专题74ls192两位十进制减法计数器电路图

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数字电子技术--中规模集成计数器及其应用--同步、异步二五十进制计数器-PPT

本方案是一个基于 FPGA  的十进制计数器。共阳极 7 段显示器上的 0 到 9 十进制计数器，硬件在 Xilinx Spartan 6 FPGA 板上实现。

74LS192 pd

74ls192加减法无法正常工作此处有个图这个是仿真图这个是功能表。最开始的时候，我们将CPU端口接了一个高电平脉冲，CPD口接上了一个开关，置低电平。给CPU口一个高电平脉冲之后，无法正常计数。反之亦然，查阅相关资料发现，触发时，另一端必须是高电平。这里我仿真图搭建正确，但是实操的时候却忽略了这个细节。不饿能放过每一个引脚的接法。不管是清零端还是什么，否则都有可能造成输出错误。...

74LS192 datashee—英版数据手册。

急需放大整形电路和时基电路设计图

十进制　　好，那就让我们来看看十进制　　所谓十进制就是以10为基数的计数体制，其计数规律是逢十进一。　　图1.3.1展示了十进制的位号和位权之间关系的图解。位号3210-1-2-3十进制数3456789位权10310210110010-110-210-3图1.3.1 十进制数的位权图　　由图中我们可以看到在小数点左边的整数部分中，位号为０的最低位所对应的位权为10的０次方，而位号为３时，位权为10的３次方，实事上，我们可以得出这样的结论，位号为n时 ，对应的位权为10的n次方；同样地，在小数点右边的情况恰好是左边的反演 ，并且多了一个负号。　　例题 1.3.1 试用位权来表示十进制数4567。　　解：将每个位子上的数码与该位的位权相乘后相加即可得到一个十进制数　　一般地，任意十进制数可表示为：

十进制同步加/减计数器（双时钟） 54192/7419254LS192/74LS192逻辑符号简要说明：192 为 可 预 置 的 十 进 制 同 步 加 / 减 计 数 器 ， 共 有54192/74192，54LS192/74LS192 两种线路

74LS192英文手册，感兴趣的小伙伴们可以瞧一瞧。

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约翰逊MC14017B是五级十进制计数器内置代码转换器。 高速运行和约翰逊spike-free输出是通过使用十进制计数器的设计。 十个解码输出通常是低，只在适当的十进制时间走高。 输出的正向变化的时钟脉冲。 这部分可用于分频应用程序以及十进制计数器或十进制译码显示应用程序。

本文档的主要内容详细介绍的是74LS90六十进制计数器的3D实验原理图免费下载。

关于74LS290的芯片介绍以及常用的几种接法。

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　　本文档的主要内容详细介绍的是采用74LS192计数芯片实现七段共阴极数码管显示的资料说明。

LCD界面显示图：一，产品功能概述：该产品型号为ZH151C，采用3A级高端芯片。这是一款正/倒计时器IC。它可以直接驱动1/4duty的4位LCD。最大计时为59:59或99:59。通过绑定选择。60分钟或100分钟一个循环。同样可以通过绑定选择32秒或64秒闹铃时间。2KHz的闹铃频率输出。本产品简单实用，有广泛的用途，如礼品盒计时器,药盒计时器,厨房定时器等.二、功能特性：◆报警输出脚可以作为开关控制或驱动另外的音乐芯片。◆内部倍压。◆32768Hz的石英作为时间基准。◆1.5V电池供电。◆直接驱动蜂鸣器。◆4位液晶显示。◆通过OPT3选择最大计时为59:59或99:59分钟。◆可以通过绑定选择倒计时器的循环功能。◆分、秒独立设置。◆要复位时,MSET按键和SSET按键要同时按下去。◆警报声以2KHz的频率输出，循环32或64次(通过OPT1选择)。

两片CT74LS160级联成100进制同步加法计数器。由图可看出：低位片CT74LS160在计到9以前，其进位输出CO＝Q3Q0＝0，高位片CT74LS160（2）的CTT＝0，保持原状态不变。当低位片计到9时，其输出CO＝1，即高位片的CTT＝1，这时，高位片才能接收CP端输入的计数脉冲。所以，输入第10个计数脉冲时，低位片回到0状态，同时使高位片加1。

The CD4017BC is a 5-stage divide-by-10 Johnson counterwith 10 decoded outputs and a carry out bit.The CD4022BC is a 4-stage divide-by-8 Johnson counterwith 8 decoded outputs and a carry-out bit.These counters are cleared

CD4017 十进制计数器的应用实验

CD4017BC • CD4022BCDecade Counter/Divider with 10 Decoded Outputs •Divide-by-8 Counter/Divider with 8 Decoded OutputsGeneral DescriptionThe CD4017BC is a 5-stage divide-by-10 Johnson counterwith 10 decoded o

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本文档的主要内容详细介绍的是十进制计数器的Multisim仿真实例电路图免费下载。

74LS390数据手册，有需要的朋友可以下来看看

Verilog数字系统设计五简单组合逻辑实验2文章目录Verilog数字系统设计五前言一、4选1多路选择器是什么？二、编程1.要求：2.实现代码：3.仿真测试：总结前言随着人工智能的不断发展，机器学习这门技术也越来越重要，很多人都开启了学习机器学习，本文就介绍了机器学习的基础内容。提示：以下是本篇文章正文内容，编程实现10进制计数器，具有异步复位功能，十位和个位用8421BCD码表示一、4选1多路选择器是什么？示例：pandas 是基于NumPy 的一种工具，该工具是为了解决

带 10 个解码输出的 Johnson 十进制计数器-74HC_HCT4017_Q100

要求设计一个2位10进制计数器，每秒加1原理图代码方式一#include "reg52.h"#define THCO0xec#define TLCO0x78//共阴极数码管，0-9段码表unsigned char code Duan[]={0x3F, 0x06,0x5B,0x4F,0x66,0x6D,0x7D,0x07,0x7F,0x6F};***i...

带 10 个解码输出的 Johnson 十进制计数器-74HC_HCT4017

双十进制纹波计数器-74HC_HCT390

集成计数器常见的是多位二进制计数器及十进制计数器，当需要实现其它进制计数器时，通常利用现有的集成计数器进行适当的连接而构成。对于当设计要求没有限定计数器的状态编码时电路设计的灵活性问题已有文献进行讨论，但各文献侧重于多次置数控制方法的实现以及侧重multsim仿真软件的应用。因此义中主要讨论的是利用已有集成计数器设计任意计数器时，其实现途径的灵活性与多样性问题。文中以2片74290实现24进制计数器为例，详细分析其实现

可预置同步BCD十进制计数器；异步复位-74HC160

首先，本次电子秒表的设计任务要求计数精度可达百分之一秒，因此基准脉冲应该获得频率为100HZ的脉冲信号。要求可显示时间99.99秒，因此每一位都为十进制位。控制部分可用三个控制键分别进行启动、暂停、清零功能。分别实现以上模块功能，即可设计出符合要求的电子秒表。

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集成计数器实现N进制计数集成计数器实现N进制计数集成计数器实现N进制计数

74161设计12进制计数器，1.74161为十六进制计数器，设计十二进制计数器时1片就可以满足要求。2.新建BDF文件及保存工程同前篇。3.将所需要的元器件和引脚拖入区域内并完成连接，如图1所示图1十二进制计数器连接图4.建立VWF文件，仿真后得到结果如图2

计数器是一种重要的时序逻辑电路，广泛应用于各类数字系统中。介绍以集成计数器74LS161和74LS160为基础，用归零法设计N进制计数器的原理与步骤。用此方法设计了3种36进制计数器，并

 Ｎ进制计数器的实现 一、用集成计数器可以实现任意进制的计数器二、集成计数器控制功能的归类三、集成计数器的级联扩展四、复位法组成任意进制加法计数器五、置位法组成任意进制加法计数器六、预置数法组成任意进制加法计数器七、预置数法组成任意进制减法计数器八、级联法和复位法的混合应用九、级联法和预置数法的混合应用十、应用总结 一、用集成计数器可以实现任意进制的计数器    随着计算机技术与电子技术的发展，集成芯片以其体积小、功耗低、功能全、使用方便等等优点，得到广泛应用，在数字电子电路中尤其得到广泛应用，成为现代电子电器必不可少的核心器件。在时序逻辑电路中，集成计数器的应用更是无孔不入，无所不在。应用集成计数器，加上简单的电路及连线，就可以组成各种形式的、任意进制的计数器，广泛应用于计数、计时、分频等电路中。就其工作原理通常是利用复位、置位、预置数等功能，采用级联法扩展容量、采用复位法、置位法或预置数法，强行中断原有计数顺序，强行对集成计数器进行复位、置位或预置数，按人们意愿组成新的计数循环，组成符合要求的计数器。在使用中，控制方法科学、简单、明了，控制电路及连线简单、易行，工作稳定性好，从而得到广泛应用。在此，我们就集成计数器的应用作较完整和系统的研究，促进集成计数器的正确使用。 二、集成计数器控制功能的归类在集成计数器中，除了实现计数器固有的常规计数功能外，还留有大量的功能控制端，方便使用者进行各种计数功能的扩展，和实现任意进制的计数器。这些功能有：功能选择、使能控制、加减控制、复位、置位、预置数等功能控制端，通过对功能控制端的控制，实现相应的功能。在我们使用集成计数器时，首先应该对这些功能进行分类，并着重研究这些功能的特点，同种功能之间细微的差别。例如：同是复位功能，有同步复位功能、异步复位功能；同样是预置数功能，也有同步预置数功能和异步预置数功能之分。只有正确认识这些功能，并分清它们之间的细微差别，才能正确使用集成计数器组成任意进制的计数器。在集成计数器预留的扩展功能中，对我们组成任意进制计数器最有用的功能有复位功能、置位功能、预置数功能。复位功能：是在复位端有效时，将本计数器复位，使其状态为“0”，即输出端完全置“0”。但复位功能有同步复位和异步复位之别，异步复位是指：只要复位端有效，即刻对计数器复位（如74LS290、160、161等计数器）。同步复位功能却有所不同，在同步复位功能中，复位端有效并不能立即使计数器复位，而是在复位端有效的同时，还必须有有效时钟脉冲边沿的触发，才能使计数器复位（如74LS163等计数器）。由于这两种复位功能的微小差异，这就决定了在使用中，特别是在用复位法组成任意进制计数器的使用中，有着很大的不同。预置数功能：是指在预置数控制端有效时，将 输入端准备好的数据置入计数器。但是，异步预置数功能和同步预置数功能之间同样存在着区别。异步预置数功能：是在预置数控制端有效时立即置入准备好的数据 （如74LS190、191）；而在同步预置数功能中，预置数控制端有效时，并不立即置入准备好的数据，而是在预置数控制端有效的同时，还必须有有效时钟脉冲边沿的触发，才能将准备好的数据 置入计数器（如74LS160、161）。由于这一差异，在用预置数法组成任意进制计数器时，同样应该加以区分。为了能够正确使用集成计数器，应该首先认识常用的集成计数器具备哪些扩展功能。下面，我们就针对一些具有典型代表意义的集成计数器芯片进行研究。图2-1  T4290的外部引线排列图VCC R02 R01  Q0 Q3T4290S91     S92 Q2 Q1   GNDT4290（T1290、74LS290、T210），是一个二-五-十进制计数器，能够进行二进制、五进制计数、通过简单联线组成十进制计数的计数器。图2-1为T290的外部引线排列图。[此贴子已经被作者于2008-7-5 13:50:59编辑过]

基于VHDL的EDA实验---3位二进制计数器

介绍了集成4位二进制计数器 74LS161 异步置零法构成任意进制计数器的 Multisim 仿真方案，即以波形方式显示计数器的计数过程、过渡状态形成异步置零信号的过程，用四踪示波器以面板

7级二进制纹波计数器-74HC4024

#ifdef UNICODEtypedef wstring _tstring;#elsetypedef string _tstring;#endif/***********************************************************************函数名称:AddBigData函数功能:两个大数据进行相加（必须为正整数 ）函数参...

双 4 位二进制纹波计数器-74LV393

Harris CD74HC4020和CD74HCT4020为14级纹波进位二进制计数器。所有计数器级都是主从触发器。阶段状态提前一次计数每个输入脉冲的负时钟转换；a高MR线上的电压水平将所有计数器重置为零状态所有输入和输出都经过缓冲。

基于探索MSI可编程同步二进制加法计数器74LS161改变应用方向进行功能扩展的目的，采用逻辑修改的方法给出了在二进制计数的基础上实现循环码计数的设计方法，即以74LS161已有的状态

基于Multisim的二位十进制数字乘法电路，与大家共享。

2018年自考工业用微型计算机押密试题及答案(五)第一部分选择题一、单项选择题(本大题共20小题，每小题2分，共40分)在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。错选、多选或未选均无分。1．十进制数65用8位二进制数表示时应为 ( )A. 11000001B B.OlOOOOOIBC. OlOOlOllBD.O0111011B2．十进制数-2用二进制补码表示...

关于十进制转十六进制，网上的方法很多，但其中相当一部分是基于显示上的转换，或是利用一些其他的库或头文件。对初学者或是希望代码在单片机环境下运行的人来说，这些代码并不是非常有用。本文基于本站一位作者的文章所给出的方法和代码进行了一些修改简化（链接如下），得出以下代码。参考文章链接：https://blog.csdn.net/Deheng_Kong/article/details/115550227代码实现：此方法主要使用位操作对十进制数进行系列处理，得到对应十六进制数。#include

十六进制转换至十进制

十进制和二进制之间的转换　　既然一个数可以用二进制和十进制两种不同形式来表示，那么两着之间就必然有一定的转换关系。　　由十进制数的一般表示式：　　可以得到整数的一般表达式：　　将等式两边分别除以2，可得第一个余数b0，同时上式演变为：　　将等式两边再除以2，可得第二个余数b1，等式变为：　　重复上述过程直到商为0，就可由所有的余数求出二进制数。　　例题 1.3.3 将(25)D转换为二进制数。　　解：该题的解题思想是，不断地用2分解十进制整数，并将余数按得到的顺序由低位到高位排列，即可得到对应的二进制数。　　所以(18)D＝(b4 b3 b2 b1 b0)B＝(10010)B　　例题1.3.4 将(155)D转换为二进制数解：当要将一个很大的十进制数转换成二进制数时，采用例题1.3.3的做法很费时 ，我们可以采用另外一种方法。这种方法的思想是从需要转换的十进制数找到与之最接近的2的幂次方，并从这个十进制数中减去该2的幂次方，在剩下的余数中重复这种做法，直到余数为0。然后将所得到的这些2的幂次方与二进制数中的位权相比，相同的位标记为1，其余的为0，这样就可得到与十进制数对应的二进制数。　　现在我们来看看155这个十进制数，与2的各个幂次方数比较后可知，与155最近的是128，即27，155减去128后余数为27，而27最接近的是24，27减去16得到11，11减去8（23）得到3，3减去2（21）得到1，1减去1（20）得到0。由于在本次计算中得到2的最高幂次为7，因此可以得知对应的二进制数是一个八位的二进制数，写出这个二进制数的位权，并将其与得到的五个2的幂次方数对比后填入1，其余的用0代替，最后得到的二进制数为10011011。　　需要指出的是，多数计算机或数字系统中只处理4、8、16、32位的二进制数据，因此,数据的位数需配成规格化的位数，如例题1.3.3种转换结果为11001，如将它配成8位,则相应的高幂项应填以0，其值不变，即11001=00011001。　　根据十进制数的一般表达式，可以得到十进制小数的表达式如下：　　将等式两边分别乘以2，可得：　　比较上面两式，可以发现第一项中2的幂次已经由原来的-1变成了0，而20是整数的最低位的位权，因此可以将该项从表达式中去掉，也就是去掉了b-1。，这样也就使得剩下的数保持为纯小数。继续在表达式的两端乘以2，可得：　　这样又得到了一个20项，也就是b-2也将再次被从式子中剔除，但同时也就产生了二进制小数的前两位。重复上述过程，直到 满足要求的位数时做“四舍五入”，也就完成了从十进制小数到二进制小数的转换。　　例题8：将(0.706)D转换成误差ε不大于2-10二进制小数。解：　　0.706 ×2=1.412……1……b-1　　0.412 ×2=0.824……0……b-2　　0.824 ×2=1.648……1……b-3　　0.648 ×2=1.296……1……b-4　　0.296 ×2=0.592……0……b-5　　0.592 ×2=1.184……1……b-6　　0.184 ×2=0.368……0……b-7　　0.368 ×2=0.736……0……b-8　　0.736 ×2=1.472……1……b-9　　最后一位小数0.472小于0.5，根据“四舍五入”原则，则有：0.0 ×2=0……0……b-10所以, (0.706)D=(0.101101001)B，误差ε< 2-10

74LS192高速的硅栅CMOS器件芯片学习参考手册免费下载。

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求解惑！

概述：CD4017是一款十进制计数器/脉冲分配器。其具有10 个译码输出端，CP、CR、INH 输入端。时钟输入端的斯密特触发器具有脉冲整形功能，对输入时钟脉冲上升和下降时间无限制。

4位八段数码管的十进制加计数仿真实验，程序采用汇编语言编写。此程序在仿真软件上与EDN-51实验板上均通过。仿真图中的数码管位驱动采用74HC04，如按EDN-51板上用想同的PNP三极

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CC4518中文资料：  CC4518为双BCD加计数器，该器件由两个相同的同步4级计数器组成。计数器级为D型触发器。

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二进制加计数器

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40110 为十进制可逆计数器/锁存器/译码器/驱动器，具有加减计数，计数器状态锁存，七段显示译码输出等功能。

The CD4024BC is a 7-stage ripple-carry binary counter.Buffered outputs are externally available from stages 1through 7. The counter is reset to its logical “0” stage by alogical “1” on the reset input. The counter is

The CD4029BC is a presettable up/down counter whichcounts in either binary or decade mode depending on thevoltage level applied at binary/decade input. When binary/decade is at logical “1”, the counter counts in binary,

本文档的主要内容详细介绍的是如何使用Multisim仿真一个60进制的计数器的详细资料免费下载

100进制加减计数器的设计与制作:本电路结构如图袁主要由晶体振荡电路，分频电路，控制电路，计数电路，译码电路，数码管显示等几部分构成。

关于FPGA的资料，包括很多有用的东西，在EDA实验4-10进制计数器。

提出一种基于Proteus 软件的任意进制计数器的设计。以74LS163 集成计数器为基础，用置数法设计了两种48 进制计数器，采用Proteus 软件对计数器进行仿真。结果表明，Proteus 软件具有实现48 进制计数器的功能。仿真图像清晰，能快速准确地验证设计结果。

自己根据项目需要写的

我也是刚接触！这个案例是自己摸索着做出来的！希望高手加我：QQ985512045

1、实现一个24进制加法计数器的设计本实验设计实现一个24进制的加法计数器，它由晶体振荡器、分频器、计数器和数码管显示器组成，图6.1是该加法计数器的示意图。晶体振荡器产生稳定的50MHz的脉冲信号CLK，经过分频器后输出标准秒脉冲CLK1，作为计数器的计数时钟。计数器按照“00-01-02…22-23-00-01”的规律计数，每增加1秒，计数器加1，信号Result[7:4]代表计数器输出结果的十位，Result[3:0]代表个位，RSTn为复位输入信号。将计数器的结果Result输出给数码管显示。功能模块图与输入输出引脚说明该工程包含顶层模块counter24与底层模块Accumulator_module、Digitron_NumDisplay_module。其中，Accumulator_module实现分频器和计数器的功能，Digitron_NumDisplay_module实现数码管显示器的功能。图6.2是整个工程的模块功能图。下面介绍一下顶层模块各引脚的功能：原作者：语雀

题: 设计一个可控进制的计数器, 当输入控制变量M=0时工作在5进制; M=1时工作在15进制.分析: 根据之前博客中的分析, 我们可以通过两种方法来进行设计.设计方案1: 我们可以通过设计74163的四个输入引脚DCBA, 再辅以LOAD'引脚的设计, 来实现可控进制计数器的功能. 将控制变量设定为M: 规定M=0时计数器工作...

目录1. 集成四位二进制计数器【74LVC161】(1) 逻辑符号(2) 功能表(3) 应用① 构成任意模数的计数器a. 反馈清零法b. 反馈置数法c. 位数拓展② 构成分频器③ 构成序列信号发生器④ 构成脉冲分频器集成十进制计数器【74LS290】集成十进制计数器【74LS390】1. 集成四位二进制计数器【74LVC161】(1) 逻辑符号CR：CR：CR： 异步置0端。优先级最高。PE：PE：PE：并行置数端。次高优先级。TC：TC：TC：进位信号。CEP，CET：CEP

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`测量范围10Hz-50Mhz，通过8数数码管显示； 数字频率计的原理很简单，就是计算每秒钟内待测信号的脉冲个数，按照分模块设计的思想，分为：计数模块，数码管显示模块，控制信号模块，因为系统还需要高电平为1s的脉冲信号，所以还需要一个分频模块：1、计数模块 计数器有二级制计数器和BCD计数器，因为计数器的计数结果需要经过译码送至数码管实时显示，所以选用BCD计数器，根据测量频率最大为50M，设计出计数器电路由8个4位BCD计数器级联实现； 2、数码管显示模块BCD计数器的输出值为4位BCD码，经过显示译码电路送至数码管，显示译码电路通过查找表LUT设计方法实现；8位数码管同时显示8个不同的值需要通过16个IO（8位位选，8位段选）动态扫描显示，扫描间隔为1ms，AC620实验板上为了节省IO，通过两片74HC595实现串并转换，将16位串行数据转换为16位并行数据，所以采用三个IO口（工作频率SCK，存储频率RCK，数据线DIO）就可以实现数码管动态扫描显示，查阅74HC595数据手册可知，3.3V电压时工作频率SCK为1.25M； 3、控制信号模块上面两个模块小梅哥都讲的很详细了，可以参考PDF或者视频，分频器最重要的就是控制信号模块，它需要产生3个控制信号：1）待测信号控制脉冲 —— 产生高电平时长为1s的门控信号，和待测信号经过与门；起到控制待测脉冲到达计数器的作用2）锁存信号控制脉冲 —— 计数器在门控信号为低电平时需要清零，以便下次计数，数码管上显示的数据需要保持，通过设计一个32位锁存器实现；在门控信号高脉冲结束时将数据送至锁存器供数码管显示3）计数器复位脉冲——将计数结果送至锁存器后，需要将计数器清零； 4、分频器模块 系统需要0.5hz的门控信号，1hz的脉冲信号，利用分频器将50M系统时钟分频得到；一直很喜欢小梅哥的一句话，代码只是照图施工的过程，下面就是按照FPGA从上向下的设计思想实现整个设计了：（.....好像不是很好传verilog代码....放附件吧）modelsim仿真波形如图：用10hz，25khz，50mhz三个信号下板验证效果：`

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附图所示电路为双刀十掷开关制作的十进制电阻箱电路图。图中仅画出了（Ⅰ）、（Ⅱ）和（Ⅷ）三个单元的电阻系列，其余五个单元的电阻系列未画出（仅电阻值不同）。该电阻箱每单元电路仅用4只电阻，八个单元用了32只电阻。 　　

4026 CMOS 7段显示十进制计数 分频器:

2018年自考工业用微型计算机押密试题及答案(二)第一部分选择题一、单项选择题(本大题共20小题，每小题2分，共40分)在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。错选、多选或未选均无分。1.8位二进制所表示的无符号整数，其相应的十进制数范围是 ( )A．0～255B．1～256C.1～255D．0—2562. 81H是用8位二进制原码所表示的十六进制数，其相...

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本帖最后由 gk320830 于 2015-3-9 15:46 编辑

自己做了个简单的两位数码管按键计数；效果不太好，按键时十位数码管一闪一闪的，晃眼。应该是程序问题。发出来大家看看。下面是程序：#include#define uchar unsigned char#define uint unsigned intuchar code table[]={0x3f,0x06,0x5b,0x4f,0x66,0x6d,0x7d,0x07,0x7f,0x6f};//共阴数码管0~9段码***it K1=P1^6;***it K2=P1^7;void delayms(uint);void key();void display();uchar num;/********主函数**********/void main(){while(1){ key(); display();}}/*******按键函数*******/void key(){ if(K2==0) {delayms(10);if(K2==0){if(num==0)num=100;num--;while(!K2);} } if(K1==0) {delayms(10);if(K1==0){num++;if(num==100)num=0;while(!K1);} } }/******延时函数******/void delayms(uint x){ uint i,j; for(i=x;i>0;i--)for(j=110;j>0;j--);}/**********显示函数**********/void display(uchar shi,uchar ge){ shi=num/10; ge=num%10; P3=0xfe; P2=table[shi]; delayms(5); P3=0xfd; P2=table[ge]; delayms(5);}

stm32十六进制字符串转十进制数值代码不会用，文档写在语雀内转载请注明作者：DK127、Holinkity代码仅供参考，

74ls详细资料

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一个小VI 大家可以参考下

1、十进制46.25对应的二进制表达式为()。A 101110.11B 101101.01C 101110.1 D 101110.01解析：首先这个题目是由整数部分和小数不同共同组成的，整数部分的计算是最简单的，整数部分除以2得到的余数按照逆向顺序排列后就是整数部分转化为二进制后的结果，详细过程如下所示：46转化为二进制的结果就是101110小数部分的计算可能很多人记不清楚了，小数部分每次乘以2后得出的结果取其整数部分，直到小数部分为0或达到精度要求为止

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