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SystemVerilog里的regions以及events的调度

本文讲一下SystemVerilog的time slot里的regions以及events的调度。SystemVerilog语言是根据离散事件执行模型定...

2023-07-12 标签：EDA工具仿真器 Verilog语言 2.7k 0

continue和break跳转语句介绍

跳转语句允许程序代码跳过一个或多个编程语句，SystemVerilog的jump语句是continue、break和disable。

2022-11-09 标签：锁存器编程语言 Verilog语言 2.7k 0

怎么去设计一个基于FPGA的二进制比较器呢？

前一篇文章我们介绍了通过小脚丫FPGA核心开发板来进行门电路的实验过程。当然，我们还可以画出更多复杂的门电路组合，并且通过小脚丫FPGA轻松实现对应的输...

2023-06-20 标签：led灯比较器数字电路 2.7k 0

看看两个使用Verilog HDL设计的简单电路

与非门的Verilog 描述如下图所示，源程序文件的后缀为.v。

2023-09-17 标签：D触发器时序逻辑电路 Module 2.6k 0

谈谈UVM代码生成器的优点及开发使用时需要注意的问题

毋庸置疑，UVM大大提高了我们开发验证平台的效率。但同时，熟练掌握UVM搭建验证平台也并不是一件容易的事情。

2023-05-20 标签：寄存器 UVM 代码生成器 2.5k 0

探讨always和always_ff的编码风格

数字门级电路可分为两大类：组合逻辑和时序逻辑。锁存器是组合逻辑和时序逻辑的一个交叉点，在后面会作为单独的主题处理。

2023-02-03 标签：锁存器 RTL Verilog语言 2.5k 0

ASIC和FPGA到底选哪个好？两者的流程有什么区别？

ASIC (Application Specific Integrated Circuit)，即专用集成电路，是指应特定用户要求和特定电子系统的需要而设...

2023-09-02 标签：FPGA设计存储器 ASIC芯片 2.5k 0

简述进行IC设计的方法和设计流程

IC设计是一门非常复杂的科学，在IC生产流程中，IC芯片主要由专业IC设计公司进行规划、设计，如联发科、高通、Intel等国际知名大厂，都自行设计各自专...

2023-07-19 标签：CMOS IC设计 EDA工具 2.5k 0

Testbench编写指南（2）读取txt文件数据

用“数组”来表述Verilog HDL中的定义并不准确，但对大多数人来说应该更好理解。

2023-09-02 标签：存储器二进制 HDL 2.5k 0

Systemverilog中的Driving Strength讲解

在systemverilog中，net用于对电路中连线进行建模，driving strength(驱动强度)可以让net变量值的建模更加精确。

2023-06-14 标签：驱动器仿真器 Verilog语言 2.4k 0

SystemVerilog中可以嵌套的数据结构

SystemVerilog中除了数组、队列和关联数组等数据结构，这些数据结构还可以嵌套。

2022-11-03 标签：Verilog语言 2.4k 0

如何在开始码代码的时候就考虑时序收敛的问题？

硬件描述语言（verilog，systemVerilog，VHDL等）不同于软件语言（C，C++等）的一点就是，代码对应于硬件实现，不同的代码风格影响硬...

2023-09-21 标签：寄存器计数器 LUT 2.4k 0

SystemVerilog中的联合(union)介绍

在 SystemVerilog 中，联合只是信号，可通过不同名称和纵横比来加以引用。

2023-10-08 标签：RTL Verilog语言 2.3k 0

关于CRC硬件并行化运算的实现方法的探讨

数据校验的基础运算原理是模2运算，也就是异或运算。

2023-06-20 标签：CRC校验 Verilog语言 LSFR算法 2.3k 0

优秀的Verilog/FPGA开源项目-MATH库介绍

数字信号处理（ Digital Signal Processing)技术广泛地应用于通信与信息系统、信号与信息处理、自动控制、雷达、军事、航空航天、医...

2023-06-19 标签：dsp fpga 数字信号处理器 2.2k 0

SystemVerilog构建大型电路

构建一个从 0 到 999（含）计数的计数器，周期为 1000 个周期。复位输入是同步的，应该将计数器复位为 0。

2023-03-09 标签：计数器时序电路状态机 2.2k 0

SystemVerilog语言中的Upcasting和Downcasting概念解析

要想理解清楚SystemVerilog语言中的Upcasting和Downcasting概念，最好的方式从内存分配的角度理解。

2022-11-24 标签：Verilog语言 2.2k 0

SystemVerilog的覆盖率建模方式

为了确保验证的完备性，我们需要量化验证目标。SystemVerilog提供了一套丰富的覆盖率建模方式。

2023-06-25 标签：有限状态机 FIFO存储 FSMC 2.2k 0

如何使用display提高debug效率呢？

在verilog中虽然没有system verilog的assertion，但是我们依旧可以使用display打印检查各类错误，在RTL级的仿真中能够快...

2023-08-27 标签：芯片设计仿真器 RTL 2.2k 0

ChatGPT在后端设计中有什么应用？

本以为ChatGPT对于IC后端设计帮助应该不大，毕竟它非常依赖EDA工具，它对于EDA工具这种非常专业的、非常Custom的东西了解和训练的数据应该不...

2023-03-07 标签：EDA工具 Verilog语言 VHDL源码 2.2k 0

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IoT是Internet of Things的缩写，字面翻译是“物体组成的因特网”，准确的翻译应该为“物联网”。物联网（Internet of Things）又称传感网，简要讲就是互联网从人向物的延伸。
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