FPGA/ASIC技术
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赛灵思（Xilinx）FPGA用户约束文件的分类和语法说明
FPGA设计中的约束文件有3类：用户设计文件（.UCF文件）、网表约束文件（.NCF文件）以及物理约束文件（.PCF文件），可以完成时序约束、管脚约束以及区域约束。...
2017-02-11 2008
Xilinx可编程逻辑器件设计与开发（基础篇）连载45：Spartan
本节将简单介绍在PlanAhead工具中如何应用ChipScope核和分析工具进行逻辑调试与验证。先通过一个向导将ChipScope核插入设计中，选择待测试的网线，并进行例化、连接和综合，最后，导入布局和时...
2017-02-11 987
Xilinx可编程逻辑器件设计与开发（基础篇）连载44：Spartan
FloorPlanning 工具是PlanAhead 的一个组成部分，用它可以对FPGA 设计进行分析，首先找到设计中的时序问题或者拥塞的问题，然后再通过使用PloorPlanning 约束，以指导实现工具产生更优的结果。...
2017-02-11 911
基于高速FPGA 的PCB 设计技巧
如果高速PCB 设计能够像连接原理图节点那样简单，以及像在计算机显示器上所看到的那样优美的话，那将是一件多么美好的事情。然而，除非设计师初入PCB 设计，或者是极度的幸运，实际的...
2017-02-11 873
Xilinx可编程逻辑器件设计与开发（基础篇）连载43：Spartan
在ISE 中可以进行时序分析，在PlanAhead 中同样也可以进行时序分析。下面介绍用PlanAhead 进行时序分析的步骤。...
2017-02-11 898
Xilinx可编程逻辑器件设计与开发（基础篇）连载42：Spartan
可以将综合后网表文件导入PlanAhead，然后在PlanAhead 中完成关键时钟，以及相关联的I/O 端口的分配。...
2017-02-11 892
Xilinx可编程逻辑器件设计与开发（基础篇）连载46：Spartan
我们知道，PicoBlaze微控制器只提供一个中断输入口，如果设计中需要多个中断，可以在FPGA中用逻辑实现。...
2017-02-11 633
FPGA开发技巧之同步复位与异步复位的理解
前两天和师兄讨论了一下design rule其中提到了同步异步复位的比较这个常见问题，据说也是IC公司经常问到的一面试题。...
2017-02-11 2533
Xilinx FPGA 嵌入式系统程序引导和启动的流程
这篇blog想弄清楚FPGA上电配置后程序引导和启动的整个流程是怎么样的，不是谈论如何编写bootloader。...
2017-02-11 2736
详细图解在NetFPGA上创建一个OpenFlow Switch的网络
Author: KiKiCompany：Digilent ChinaEmail : Date: 2012.02.14 目的 如 图所示，我们会创建一个基于OpenFlow Switch的网络。...
2017-02-11 2570
Xilinx可编程逻辑器件设计与开发（基础篇）连载50：Spartan
1. PICOBLAZE 嵌入式系统，包括1 个8 位的方波输出口，一个驱动两位7 段LED 的输出口，一个时钟输入和一个中断输入。...
2017-02-11 885
Xilinx可编程逻辑器件设计与开发（基础篇）连载49：Spartan
通常情况下，如果对性能要求不是太高，最好是让PicoBlaze在低频下工作，因为它所处理的外设一般为低速设备，例如，串行通信，按键等。另外，低频工作也会减少等待周期，降低系统功耗。...
2017-02-11 998
Xilinx可编程逻辑器件设计与开发（基础篇）连载47：Spartan
PicoBlaze微控制器支持最大256个输入口和256 个输出口，PicoBlaze与输入和输出有关的信号在“PicoBlaze微控制器接口信号”部分有详细说明，包括PORT_ID[7:0]、IN_PORT[7:0]、OUT_PORT[7:0]、READ_STROBE WRITE_STR...
2017-02-11 582
XPS中的时钟模块和复位模块
CLKIN为外部输入时钟，如果是外部差分时钟信号，在MHS文件的PORT行指定*_p、*_n管脚均为同样的Net，如dcm_clk_s，差分极性分别指定正负即可。...
2017-02-11 2872
Virtex6 GTX设计总结：预加重、均衡、输出振幅的值
在Xilinx的Virtex6 FPGA中，GTX作为一种低功耗的吉比特收发器，配置灵活，功能强大，并与FPGA内部的其他逻辑资源紧密联系，可用于实现多种高速接口（如XAUI、PCIE等）。...
2017-02-11 4285
Nexys3学习手记6：ClockingWizard探秘
这一节，我们首先会来了解下Nexys3上的主角儿XC6SLX16（Spartan-6家族）的时钟资源，当然不会照搬ug382.pdf（建议大家去浏览一遍）的内容凑篇幅，但身为“菜鸟”的特权同学也只能够蜻蜓点水般和...
2017-02-11 4048
Nexys3学习手记5：流水灯在线运行
在进行第一个工程实例前，顺便提一下设计工具相关资源的获取。从特权同学接触的几家FPGA开发工具来看，Xilinx在这方面做得应该算是最人性化的了，其设计资源可谓唾手可得。...
2017-02-11 1731
Nexys3学习手记2：建立自己的开发环境
接过Nexys3时，本以为能够提供一张资料光盘，结果大失所望，除了静电袋里一块精致的电路板，就只有一条用于供电和下载的USB连接线和两张活页。...
2017-02-11 1660
PowerPC平台Linux的移植（三）
如果你想使用ram disk，那么用以下命令进行编译:make zImage.initrd否则用以下命令:make以前编译2.4内核的时候之前都要用make dep 命令保证编译内核时所有的依赖，例如头文件，都存在。...
2017-02-11 894
PowerPC平台Linux的移植（二）
处理并编译内核源代码Linux内核的配置系统由三个部分组成，分别是：1. Makefile：分布在 Linux 内核源代码中的 Makefile，定义 Linux 内核的编译规则...
2017-02-11 1407
PowerPC平台Linux的移植（一）
PowerPC是早期Motorola和IBM联合为Apple的MAC机开发的CPU芯片,商标权同时属于IBM和Motorola,并成为他们的主导成品.IBM主要的PowerPC产品有PowerPC604s(深蓝内部的CPU), PowerPC750,PowerPCG3(1.1GHz).Motorola主要有MC和...
2017-02-11 1969
Nexys3学习手记8：FT232之高速UART
继续上一节的工程，这里要接着在XPS上扩展一个UART外设，配合板载的USB2UART芯片FT232R做个高速串口传输测试。 ...
2017-02-11 5118
FPGA verilog实现的1602时钟计数器
网上很少用人公开这一类代码，一搜FPGA 1602，都是写一个静态的显示，在实际应用中，是没有用的，因此这个简单的例子，给大家抛砖引玉了！...
2017-02-11 2062
如何使用PlanAhead/Adept加速管脚排布
在排布FPGA管脚生成ucf文件的过程中，当FPGA管脚较多的时候，手工排布管脚不仅效率低，而且很容易出错。借助PlanAhead和Adept等工具，可以很方便快速的实现管脚排布。...
2017-02-11 2090
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