FPGA/ASIC技术

电子发烧友本栏目为FPGA/ASIC技术专栏，内容有fpga培圳资料、FPGA开发板、FPGA CPLD知识以及FPGA/ASIC技术的其它应用等；是您学习FPGA/ASIC技术的好栏目。

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QII中的几个Warning的解决方法

前几天看网上一个人说在仿经典基础程序按键消抖实验的时候0 error、0 warning，正好我也在仿这个实验，就想说看看我能不能也出现这样爽的结果，没想到最后出了6个warning，于是施展搜索大法，...

2017-02-11 标签：eda QII Warning 2194

verilog语言实现任意分频

原文出自：分频器是指使输出信号频率为输入信号频率整数分之一的电子电路。在许多电子设备中如电子钟、频率合成器等，需要各种不同频率的信号协同工作，常用的方法是以稳定度高的晶体...

2017-02-11 标签：分频器 Verilog 电子电路 14677

组合逻辑设计中的毛刺现象

和所有的数字电路一样，毛刺也是FPGA电路中的棘手问题，它的出现会影响电路工作的稳定性，可靠性，严重时会导致整个数字系统的误动作和逻辑紊乱。...

2017-02-11 标签：FPGA 电路毛刺 2325

Linux2.4.26内核在Virtex II Pro开发板上的移植

下载Crosstoolcrosstool-在网上可以很容易找到，#tar zxvf crosstool-0.43.tar.gz#cd crosstool-0.43#vim demo-powerpc-405.sh 修改脚本TARBALLS_DIR=/home/yaoq/crosstool-0.43...

2017-02-11 标签：Linux 开发板 838

FPGA管脚分配时需注意的一些事项

设计过FPGA的原理图，看FPGA的手册，说管脚的分配问题，如时钟管脚要用GC类管脚，而且单端时钟输入时要用P类型的管脚，不能用N类型管脚等等。...

2017-02-11 标签：FPGA 12537

学习FPGA需要注意的几个重要问题

如何学好FPGA呢，很多人很困惑，多数停留在基础位置徘徊，我就这方面问题给大家谈几点自己的看法。...

2017-02-11 标签：FPGA 数字电路 HDL语言 1187

使用Signal Tap II采集到的数据进行Matlab仿真

在使用FPGA进行无线通信或者进行信号处理时，一般按照这样的步骤进行...

2017-02-11 标签：FPGA MATLAB仿真 Signal Tap II 3847

深入分析verilog阻塞和非阻塞赋值

学verilog 一个月了，在开发板上面写了很多代码，但是始终对一些问题理解的不够透彻，这里我们来写几个例子仿真出阻塞和非阻塞的区别...

2017-02-11 标签：Verilog 阻塞非阻塞 1702

FPGA设计全流程：ModelsimSynplify.ProISE

介绍如何编译HDL必须的Xilinx库和结构仿真。创建将被编译库的目录在编译库之前，最好先建立一个目录（事实上必须建立一个目录），步骤如下...

2017-02-11 标签：FPGA FPGA设计 Xilinx 1531

基于Xilinx FPGA的通用信号采集器

上一篇写了基于Xilinx FPGA的通用信号发生器的案例，反响比较好，很多朋友和我探讨相关的技术，其中就涉及到信号的采集，为了使该文更有血有肉，我在写一篇基于Xilinx FPGA的通用信号采集器...

2017-02-11 标签：FPGA Xilinx 2118

基于System Generator的FPGA开发总结

前一阵一直在忙，所以没有来得及写博文。弄完杂七杂八的事情，又继续FPGA的研究。使用Verilog HDL语言和原理图输入来完成FPGA设计的方法都试验过了，更高级的还有基于System Generator和基于EDK...

2017-02-11 标签：FPGA Xilinx 8695

8位无符号数乘法运算HDL设计实例

加减乘除是运算的基础，也是我们在小学课堂里的重点必修课。乘除运算虽然对于我们今天来说还是小菜一碟，让计算机做起来也是九牛一毛不足挂齿，但是要真探究一下计算机是如何完乘除运...

2017-02-11 标签：HDL 9461

cordic算法verilog实现（复杂版）

module cordic (clk,rst_n,ena,phase_in,sin_out,cos_out,eps); parameter DATA_WIDTH=8; parameter PIPELINE=8; ...

2017-02-11 标签：Verilog CORDIC 4744

cordic算法verilog实现（简单版）

cordic算法verilog实现（简单版）(转载）module cordic(clk, phi, cos, sin); parameter W = 13, W_Z = 14; input clk; input [W_Z-1:0] phi; output[W-1:0] ...

2017-02-11 标签：Verilog CORDIC 3503

7 FPGA SATA3.0 6Gbps Host IP通过UNH

IntelliProp的SATA 6Gb/s Host IP核刚刚在新罕布什尔大学互通测试实验室(UNH-IOL)通过认证测试。...

2017-02-11 标签：FPGA SATA 3438

借助Intel i7 处理器和 Xilinx FPGA实现的开放式毫米波测试平台

美国国家仪器公司（NI）和德国德累斯顿工业大学开展合作，通过世界上第一台开放式毫米波测试平台来拓展德累斯顿5G实验室（D5GL），该测试平台能实时处理超过2GHz的RF（射频）信号，可以作...

2017-02-11 标签：FPGA Xilinx intel 1241

ZedBoard学习手记（四）为使用Linux系统做准备

裸机控制外设是非常简单的，与普通的单片机并无二异，但仅仅有裸奔代码还远远无法发挥Cortex-A9硬核的作用，毕竟Zynq芯片集成了一颗最高能跑到1GHz的双核CPU（ZedBoard上的XC7Z020只能到800MHz）。...

2017-02-11 标签：Linux Zedboard Zynq芯片 2354

ZedBoard学习手记（三）为自定义外设编写裸奔控制软件

由于Xilinx已经为我们做了大部分的铺垫工作，因此裸奔控制外设这一步就显得十分简单了，如果不用Linux和图形界面显示，大概我的作品早早的就完成了吧。...

2017-02-11 标签：Linux Xilinx Zedboard 1194

ZedBoard学习手记（二）开发自定义AXI总线外设IP核

想要发挥ZYNQ芯片的特长，让整个系统协同工作起来，就需要将PS与PL两部分结合在一起，在Cortex-A9核和FPGA逻辑资源之间建立通信的通道，这条通道就是AXI总线。...

2017-02-11 标签：IP核 Zedboard 4376

Xilinx DDR3控制器接口带宽利用率测试（四

描述：在此项测试中，发起四次读写访问，其中读写操作分别间隔开，四次读写操作访问的地址都是同一个，由此观察读写切换引入的带宽开销。...

2017-02-11 标签：DDR3 Xilinx 6060

Xilinx DDR3控制器接口带宽利用率测试（三）

描述：在此项测试中，每个Bank只访问一次，接着依次访问其它Bank。DDR3有限制在一定时间内可以输入的Bank打开指令个数，即在一定时间内只允许输入最多4个Bank打开命令。...

2017-02-11 标签：DDR3 Xilinx 4677

Xilinx DDR3控制器接口带宽利用率测试(二）

描述：单Bank内行切换时，每次打开一个Row，进行一次写操作以后，必须重新打开另外一个Row，才能进行该Row的写操作。两个Row打开操作有时间间隙要求，打开Row到写操作也有时间间隙要求。...

2017-02-11 标签：DDR3 Xilinx 3117

ZedBoard学习手记（十）图形界面控制ZedBoard硬件

今天所讨论的内容就是通过QT开发的GUI软件来控制ZedBoard板上的硬件外设，完整的信号链如下：QT GUI → Linux Driver → AXI Bus → My_GPIO Peripheral → LED & Switch首先在QT Creator中建立一个QT GUI工程，命名...

2017-02-11 标签：C++Zedboard 2838

ZedBoard学习手记（九）在ZedBoard上运行QT图形软件

在Zynq平台上运行QT其实与PC无异，都需要相应的执行环境，只不过PC上的QT Lib可以使用QT SDK自动安装配置，而Zynq平台上的QT Lib则需要手动安装。...

2017-02-11 标签：Xilinx Zynq Zedboard 1691

ZedBoard学习手记（八）更大的目标！

在Linux下做GUI，比较简单的方法是使用QT。QT一直被用于跨平台的应用程序开发，之前属于Nokia，现在被卖给了Digia，开源版本的主页是。...

2017-02-11 标签：Linux Zedboard 1259

按键消抖的原理和基于verilog的消抖设计

按键开关是各种电子设备不可或缺的人机接口。在实际应用中，很大一部分的按键是机械按键。在机械按键的触点闭合和断开时，都会产生抖动，为了保证系统能正确识别按键的开关，就必须对...

2017-02-11 标签：Verilog 23559

一步一步学ZedBoard Zynq(四)：基于AXI Lite 总线的从设备IP设计

本小节通过使用XPS中的定制IP向导(ipwiz)，为已经存在的ARM PS 系统添加用户自定IP(Custom IP )，了解AXI Lite IP基本结构，并掌握AXI Lite IP的定制方法，为后续编写复杂AXI IP打下基础。...

2017-02-10 标签：Zynq Zedboard 6238

一步一步学ZedBoard Zynq(三)：使用自带外设IP让ARM PS访问FPGA

这一节的目的是使用XPS为ARM PS?处理系统?添加额外的IP。从IP Catalog 标签添加GPIO，并与ZedBoard板子上的8个LED灯相连。当系统建立完后，产生bitstream，并对外设进行测试。...

2017-02-10 标签：FPGA Zynq Zedboard 3899

一步一步学ZedBoard Zynq(二)：使用PL做流水灯

《一步一步学ZedBoard & Zynq》系列第二篇，目的是为了学习不使用ARM PS情况下，只对Zynq PL的编程方法，同时学习Xilinx?PlanAhead工具的使用方法?...

2017-02-10 标签：FPGA Zynq Zedboard 4239

开启400G以太网：Spirent 400G以太网测试系统

在法国尼斯举行的2014WDM和下一代光纤网络研讨会上，思博伦通信和赛灵思公司讨论了通过Spirent 400G以太网测试系统对华为NE5000E以太网核心路由成功测试的完成情...

2017-02-10 标签：以太网赛灵思思博伦通信 1792

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