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ip核

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IP就是知识产权核或知识产权模块的意思，在EDA技术开发中具有十分重要的地位。美国著名的Dataquest咨询公司将半导体产业的IP定义为“用于ASIC或FPGA中的预先设计好的电路功能模块”。

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ip核技术

Video Processing Subsystem与HDMI示例设计

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2025-11-07 标签：amd HDMI Video 293 0

JESD204B IP核的配置与使用

物理层的位置，一种是物理层在JESD204 IP里；另外一种是物理层在JESD204 IP外部，需要再配置JESD204 phy IP核进行使用。

2025-05-24 标签：收发器寄存器 IP核 1.5k 0

基于8051 IP调试器设计方案

8051 IP调试器是一种对基于8051指令系统的IP核进行调试的软硬件结合工具，需要与集成开发环境(IDE)结合使用。

2025-05-07 标签：寄存器指令系统 IP核 850 0

vivado IP核cordic中sin和cos的计算

Architectural Configuration选择为并行模式，具有单周期数据吞吐量和较大的硅面积。具有并行结构配置的CORDIC核使用移位相加子...

2025-05-03 标签：模块 IP核 Vivado 1.3k 0

一文详解AXI DMA技术

AXI直接数值存取（Drect Memory Access，DMA）IP核在AXI4内存映射和AXI4流IP接口之间提供高带宽的直接内存访问。DMA可以...

2025-04-03 标签：接口内存 dma 2.1k 0

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Video In to AXI4-Stream IP核用于将视频源(带有同步信号的时钟并行视频数据，即同步sync或消隐blank信号或者而后者皆有)转...

2025-04-03 标签：接口 Xilinx fifo 2.2k 0

Zynq7000处理器的配置详解

添加好ZYNQ7 Processing System IP核后，需要对其进行配置，双击弹出如下窗口。绿色部分表示ZYNQ PS部分中可配置的项目，可以双...

2025-03-27 标签：处理器时钟中断 2.2k 0

Vivado FIR IP核实现

Xilinx的FIR IP核属于收费IP，但是不需要像 Quartus那样通过修改license文件来破解。如果是个人学习，现在网络上流传的licens...

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RAM-Based Shift Register Xilinx IP核的使用

一般来讲，如果要实现移位寄存器的话，通常都是写RTL用reg来构造，比如1bit变量移位一个时钟周期就用1个reg，也就是一个寄存器FF资源，而移位16...

2025-01-21 标签：寄存器 Xilinx IP核 2.9k 0

XADC IP核介绍

1. XADC介绍 xadc在所有的7系列器件上都有支持，通过将高质量模拟模块与可编程逻辑的灵活性相结合，可以为各种应用打造定制的模拟接口，XADC ...

2025-01-15 标签：FPGA IP核 XADC 2.1k 0

FIFO IP核的使用教程

在数字设计中，利用FIFO进行数据处理是非常普遍的应用，例如，实现时钟域交叉、低延时存储器缓存、总线位宽调整等。下图给出了FIFO生成器支持的一种可能配置。

2025-01-03 标签：FPGA fifo IP核 4k 0

Vivado中FFT IP核的使用教程

本文介绍了Vidado中FFT IP核的使用，具体内容为：调用IP核>>配置界面介绍>>IP核端口介绍>>MATLA...

2024-11-06 标签：FFT 仿真端口 5.4k 0

Xilinx 7系列FPGA PCIe Gen3的应用接口及特性

Xilinx7系列FPGA集成了新一代PCI Express集成块，支持8.0Gb/s数据速率的PCI Express 3.0。本文介绍了7系列FPGA...

2024-11-05 标签：FPGA Xilinx 计算机 4.5k 0

Xilinx DDS IP核的使用和参数配置

用RAM实现一个DDS，从原理上来说很简单，在实际使用的时候，可能没有直接使用官方提供的IP核来的方便。这个博客就记录一下，最近使用到的这个DDS IP。

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2024-10-25 标签：FPGA Xilinx IP核 2.1k 0

数字芯片设计验证经验分享（第三部分）：将ASIC IP核移植到FPGA上——如何确保性能与时序以完成充满挑战的

本篇文章是SmartDV数字芯片设计经验分享系列文章的第三篇，将继续分享第五、第六主题，包括确保在FPGA上实现所需的性能和时钟两个方面的考量因素。

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VIVADO软件使用问题总结

【关键问题！！！！重要！！！】VIVADO会在MESSAGE窗口出提示很多错误和警告信息！

2023-12-15 标签：软件 IP核 Vivado 8.1k 0

AMD Versal系列CIPS IP核建立示例工程

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2023-12-05 标签：amd 调试 IP核 1.4k 0

Distributed Memory Generator IP核简介

Distributed Memory Generator IP 核采用 LUT RAM 资源创建各种不同的存储器结构。IP可用来创建只读存储器 (ROM...

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FPGA IP核开发流程概要

开发和验证 FPGA IP 不仅仅是编写 HDL，而是需要更多的思考。让我们来看看如何做吧！

2023-10-17 标签：fpga 接口 HDL 1.8k 0

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