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fpga设计

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FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

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fpga设计技术

基于Xilinx Kintex开源的FPGA设计方案

DFC设计公司是一家传统的电子设计服务公司，其产品主要涉及基于FPGA和DSP技术的高端电子硬件及PCB设计、专用电子产品设计、机器视觉设计以及下面将会...

2018-07-05 标签：fpga设计 xilinx 4.7k 0

手把手用Verilog实现FIR滤波器

首先需要把FIR最基本的结构实现，也就是每个FIR抽头的数据与其抽头系数相乘这个操作。由顶层文件对这个基本模块进行多次调用。

2023-06-19 标签：转换器 FPGA设计 FIR 4.6k 0

vivado主界面及设计流程

Vivado设计主界面，它的左边是设计流程导航窗口，是按照FPGA的设计流程设置的，只要按照导航窗口一项一项往下进行，就会完成从设计输入到最后下载到开发...

2023-09-17 标签：FPGA设计寄存器 TCL 4.6k 0

请问create_generated_clock该怎么使用呢？

FPGA设计中，生成时钟分为两大类：自动生成时钟和用户生成时钟。

2024-01-25 标签：FPGA设计 PLL电路 4.5k 0

always组合逻辑块的讲解和译码器的实现

always 语句是重复执行的。always 语句块从 0 时刻开始执行其中的行为语句；当执行完最后一条语句后，便再次执行语句块中的第一条语句，如此循环反复。

2023-05-22 标签：FPGA设计 led灯译码器 4.5k 0

基于FPGA设计的医学监测用视力测试仪设计

实现用FPGA随机生成不同方向的E，通过VGA接口在显示器上显示，判断测试者按的按键方向是否正确，通过几轮测试计算并显示最终视力测试结果的功能

2017-08-11 标签：fpga FPGA设计视力测试仪 4.4k 2

电平设计基础：电平匹配设计

单端逻辑电平的匹配是我们平时在硬件设计中最经常碰到的，我们在《TTL&CMOS电平》章节中已经对TTL和COMS电平的匹配设计做了一些分析，一般...

2023-06-25 标签：二极管 FPGA设计 MOS管 4.4k 0

技术 | 详解 FPGA 电源排序的四种方案

今天我们将详细说明可根据系统所要求的复杂程度来实现的电源排序解决方案。

2019-06-25 标签：电源 FPGA设计 4.4k 0

Zynq高速串行CMOS接口的设计与实现

现在CMOS传感器的分辨率越来越大，对应的，对数据传输接口的要求也越来越高。

2023-06-28 标签：转换器 FPGA设计寄存器 4.4k 0

FPGA设计之tcl脚本的应用

目前已经学完了基础实验，这里要介绍Quatus自带的两个非常重要的功能，第一个是tcl脚本，第二个是SignalTap（下一篇）。

2023-09-07 标签：fpga FPGA设计 TCL 4.3k 0

如何使用Verilog硬件描述语言描述时序逻辑电路？

时序逻辑电路的特点是输出信号不仅与电路的输入有关，还与电路原来的状态有关。

2023-09-17 标签：FPGA设计反相器 D触发器 4.3k 0

用Verilog在FPGA上实现低通滤波器

在本文中，我们将简要介绍不同类型的滤波器，然后学习如何实现移动平均滤波器并使用CIC架构对其进行优化。

2023-10-02 标签：FPGA设计低通滤波器加法器 4.2k 0

Xilinx FPGA AXI4总线（二）用实例介绍5个读写通道

AXI4协议是一个点对点的主从接口协议，数据可以同时在主机（Master）和从机（Slave）之间**双向** **传输** ，且数据传输大小可以不同。

2023-06-21 标签：FPGA设计 FIFO存储 BRAM 4.2k 0

FPGA设计中几种常见的反压方式

FPGA的设计中，一个前级模块A向下游模块B发送数据，如下图所示，当下游模块B不能及时处理数据时，希望前级模块A停止发送数据，这个时候模块B会通过一个反...

2023-09-06 标签：fpga 模块 FPGA设计 4.1k 0

FPGA时序约束之衍生时钟约束和时钟分组约束

在FPGA设计中，时序约束对于电路性能和可靠性非常重要。在上一篇的文章中，已经详细介绍了FPGA时序约束的主时钟约束。

2023-06-12 标签：fpga FPGA设计 pll 4.1k 0

通过HLS封装一个移位流水灯的程序案例

当我们安装好Vivado 的时候，也同时装好了Vivado HLS.。这是个什么东西？我就有一种想一探究的感觉。网上一查，Vivado High-Le...

2020-10-14 标签：FPGA设计 Xilinx C++ 4.1k 0

浅析FPGA的调试-内嵌逻辑分析仪(SignalTap)原理及实例

对于FPGA调试，主要以Intel FPGA为例，在win10 Quartus ii 17.0环境下进行仿真和调试，开发板类型EP4CE15F17。

2024-01-12 标签：FPGA设计寄存器状态机 4.1k 0

基于FPGA的EnDat接口编码器数据采集设计

EnDat接口是HEIDENHAIN专为编码器设计的数字式、全双工同步串行的数据传输协议，具有传输速度快、功能强大、连线简单、抗干扰能力强等优点，是编码...

2019-01-01 标签：FPGA设计 4k 0

基于FPGA的Petri网的硬件实现

Petri网是异步并发现象建模的重要工具，Petri网的硬件实现将为并行控制器的设计提供一种有效的途径.本文在通用的EDA软件Max+PlusII中，研...

2019-01-01 标签：FPGA设计 Petri网 4k 0

FPGA设计中对输入信号的处理

一般来说，在全同步设计中，如果信号来自同一时钟域，各模块的输入不需要寄存。只要满足建立时间，保持时间的约束，可以保证在时钟上升沿到来时，输入信号已经稳定...

2017-02-11 标签：FPGA FPGA设计全同步设计 4k 0

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