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First Input First Output的缩写，先入先出队列，这是一种传统的按序执行方法，先进入的指令先完成并引退，跟着才执行第二条指令。

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fifo技术

FIFO漫谈之异步FIFO空满信号的产生位置

格雷码的事聊完了，后面顺理成章的就是读写通路模块的设计。不过在读写控制通路之前还要明确下另一个问题，就是空满信号的产生位置的事情。

2024-03-19 标签：fifo 格雷码时钟域 188 0

为什么格雷码可以辅助解决多bit跨时钟域的问题？求解

单bit通过两级同步打拍可以有效的解决亚稳态问题。

2024-03-08 标签：二进制 fifo RTL 621 0

如何从SD卡读取音频文件并将其输出到扬声器上？

在上一篇教程中，创建了一个 I2S 发送器用来发送来从FPGA内部 ROM 的音频数据。下一步，我们向该 I2S 发送器添加 AXI-Stream 接口...

2024-01-22 标签：音频扬声器 SD卡 1214 0

跨时钟域的解决方案

在很久之前便陆续谈过亚稳态，FIFO，复位的设计。本次亦安做一个简单的总结，从宏观上给大家展示跨时钟域的解决方案。

2024-01-08 标签：FPGA设计 fifo CDC 381 0

谈一谈FIFO的深度

最近加的群里面有些萌新在进行讨论**FIFO的深度**的时候，觉得 **FIFO的深度计算比较难以理解** 。所

2023-11-28 标签：IC设计 fifo 时钟源 442 0

如果IP已经采用OOC综合那么是否可以将其修改为Global综合方式？

相比于Project模式，Vivado Non-Project模式可以提供用户更多的控制权，进而用户可以自主管理整个编译流程

2023-11-16 标签：fifo CLK Vivado 454 0

基于STM32F407的FreeRTOS学习笔记(5)

在数据结构中有一种很重要的数据结构叫做队列，其特点是数据先进先出。在FreeRTOS中也有一类队列，我们利用这类队列在FreeRTOS中实现任务与任务间...

2023-11-07 标签：fifo FreeRTOS 数据结构 379 0

如何使用硬件FIFO来减少接收中断次数

本文给介绍如何使用带FIFO的串口来减少接收中断次数，通过一种自定义通讯协议格式，给出帧打包方法；之后介绍一种特殊的串口数据发送方法，可在避免使用串口发...

2023-11-06 标签：单片机 fifo 定时器 277 0

FIFO为什么不能正常工作？

FIFO为什么不能正常工作？复位信号有效长度不够，接口时序不匹配，可看下面这篇文章。本文将介绍：非DFX工程如何确保异步FIFO自带的set_max...

2023-11-02 标签：fpga FPGA设计 fifo 568 0

异步FIFO设计之格雷码

相邻的格雷码只有1bit的差异，因此格雷码常常用于异步fifo设计中，保证afifo的读地址（或写地址）被写时钟（或读时钟）采样时最多只有1bit发生跳变。

2023-11-01 标签：fifo 格雷码异步FIFO 847 0

LogiCORE IP AXI4-Stream FIFO内核解决方案

LogiCORE IP AXI4-Stream FIFO内核允许以内存映射方式访问一个AXI4-Stream接口。该内核可用于与AXI4-Stream ...

2023-09-25 标签：内核 fifo dma 600 0

CRYP加密处理器简介、主要特性及功能说明

MCU加/解密可分为对称加/解密、非对称加/解密、以及HASH算法，以上加/解密算法均可通过CAVP FIPS认证，用于各类安全相关应用。其中，包含DE...

2023-09-22 标签：处理器 mcu fifo 1569 0

跨时钟域类型介绍同步FIFO和异步FIFO的架构设计

在《时钟与复位》一文中已经解释了亚稳态的含义以及亚稳态存在的危害。在单时钟系统中，亚稳态出现的概率非常低，采用同步设计基本可以规避风险。但在实际应用中，...

2023-09-19 标签：fifo 时钟时钟域 959 0

亚稳态理论知识如何减少亚稳态

亚稳态（Metastability）是由于输入信号违反了触发器的建立时间（Setup time）或保持时间（Hold time）而产生的。建立时间是指在...

2023-09-19 标签：TTL fifo 数字电路 437 0

异步FIFO相关面试问题

又到了一年一度的招聘季节，有粉丝私信问了一个问题，一个关于以前流传出来的大厂面试的题目，个人觉得算是比较经典的题目，也是工作中经常遇到的一个问题，所以准...

2023-10-01 标签：fifo 信号时钟域 386 0

单片机串口发送数据很慢？这种方法帮助你提高！

2023-11-02 标签：单片机 fifo 串口 1007 0

单片机自定义协议FIFO高效发送数据方法

2023-09-28 标签：cpu fifo 串口 506 0

多核SoC的系统结构设计

一直以来，一个通用处理器加上硬件逻辑是SoC设计的主流结构。

2023-09-18 标签：处理器内核 soc 1912 0

等效时间采样原理及基于FPGA的实现

经常涉及对宽带模拟信号进行数据采集和存储，以便计算机进一步进行数据处理。为了对高速模拟信号进行不失真采集，根据奈奎斯特定理，采样频率必须为信号频率的2...

2023-09-15 标签：fpga adc 数据采集 1176 0

采用格雷码异步FIFO跟标准FIFO有什么区别

异步FIFO包含"读"和"写“两个部分，写操作和读操作在不同的时钟域中执行，这意味着Write_Clk和Read_Clk的...

2023-09-14 标签：fifo 信号时钟域 592 0

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