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电子发烧友网>业界新闻>行业新闻>时钟 IC 改善通信基础设施时序信号链的性能

时钟 IC 改善通信基础设施时序信号链的性能

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算力基础设施关键技术

算力基础设施是算力网络的核心,以构建高效、灵活、敏捷的算力基础设施为目标,积极引入云原生、无服务器计算、异构计算、算力卸载等技术,探索算力原生、存算一体等新方向, 持续增强算力能力,释放算力价值
2023-05-24 16:38:587

两部门:加快推进充电基础设施建设

5月17日,国家发改委、国家能源局两部门联合发布《关于加快推进充电基础设施建设 更好支持新能源汽车下乡和乡村振兴的实施意见》。
2023-05-19 16:03:02672

无线通信基础设施中离不开的有线连接与接插件

在无线通信方便快捷的背后,是一个又一个稳定可靠的通信节点,它们编织在一起,便是全时空场景下的高速移动互联。在每一个通信节点下,光纤、路由器、电源设备等高效协同,为无线通信提供稳定可靠的支持。而今天我们要谈论的元器件则是帮助那些无线通信基础设施满足网速、EMI等指标的连接器——有线连接与接插件。
2023-05-19 10:57:58717

国常会提出“适度超前建设充电基础设施

5月5日,国常会提出,要聚焦制约新能源汽车下乡的突出瓶颈,适度超前建设充电基础设施,创新充电基础设施建设、运营、维护模式。
2023-05-08 15:45:19747

电动车持续发展,搞好充电基础设施是关键

目前世界各地在争相将燃油汽车替换为电动汽车,预计电动汽车的普及率将迅速攀升。与目前部署的充电桩数量相比,预计电动车 (EV) 的迅速采用将会对可用的充电桩数量带来重大改变。在本文中,我们将研究电动车采用率的增加将对配电基础设施提出怎样的要求,以及在规划电动车充电基础设施时必须考虑的一些因素。
2023-05-08 10:29:03326

FPGA设计中大位宽、高时钟频率时序问题调试经验总结

时钟周期约束:用户需要将设计中的所有时钟进行约束后,综合器才能进行合理的静态时序分析。一个设计中的时钟主要分为两类:主时钟和生成时钟。主时钟包括由全局时钟引脚接入的时钟、高速收发器的输出时钟
2023-05-06 09:31:341253

更智能的基础设施是更安全、更顺畅的移动性的关键

车辆到基础设施 (V2I) 是一种通信模型,允许车辆与支持一个国家高速公路系统的组件共享信息,例如交通信号灯、车道标记、路灯、标牌、架空 RFID 阅读器、摄像头和停车计时器。几乎任何物体,从建筑物到灯柱再到住宅区,都可以配备此功能。
2023-05-04 09:52:55337

如何调整LVDS时钟频率和时序

我正在尝试使用 i.MX8MP EVK 输出 LVDS,但我无法调整 LVDS 输出时钟频率和时序。我需要修改哪些源码,应该怎么修改?需要的时序参数如下:像素时钟 = 54.13 MHz有效分辨率
2023-04-18 09:46:58

MC33772C使用菊花没有唤醒是为什么?

BMS 使用 ADI 的 LTC6820 连接到 MC33772C,具有菊花唤醒功能,但没有唤醒功能。MC33772C上电后进入INIT,等待60S后进入IDLE状态。 通信正常,唤醒时序为6820的CS下拉、上拉、下拉、上拉操作,但没有唤醒。关于在菊花唤醒中寻找什么的任何建议?
2023-04-17 07:49:25

展频IC在4M时钟上的应用

展频IC在4M时钟上的应用
2023-04-14 10:12:270

单位宽信号如何跨时钟

单位宽(Single bit)信号即该信号的位宽为1,通常控制信号居多。对于此类信号,如需跨时钟域可直接使用xpm_cdc_single
2023-04-13 09:11:37911

时序约束---多时钟介绍

当设计存在多个时钟时,根据时钟的相位和频率关系,分为同步时钟和异步时钟,这两类要分别讨论其约束
2023-04-06 14:34:28886

IC设计中的多时钟域处理方法总结

我们在ASIC或FPGA系统设计中,常常会遇到需要在多个时钟域下交互传输的问题,时序问题也随着系统越复杂而变得更为严重。
2023-04-06 10:56:35413

光伏与储能核心基础设施中的连接器

形式。储能市场在过去几年里的火爆程度大家也项目共睹。   “光伏+储能”模式里,光伏逆变器和储能变流器是两大核心基础设施。经由这两大核心基础设施如何把大量组件的电量汇集在一起,都依赖于电缆和连接器。光伏连接器和储
2023-04-06 00:32:002092

时钟抖动和时钟偏斜讲解

系统时序设计中对时钟信号的要求是非常严格的,因为我们所有的时序计算都是以恒定的时钟信号为基准。但实际中时钟信号往往不可能总是那么完美,会出现抖动(Jitter)和偏移(Skew)问题。
2023-04-04 09:20:561633

信号完整性仿真三个重点:信号质量、串扰和时序

信号完整性仿真重点分析有关高速信号的3个主要问题:信号质量、串扰和时序。对于信号质量,目标是获取具有明确的边缘,且没有过度过冲和下冲的信号
2023-04-03 10:40:07887

时序约束的相关知识(二)

设置 Input-to-Reg 时序路径的约束时,不仅需要创建时钟模型,还需要设置输入延时 (input delay)。设置 input delay 时,需要假设输入 port 信号是与时钟
2023-03-31 16:39:141044

时钟域处理方法(一)

理论上讲,快时钟域的信号总会采集到慢时钟域传输来的信号,如果存在异步可能会导致出现时序问题,所以需要进行同步处理。此类同步处理相对简单,一般采用为延迟打拍法,或延迟采样法。
2023-03-28 13:50:291386

Vimeo发布新转码基础设施Falkor

Vimeo发布新转码基础设施Falkor——降低成本的同时将速度推向极限。
2023-03-28 10:55:30445

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