FPGA/ASIC技术

电子发烧友本栏目为FPGA/ASIC技术专栏，内容有fpga培圳资料、FPGA开发板、FPGA CPLD知识以及FPGA/ASIC技术的其它应用等；是您学习FPGA/ASIC技术的好栏目。

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基于FPGA的抖动及消抖的方法

抖动的产生,通常的按键所用开关为机械弹性开关,当机械触点断开、闭合时，由于机械触点的弹性作用，一个按键开关在闭合时不会马上稳定地接通，在断开时也不会一下子断开。因而在闭合及...

2017-11-18 标签：FPGA 10927

NI系统级模块（SOM）采用可重配置的FPGA技术

基于Zynq SoC,NI SOM经过广泛的测试与验证，并配有完整的软件协议栈。嵌入式设计团队肩负着处理众多棘手问题的重担。他们需要跟上最新技术并提供众多新功能以保持竞争优势；同时，对于每...

2017-11-18 标签：FPGA NI 2699

基于FPGA时序优化设计

现有的工具和技术可帮助您有效地实现时序性能目标。当您的FPGA 设计无法满足时序性能目标时，其原因可能并不明显。解决方案不仅取决于FPGA 实现工具为满足时序要求而优化设计的能力，还...

2017-11-18 标签：FPGA Vivado 3739

xilinx Vivado HLS工作方式的优势与案例

不同层面的协议处理常见于各种新型通信系统，因为任何信息交流都需要使用某种通信协议。通信协议一般包含数据包。数据包由发送方创建，由接收方重新组合，这些操作都要遵循协议规范...

2017-11-18 标签：Xilinx Vivado 10730

软件可靠性设计研究及应用

无论您的终端应用是什么，可靠性都将是设计的主要考虑因素之一。实现可靠性的方法多种多样。在考虑设计可靠性时，大部分工程师都将注意力集中在一个综合性度量标准：平均故障间隔时间...

2017-11-18 标签：FPGA MTBF 2617

在Vivado下利用Tcl实现IP的高效管理

在Vivado下，有两种方式管理IP。一种是创建FPGA工程之后，在当前工程中选中IP Catalog，生成所需IP，这时相应的IP会被自动添加到当前工程中；另一种是利用Manage IP，创建独立的IP工程，缺省情况...

2017-11-18 标签：IP TCL Vivado 6128

存储器领域的现状

赛灵思有90%的客户在使用DDR存储器。DDR4是倍受青睐的DDR存储器系列的最后一代。众多竞争者们正在虎视眈眈，意图抢占更大的DDR4市场份额。存储器领域正在发生翻天覆地的变化，这一变化的根...

2017-11-18 标签：串行存储器 HMC DDR存储器 2499

Virtex UltraScale器件的优点

赛灵思Virtex® UltraScale ™ All Programmable FPGA 是高端FPGA 系列的扩展，可支持1Tbps 系统的实现。Virtex UltraScale 系列具有前所未有的高性能、系统集成度和带宽，适用于有线通信、测试测量、航空航天...

2017-11-18 标签：FPGA UltraScale 2328

宇宙微波背景辐射中发现引力波

一个南极多学科科学家小组最近窥到了宇宙大爆炸的余晖。3月17日该小组宣布BICEP2试验在宇宙微波背景辐射（CMB）的B模偏振中找到了引力波的第一个证据。目前科学家们在寻找另一个印迹：C...

2017-11-18 标签：FPGA Xilinx dfmux 1917

JESD204B接口及协议状态过程

在使用我们的最新模数转换器(ADC)和数模转换器(DAC)设计系统时，我已知道了很多有关 JESD204B接口标准的信息，这些器件使用该协议与FPGA 通信。...

2017-11-18 标签：FPGA JESD204B 3376

XDC路径的鉴别、分析和约束方法

我们知道XDC与UCF的根本区别之一就是对跨时钟域路径（CDC）的缺省认识不同，那么碰到FPGA设计中常见的CDC路径，到底应该怎么约束，在设计上又要注意些什么才能保证时序报告的准确性？CDC是...

2017-11-18 标签：FPGA CDC Vivado 6946

XDC的时钟约束及优势

Xilinx©的新一代设计套件 Vivado 中引入了全新的约束文件 XDC，在很多规则和技巧上都跟上一代产品 ISE 中支持的 UCF 大不相同，给使用者带来许多额外挑战。Xilinx 工具专家告诉你，其实用好 XDC...

2017-11-18 标签：TCL Vivado xdc 4057

Tcl在Vivado中的基础应用

Xilinx的新一代设计套件Vivado相比上一代产品ISE，在运行速度、算法优化和功能整合等很多方面都有了显著地改进。但是对初学者来说，新的约束语言XDC以及脚本语言Tcl的引入则成为了快速掌握...

2017-11-18 标签：TCL Vivado 5327

基于双MicroBlaze软核处理器的SOPC系统

设计了一款基于双MicroBlaze软核处理器、面向嵌入式领域的SOPC系统，在信息处理繁忙的情况下，实现两软核处理器之间的同步、通信和中断功能，提高信息吞吐率和系统灵活性，降低设备尺寸。...

2017-11-18 标签：sopc MicroBlaze 4386

基于FPGA的图形生成与视频处理系统的设计与实现

本文对基于FPGA的机载视频图形显示系统架构进行设计和优化。从实时性、BRAM资源占用和DDR3吞吐量三方面进行分析，改进帧速率提升算法来提高实时性；改进视频旋转算法来降低BRAM资源占用；...

2017-11-18 标签：FPGA DDR3 BRAM 3159

基于FPGA+DSP的海德汉编码器结构及设计

在现代工业控制系统中，对电机的控制是其重要组成部分。编码器作为电机角位移的检测装置，为系统提供重要反馈信号。本文介绍了一个适合嵌入式系统的基于DSP和FPGA的海德汉光电编码器信...

2017-11-18 标签：dsp FPGA 编码器 4390

使用LabVIEW进行GPU计算

具有并行处理架构的平台，例如FPGA和GPU，在快速分析大型数据集方面得到了广泛应用。这两项技术可以减轻运算密集型算法对CPU造成的负担，在高度并行的平台上进行处理。FPGA灵活性高、处理...

2017-11-18 标签：FPGA LabVIEW gpu 5438

基于CompactRIO的高级可编程自动控制器

全新NI cRIO-907x CompactRIO集成系统是一种高级可编程自动控制器（PAC），它在单个机箱中集成了工业实时处理器及一块可配置FPGA，降低了用于高容量机器控制、监控等应用的CompactRIO系统的成本。...

2017-11-18 标签：LabVIEW CompactRIO 2971

借助智能DAQ获得高级数据采集技术

多功能智能DAQ设备配有自定义式板载处理功能，最大限度地为系统定时及触发提供灵活性能。与控制设备功能的固定ASIC不同，智能DAQ采用基于FPGA的系统定时控制器，令所有模拟和数字I/O能够根...

2017-11-18 标签：LabVIEW NI DAQ 4639

在Vivado下利用Tcl脚本对综合后的网表进行编辑过程

在ISE下，对综合后的网表进行编辑几乎是不可能的事情，但在Vivado下成为可能。Vivado对Tcl的支持，使得Tcl脚本在FPGA设计中有了用武之地。本文通过一个实例演示如何在Vivado下利用Tcl脚本对综合...

2017-11-18 标签：TCL DCP Vivado 8294

基于FPGA的Vivado功耗估计和优化

资源、速度和功耗是FPGA设计中的三大关键因素。随着工艺水平的发展和系统性能的提升，低功耗成为一些产品的目标之一。功耗也随之受到越来越多的系统工程师和FPGA工程师的关注。Xilinx新一...

2017-11-18 标签：Xilinx Vivado 7741

基于FPGA的机载显示系统架构

本文设计一种基于FPGA的机载显示系统架构，能够实现2D图形绘制，构成各种飞行参数画面，同时叠加外景视频图像。BRAM资源占用方面，视频旋转算法需要279个36Kb的BRAM；DDR3吞吐量方面，系统吞...

2017-11-18 标签：FPGA Xilinx 2886

使用JESD204B同步多个ADC

许多通信、仪器仪表和信号采集系统需要通过多个模数转换器（ADC）对多个模拟输入信号进行同时采样。随后，经过采样得到的数据需被处理以实现各个通道的同步，然而他们各自有不同的时延...

2017-11-18 标签：FPGA adc JESD204B 5251

构建JESD204B链路的步骤

JESD204B 协议中的三个状态对于在链路的 TX 和 RX 之间构建有效数据链路非常重要，它们是：代码组同步 (CGS)、初始信道对齐序列 (ILAS) 和用户数据。今天我将探讨在 TX 与 RX 之间必然会出现的信...

2017-11-18 标签：JESD204B ilas 13791

JESD204B标准及演进历程

在从事高速数据撷取设计时使用FPGA的人大概都听过新JEDEC标准「JESD204B」的名号。近期许多工程师均联络德州仪器，希望进一步了解 JESD204B 接口，包括与FPGA如何互动、JESD204B如何让他们的设计更...

2017-11-18 标签：ESD JESD204B 14846

添加FPGA终端的步骤方法

使用FPGA终端创建应用程序前，必须创建一个LabVIEW项目。然后添加FPGA终端至该项目并创建FPGA VI。 ...

2017-11-18 标签：FPGA LabVIEW 2845

FPGA创建一个程序生成规范

编译FPGA VI至FPGA应用前必须创建一个程序生成规范。...

2017-11-18 标签：FPGA 960

LabVIEW的RIO与I/O对比

NI可重配置I/O(RIO)产品可在灵活的开发平台上实现高精度测量，适用于需要高速闭环控制的系统级应用。这些应用有时需要比核心系统可提供的更多的通道数或分布更广的架构。而扩展I/O系统可...

2017-11-18 标签：LabVIEW RIO NI 6218

数据流编程以及LabVIEW多核编程

因为NI LabVIEW是数据流编程语言，开发者们可以编写并行的应用程序，这些应用程序可以直接映射到并行的硬件（如多核心处理器和FPGA等）上以获得最优异的性能。这篇白皮书讨论了什么是数据...

2017-11-18 标签：FPGA LabVIEW 2096

FPGA通用接口JESD204转换器接口标准详解

随着转换器分辨率和速度的提高，对于效率更高的接口的需求也随之增长。一种新型转换器接口——JESD204——诞生于几年前，其作为转换器接口经过几次版本更新后越来越受瞩目，效率也更高...

2017-11-18 标签：ADI JESD204 ad9639 4306

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