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单通道100GBPS速率还没做,448GBPS就要来了?

edadoc 来源:edadoc 作者:edadoc 2026-05-25 14:37 次阅读
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高速先生成员--周伟

一年一度的DesignCon会议早就结束了,本次会议的干货还是很多的,大家都知道DesignCon是全球最权威、规模最大的高速通信与芯片、电路板到系统设计的顶级工程会议,也是全球著名芯片公司、连接器/线缆和PCB厂家的硬件工程师、SI/PI 专家等大拿们的年度盛会,被称为高速互联 / 信号完整性领域的 “超级碗”。每年年初在美国硅谷圣克拉拉会议中心举办,从1995年开始至今已成功举办了31届。

熟悉我们高速先生惯例的童鞋们估计已经猜到了,虽然没有每次都亲临现场,但每年有空的时候我们都会拜读DesignCon的文章,然后根据我们的理解再把比较感兴趣的部分拿出来和大家分享,也让大家跟着我们的步伐一起看看有哪些最新的技术进展。好了闲话少说,来看看今年会议上出现了哪些最新的技术吧。

解压文档后通盘扫了一眼,映入眼帘最多的无疑是“400/448Gbps”,”他”就是今年会议上最靓的仔,围绕”他”的话题也最多,当然也少量出现224Gbps和112Gbps,但这两个已经在前两年的会议里提到了多次,今年已经从小甜甜变成了“牛夫人”,可见随着AI的需求旺盛起来,技术的发展迭代也确实快得惊人,对算力的要求也越来越高。简单归纳了一下,112Gbps以上相关的文章居然有下图这么多,而绝大多数都是和400/448Gbps相关。

wKgZPGoT7iuAHtmFAAOOmzJnUVU240.png

为了实现400/448Gbps速率,又衍生出了CPC,CPO以及新的编码技术PAM6和PAM8等,我们先来简单认识一下它们到底是什么。

• CPC介绍

CPC是Co-Packaged Copper(共封装铜互连)的简称,就是把高速铜连接器、铜缆接口直接跟交换 / AI 芯片封装做在一起,让高速信号不用走过长的 PCB 走线,直接从芯片出来就接到铜缆,这个主要是为了解决 448Gbps 高频电信号在 PCB 上损耗太大、带宽不够的问题,局部共封装后的示意如下图所示。

wKgZO2oT7iyAY_GvAACuWPg4pmw732.png

具体应用示意如下图所示:

wKgZPGoT7iyAD5BWAACqyYqQ_7k658.png

真实的应用场景如下图所示。

wKgZO2oT7iyADXzjAARtHnnCHCA302.png

• CPO介绍

CPO是Co-Packaged Optics(共封装光学)的简称,就是把光引擎(激光 + 调制 + 探测)和交换芯片 / AI 芯片封在同一个基板上,光纤直接从封装出来,不再用可插拔光模块。主要解决高速信号(448G/1.6T)在 PCB 上跑不长(损耗大)、功耗太高、密度上不去的三大核心难题,如下示意图所示:

wKgZPGoT7i2AFB0PAAMQfANAZIM424.png

CPC和CPO的区别:综合来说CPC 是把铜缆接口与芯片共封装,用于机架内短距离电互联,专门解决 448Gbps 电信号在 PCB 上损耗大、带宽不足的问题;而 CPO 是把光引擎与芯片共封装,用于机架间长距离光互联,专门解决高速传输损耗大、功耗高、端口密度低、信号无法远距离传输的问题,二者分别对应 AI 集群里Scale-Up 近电连接与 Scale-Out 远光连接的不同场景,看起来CPC和CPO对于PCB人不太友好啊。

• PAM6和PAM8介绍

PAM6是6-level Pulse Amplitude Modulation(6 电平脉冲幅度调制)的简称,每符号2.5bit,448Gbps速率下奈奎斯特频率(有些说法叫带宽)约90GHz,性能与复杂度折中,适合信道一般、功耗有限的场景。PAM8是8-level Pulse Amplitude Modulation(8 电平脉冲幅度调制)的简称,每符号3bit,448Gbps速率下奈奎斯特频率仅约75GHz,仿真性能最优,适合信道好、能提供高SNR的场景。二者主要是为了让 448Gbps速率避开 PAM4 所需的 112GHz 超高频率难题。PAM4到PAM8对应的眼图如下所示。

wKgZO2oT7i2ABmmjAAJI48S55EA544.png

下表简单对比了PAM4到PAM8的特性。

wKgZPGoT7i6AAKtNAAFWmozEGFg857.png

• PCIe7.0介绍

PCIe 7.0 是PCI-SIG 在 2025 年 6 月正式发布的新一代高速总线标准,单通道速率128 GT/s,是 PCIe 6.0 的两倍,x16 双向带宽512 GB/s,采用 PAM4 调制与 FLIT 流式编码,具备超高带宽、低延迟、高能效、原生支持光互连、兼容前代及 CXL/UCIe 生态等核心特性,主要应用于AI 大模型训练、GPU 集群、HPC、Chiplet、800G 以太网、CPO 共封装光学、数据中心高速存储与计算互联等场景,有效解决了下一代算力平台带宽瓶颈、传统 I/O 延迟过高、高速信号在 PCB 上损耗受限、高密度系统功耗过大、长距离传输能力不足等关键问题,为未来高密度、高算力、低延迟的数据中心与 AI 硬件提供底层高速互连支撑。

wKgZO2oT7i6AanSaAAGpR-Dkb9U253.png

PCIe7.0的协议已经出来了,但目前主流的应用还是在PCIe4.0和PCIe5.0,PCIe6.0从目前的应用端来看都不太多,随着后续AI对于速率的要求越来越高,有种说法是最终市场会跳过PCIe6.0而直接选择PCIe7.0,未来的事情谁又能说得好呢,我们拭目以待吧。

总体来说我们对于今年DesignCon会议的焦点还是在448Gbps速率的实现上,后面我们会重点谈谈实现它的具体技术如CPO、CPC及PAM6和PAM8,欢迎大家继续关注。

问题来了:

最近常听到“要站在光里,不要光站着”这句话,光也成了最近市场最靓的仔,火得一塌糊涂,甚至说“光进铜退”,大家怎么看?欢迎大家一起来讨论。

审核编辑 黄宇

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