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First Input First Output的缩写，先入先出队列，这是一种传统的按序执行方法，先进入的指令先完成并引退，跟着才执行第二条指令。

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FPGA之FIFO练习2：设计思路

FIFO( First Input First Output)简单说就是指先进先出。由于微电子技术的飞速发展，新一代FIFO芯片容量越来越大，体积越来越...

2019-11-18 标签：fpga 芯片 fifo 2k 0

Synwit SWM系列单片机的UART FIFO详解

如何配合接收门限中断、接收超时中断完成UART数据接收。

2023-03-03 标签：芯片单片机 fifo 2k 0

谈一谈FIFO的深度

最近加的群里面有些萌新在进行讨论**FIFO的深度**的时候，觉得 **FIFO的深度计算比较难以理解** 。所

2023-11-28 标签：IC设计 fifo 时钟源 2k 0

FPGA视频教程：SF-EP1C开发板-基于FIFO的串口发送机设计

发送机是指产生并送出信号或数据的设备。光发送机是光传输网中的一类设备，和光接收机成对使用。光发送机将电信号转成光信号，通过光纤发送，光接收机则将光信号转...

2019-12-13 标签：fpga fifo 串口 2k 0

FIFO项目设计需求与操作步骤

在计算机中，先入先出队列是一种传统的按序执行方法，先进入的指令先完成并引退，跟着才执行第二条指令（指令就是计算机在响应用户操作的程序代码，对用户而言是透明的）。

2019-11-19 标签：计算机 fifo 2k 0

FPGA之FIFO练习1：设计思路

FIFO队列具有处理简单，开销小的优点。但FIFO不区分报文类型，采用尽力而为的转发模式，使对时间敏感的实时应用（如VoIP）的延迟得不到保证，关键业务...

2019-12-02 标签：fpga 带宽 fifo 2k 0

FPGA学习-总结fifo设计中深度H的计算

对于fifo来说，H的设置至关重要。既要保证功能性，不溢出丢数，也要保证性能流水。深度设置过小会影响功能，过大又浪费资源。因此，总结下fifo设计中深度...

2022-08-29 标签：fpga fifo 2k 0

驱动LSM6DS3TR-C实现高效运动检测与数据采集(8)----中断获取FIFO数据并应用MotionFX库解析空间坐标

本文将探讨如何使用中断机制获取FIFO数据并应用MotionFX库解析空间坐标。MotionFX库是一种用于传感器融合的强大工具，可以将加速度计、陀螺仪...

2024-07-21 标签：数据采集 fifo 运动检测 1.9k 0

浅谈FPGA芯片架构

FPGA 芯片架构是非常重要的，如果你不了解 FPGA 芯片内部的详细架构。

2023-07-04 标签：fpga fifo 时钟 1.9k 0

基于XC3S400PQ208 FPGA芯片实现异步FIFO模块的设计

随着数字电子系统设计规模的扩大，一些实际应用系统中往往含有多个时钟，数据不可避免地要在不同的时钟域之间传递。如何在异步时钟之间传输数据，是数据传输中一个...

2020-07-21 标签：fpga 存储器 fifo 1.9k 0

网卡的Ring Buffer详解

DMA 将 NIC 接收的数据包逐个写入 sk_buff ，一个数据包可能占用多个 sk_buff , sk_buff 读写顺序遵循FIFO（先入先出）原则。

2023-04-04 标签：网卡 fifo 函数 1.9k 0

功能覆盖率应该包含哪些内容？

如果某个场景已经使用了covergroup覆盖，就不需要使用SVA cover重复覆盖

2022-11-22 标签：fifo SVA 1.9k 0

Verilog电路设计之单bit跨时钟域同步和异步FIFO

FIFO用于为匹配读写速度而设置的数据缓冲buffer，当读写时钟异步时，就是异步FIFO。多bit的数据信号，并不是直接从写时钟域同步到读时钟域的。

2023-01-01 标签：fifo Verilog 1.8k 0

基于FPGA软硬件设计大容量数据采集系统

本文从硬件和软件角度出发，介绍了FPGA与CF卡的接口设计、给出了用双RAM访问CF卡的编程，并且利用FPGA作为FIFO对AD采集的数据进行缓冲，然后...

2013-01-07 标签：FPGA 数据采集 FIFO 1.8k 0

利用光纤通道协议和异步FIFO实现FC-AL通信弹性缓存的设计

一个简化的异步数据通信系统如图1所示。接收机端从接收到的来自串行链路的比特流中提取时钟信号Clk1，作为其工作时钟源；而发送机端采用本地晶振和锁相环产生...

2020-05-13 标签：光纤通信 fifo 1.8k 0

AXI接口FIFO简介

AXI接口FIFO是从Native接口FIFO派生而来的。AXI内存映射接口提供了三种样式：AXI4、AXI3和AXI4-Lite。除了Native接口...

2025-03-17 标签：接口 fifo 总线 1.8k 0

分享一个嵌入式通用FIFO环形缓冲区实现库

开源项目ringbuff ，是一款通用FIFO环形缓冲区实现的开源库，作者MaJerle，遵循 MIT 开源许可协议。

2024-10-23 标签：缓冲区嵌入式 fifo 1.8k 0

亚稳态理论知识如何减少亚稳态

亚稳态（Metastability）是由于输入信号违反了触发器的建立时间（Setup time）或保持时间（Hold time）而产生的。建立时间是指在...

2023-09-19 标签：TTL fifo 数字电路 1.8k 0

SDRAM控制器设计之异步FIFO的调用

为了加深读者对 FPGA 端控制架构的印象，在数据读取的控制部分，首先我们可以将SDRAM 想作是一个自来水厂，清水得先送至用户楼上的水塔中存放，在家里...

2025-02-26 标签：FPGA 控制器 SDRAM 1.7k 0

基于环形队列的UART收发回显实验

在实际项目开发中，由于有些串口不具备FIFO（如SCI1和SCI2）或FIFO的buffer比较小，这可能会在数据处理速度小于数据接收速度的时候，导致数...

2025-10-27 标签：led灯 fifo 串口 1.7k 0

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