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First Input First Output的缩写，先入先出队列，这是一种传统的按序执行方法，先进入的指令先完成并引退，跟着才执行第二条指令。

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fifo技术

基于FPGA的异步FIFO设计架构

为了得到正确的空满标志位，需要对读写指针进行同步。一般情况下，如果一个时钟域的信号直接给另一个时钟域采集，可能会产生亚稳态，亚稳态的产生对设计而言是致命...

2018-09-25 标签：寄存器 FIFO 4k 0

等效时间采样原理及基于FPGA的实现

经常涉及对宽带模拟信号进行数据采集和存储，以便计算机进一步进行数据处理。为了对高速模拟信号进行不失真采集，根据奈奎斯特定理，采样频率必须为信号频率的2...

2023-09-15 标签：fpga adc 数据采集 3.8k 0

FIFO写数据失败问题分析

前几天测试中心在对伺服电机控制板进行测试中，发现多次随机点击控制屏上控制指令时，会出现正常运行的电机突然就停了。在当前指令还没有执行完，并且确认没有下发...

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FIFO的阈值如何设置

FIFO是First in First out 的缩写，一般是由寄存器reg或者ram搭起来的，相对于普通存储器而言，FIFO没有地址可操作的地址总线，...

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Linux中的LS命令详细学习资料概述

ls 命令可以列出一个 POSIX 系统上的文件。这是一个简单的命令，但它经常被低估，不是它能做什么（因为它确实只做了一件事），而是你该如何优化对它的使用。

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2023-05-25 标签：fpga fifo 格雷码 3.6k 0

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双口RAM是常见的共享式多端口存储器，以图1所示通用双口静态RAM为例来说明双口RAM的工作原理和仲裁逻辑控制。双口RAM最大的特点是存储数据共享。图1...

2020-05-18 标签：存储器 ram fifo 3.5k 0

FPGA设计过程中常用的FIFO

无论何时，在复杂的 FPGA 设计过程中，都不可避免地需要在模块之间发送数据，实现这一点的常用的是 FIFO。

2022-09-20 标签：fpga FPGA设计数据 3.5k 0

异步FIFO设计原理及应用需要分析

在大规模ASIC或FPGA设计中，多时钟系统往往是不可避免的，这样就产生了不同时钟域数据传输的问题，其中一个比较好的解决方案就是使用异步FIFO来作不同...

2022-03-09 标签：fpga asic fifo 3.4k 0

同步FIFO和异步FIFO区别介绍

1. FIFO简介 FIFO是一种先进先出数据缓存器，它与普通存储器的区别是没有外部读写地址线，使用起来非常简单，缺点是只能顺序读写，而不能随机读写。 ...

2024-06-04 标签：电路数据传输 AD 3.4k 0

基于环形队列的串口打印阻塞解决方法

队列（FIFO）是一种常见的线性存储结构，在嵌入式开发中经常用到，主要的应用场景有：

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多核SoC的系统结构设计

一直以来，一个通用处理器加上硬件逻辑是SoC设计的主流结构。

2023-09-18 标签：处理器内核 soc 3.4k 0

跨时钟设计：异步FIFO设计

在ASIC设计或者FPGA设计中，我们常常使用异步fifo（first in first out）（下文简称为afifo）进行数据流的跨时钟，可以说没使...

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FIFO的一些基础知识

FPGA厂商提供了丰富的IP核，基础性IP核都是可以直接免费调用的，比如FIFO、RAM等等。

2023-08-07 标签：fpga fifo IP核 3.3k 0

XILINX FPGA IP之FIFO Generator例化仿真

上文XILINX FPGA IP之FIFO对XILINX FIFO Generator IP的特性和内部处理流程进行了简要的说明，本文通过实际例子对该I...

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陀螺仪LSM6DSV16X与AI集成(7)----FIFO数据读取与配置

LSM6DSV16X是一款高性能、低功耗的6轴IMU传感器，集成了3轴加速度计和3轴陀螺仪。本文将详细介绍如何配置和读取LSM6DSV16X传感器的FI...

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如何从SD卡读取音频文件并将其输出到扬声器上？

在上一篇教程中，创建了一个 I2S 发送器用来发送来从FPGA内部 ROM 的音频数据。下一步，我们向该 I2S 发送器添加 AXI-Stream 接口...

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异步FIFO在DSP图像采集系统中的应用

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2018-02-26 标签：DSP FIFO 图像采集系统 3.1k 0

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