FPGA/ASIC技术
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可编程逻辑器件的详细分析分类和输出结构
根据PLD器件的与阵列和或阵列的编程情况及输出形式，可编程逻辑器件通常可分为4类。第一类是与阵 列固定、或阵列可编程的PLD器件，这类PLD器件以可编程只读存储器PROM为代表。可编程只读存...
2017-11-25 4722
采用AD9789与FPGA相结合实现全数字QPSK射频调制的方案
摘要： 一种采用AD9789与FPGA相结合，在FPGA上实现全数字QPSK射频调制的方案。介绍了AD9789的接口设计及配置流程，并给出了设计实例。 DVB-S标准只是规定了信道编码及调制方式，没有提供具体的...
2017-11-25 4664
可重构计算的详细介绍与发展状况和未来方向
在大众已经习惯的计算模式中，处理器和专用集成电路（ASIC）一直是两大主流。伴随着应用领域特别是嵌入式环境对系统的性能、能耗、上市时间等指标需求的不断提高，传统的计算模式暴露...
2017-11-25 17903
基于FPGA技术的发展提出一种可重构测控系统的设计构想
1 可重构测控系统的提出 测控系统一般是指基于计算机实现数据采集和控制的系统。测控系统在工业现场控制、家庭数字化管理、通信和网络等方面应用广泛，并不断向低成本、高速、高性能、...
2017-11-25 1287
通过一个实例具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束
摘要：本文主要通过一个实例具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束，主要涉及到的约束包括时钟约束、群组约束、逻辑管脚约束以及物理属性约束。 Xilinx定义了如下几种约束类型...
2017-11-25 6992
基于BDTI研究认证以D S P为核心的高级综合工具
近年来，高级综合工具已成为在设计方案中使用或希望使用FPGA的工程师的必杀技。这种工具以应用的高级表示法（比如用C语言或MATLAB的M语言编写的表示法）为输入，并生成面向FPGA的硬件实现...
2017-11-25 1840
成功解决FPGA设计时序问题的三大要点
FPGA的设计与高速接口技术可以帮助你满足今天的市场要求，但也提出了一些有趣的设计挑战。为了确保存储器接口的数据传输准确，在超过200兆赫兹以上，进行时序分析将发挥更突出的作用，...
2017-11-25 1533
基于ＦＰＧＡ的ＤＤＲ ＳＤＲＡＭ控制器的设计
ＤＤＲ ＳＤＲＡＭ是建立在ＳＤＲＡＭ的基础上的，但是速度和容量却有了提高。首先，它使用了更多的先进的同步电路。其次，它使用延时锁定回路提供一个数据滤波信号。当数据有效时，...
2017-11-25 4487
区分ＦＰＧＡ和ＣＰＬＤ结构差异的8个特点
市面上尤其是学校里面可以看到Xilinx公司或者Altera公司各种不同的开发板，其实只有两个大类，CPLD开发板和FPGA开发板。尽管ＦＰＧＡ和ＣＰＬＤ都是可编程ＡＳＩＣ器件,有很多共同特点,但由...
2017-11-25 8264
基于FPGA/CPLD设计中使用的状态机稳定性问题解决的方案
在FPGA/CPLD设计中频繁使用的状态机,常出现一些稳定性问题,本文提出了一些解决方法,实验表明该方法有效地提高了综合效率. 随着大规模和超大规模FPGA/CPLD器件的诞生和发展,以HDL(硬件描述语言...
2017-11-24 3856
Xilinx Spartan-3AN对游戏机加密的详细分析与特点
动漫游戏是一个新兴的行业，发展潜力大，市场前景好。游戏平台的加密性、灵活性、通用性备受游戏平台提供商的关注，同时要求低成本、容易采购。 科通数字技术公司认为， 目前游戏行业...
2017-11-24 1656
FPGA配置与测试的详细方法分析与特点
从制造的角度来讲，FPGA测试是指对FPGA器件内部的逻辑块、可编程互联线、输入输出块等资源的检测。完整的FPGA测试包括两步，一是配置FPGA、然后是测试FPGA，配置FPGA是指将FPGA通过将配置数据...
2017-11-24 8751
MicroBlaze构建了雷达多目标跟踪的嵌入式系统解决了排序的难点
利用FPGA及其片上32位微处理器内核MicroBlaze,构建雷达目标跟踪系统，硬件实现的高速并行性保证了多目标跟踪的实时性，微处理器CPU强大的控制协调功能保证系统的正常运行。针对多目标波门排...
2017-11-24 2656
基于FPGA的高速通信可重构系统灵活多变可以适应不同的应用需求
远程通信系统和远程监控系统对信号传输有两方面的要求：一方面要求接口灵活且有较高的数据传输带宽；另一方面要求系统的传输距离远。传统接口如UART，USB，以太网等在传输带宽和传输距...
2017-11-24 2825
基于FPGA设计时效仿真技术的验证以及其应用
随着FPGA器件体积和复杂性的不断增加，设计工程师越来越需要有效的验证方。时序仿真可以是一种能发现最多问题的验证方法，但对许多设计来说，它 常常是最困难和费时的方法之一。过去，...
2017-11-24 1676
基于赛灵思的Virtex-7 HT系列的详细分析与解答
赛灵思近日推出内置28Gbps收发器的Virtex-7 HT系列支持下一代100-400Gbps通信系统应用适用于行业最高带宽线路卡的全新FPGA， 可以提供多达16个28Gbps串行收发器，可支持主要的高速串行、光学和背板...
2017-11-24 3241
基于赛灵思Virtex-5的音视频监视系统设计的详细分析
本文探讨在Virtex-5 FPGA中实现设计的一些难题，然后用一个项目作为示范来详解充分利用其功能集的技法。设计过程包括几个步骤，从针对应用选择适合的Virtex-5开始。为便于本文叙述，我们假定...
2017-11-24 1737
介绍了RocketIO在高速通信中的应用并总结了高速通信系统的共性特征
在高速电路系统设计中，差分串行通信方式正在取代并行总线方式 ，以满足系统对高带宽数据通信的需求。RocketIO是Virtex2 Pro以上系列中集成的专用高速串行数据收发模块，可用于实现吉比特的...
2017-11-24 2667
介绍了中频直接正交采样及Bessel插值理论以及FPGA实现
现代雷达普遍采用相参信号来进行处理，而如何获得高精度基带数字正交(I，Q)信号是整个系统信号处理成败的关键。传统的做法是采用模拟相位检波器来得到I、Q信号，其正交性能一般为：幅度...
2017-11-24 4721
基于赛灵思FPGA的红外相机原理样机的系统设计与实现
根据内编队重力场卫星红外成像工作环境的温度要求，选取了非制冷长波红外焦平面阵列探测器——UL 03 16 2，并在此基础上进行了系统的软硬件设计。硬件电路采用了模拟电路和数字电路分离...
2017-11-24 4613
关于FPGA设计的验证技术及其应用原则分析和介绍
FPGA设计和验证工程师当今面临的最大挑战之一是时间和资源制约。随着FPGA在速度、密度和复杂性方面的增加，完成一个完整时序验证对人力和计算机处理器、存储器提出了更多更高的要求。...
2019-10-06 1547
基于DSP与FPGA的蓝牙数据采集系统设计详细分析以及优势
基于DSP与FPGA的蓝牙数据采集系统设计,数据采集系统广泛地应用于工业、国防、图像处理、信号检测等领域。DSP处理器是一种高速的数字信号处理器 数据采集系统广泛地应用于工业、国防、图像...
2017-11-24 2467
FPGA创新技术实现广播到3D的技术进步以及下个发展趋势
过去10年来，电子行业推出了一系列令人眼花缭乱的平板电视及相关技术，将阴极射线管电视、背投电视乃至模拟标清信号广播技术统统扫进了积满灰尘的“古董”库房。如今，众企业纷纷以前...
2017-11-24 792
基于FPGA设计环境中加时序约束的详细分析与优化结果
在给FPGA做逻辑综合和布局布线时，需要在工具中设定时序的约束。通常，在FPGA设计工具中都FPGA中包含有4种路径：从输入端口到寄存器，从寄存器到寄存器，从寄存器到输出，从输入到输出的...
2017-11-24 2053
FPGA时序收敛设计技巧的详细分析与消除差异的方法
您编写的代码是不是虽然在仿真器中表现正常，但是在现场却断断续续出错？要不然就是有可能在您使用更高版本的工具链进行编译时，它开始出错。您检查自己的测试平台，并确认测试已经做...
2017-11-24 3131
基于PI 控制算法的三阶全数字锁相环的详细分析与实验结果
锁相环在通信、雷达、测量和自动化控制等领域应用极为广泛，已经成为各种电子设备中必不可少的基本部件。随着电子技术向数字化方向发展，需要采用数字方式实现信号的锁相处理。因此，...
2017-11-24 14141
基于CPCI架构符合PICMG2.0 D3.0标准的软件无线电处理方案
软件无线电的基本思想是以一个通用、标准、模块化的硬件平台为依托，通过软件编程来实现无线电台的各种功能，从基于硬件、面向用途的电台设计方法中解放出来。功能的软件化实现势力要...
2017-11-24 1577
具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束
本文主要通过一个实例具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束，主要涉及到的约束包括时钟约束、群组约束、逻辑管脚约束以及物理属性约束。 Xilinx定义了如下几种约束类型： •...
2017-11-24 4421
FPGA设计中的时序问题的详细分析与解决方案
耗费数月精力做出的设计却无法满足时序要求，这确实非常令人伤心。然而，试图正确地对设计进行约束以保证满足时序要求的过程几乎同样令人费神。找到并确定时序约束本身通常也是非常令...
2017-11-24 10784
深入了解时序约束以及如何利用时序约束实现FPGA 设计的最优结果
作为赛灵思用户论坛的定期访客（见 ），我注意到新用户往往对时序收敛以及如何使用时序约束来达到时序收敛感到困惑。为帮助 FPGA设计新手实现时序收敛，让我们来深入了解时序约束以及如...
2017-11-24 5933
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