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　　赛灵思公司（Xilinx）推出的行业第一个可扩展处理平台Zynq系列。旨在为视频监视、汽车驾驶员辅助以及工厂自动化等高端嵌入式应用提供所需的处理与计算性能水平。

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【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十四章PS端SD卡读写

FatFs是一个通用的文件系统模块，用于在小型嵌入式系统中实现FAT文件系统。FatFs的编写遵循 ANSI C，因此不依赖于硬件平台。它可以嵌入到便宜...

2021-01-28 标签：fpga 嵌入式 SD卡 6.3k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十三章PS端DP的使用

DisplayPort v1.2协议，支持4个5.4G的lane，但本控制器只支持两个lane，分辨率最大支持4096*2160@30。

2021-01-27 标签：fpga 音频 DP 7.8k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十二章PS端I2C的使用

ReadBuffer清0，WriteBuffer赋FF写16个字节到EEPROM读EEPROM的16个字节到ReadBuffer检验是否正确Readbu...

2021-01-27 标签：fpga EEPROM I2C 7.2k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十一章PS端UART读写控制

除了打印信息之外，如果我们想用UART进行数据传输呢？本章便来介绍PS端UART的读写控制，实验中，每隔1S向外发送一串字符，如果收到数据，产生中断，并...

2021-01-27 标签：fpga 串口 uart 7.2k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十章PS端RTC中断实验

实验中通过简单的修改Vitis的例程，就完成了RTC，中断的应用，看似简单的操作，但蕴含了丰富的知识，我们需要非常了解RTC的原理、中断的原理，这些基本...

2021-01-26 标签：fpga 实时时钟 RTC 7.2k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十九章 Hello World(下)

本章从FPGA工程师和软件工程师两者角度出发，介绍了ZYNQ开发的经典流程，FPGA工程师的主要工作是搭建好硬件平台，提供硬件描述文件hdf给软件工程师...

2021-01-26 标签：fpga ARM 工程师 8k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十八章 Hello World(上)

我们从原理图中可以看到ZYNQ芯片分为PL和PS，PS端的IO分配相对是固定的，不能任意分配，而且不需要在Vivado软件里分配管脚，虽然本实验仅仅使用...

2021-01-26 标签：fpga ARM 工程师 5.1k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十七章Vitis准备工程及注意事项

所有的工程目录下都有个bootimage文件夹，存放了对应的BOOT.bin文件，可将此文件拷贝到Vitis_image_download文件夹，覆盖原...

2021-01-26 标签：fpga 编译 Zynq 4.8k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十六章7寸液晶屏显示实验

LCD屏显示方式从屏幕左上角一点开始，从左向右逐点显示，每显示完一行,再回到屏幕的左边下一行的起始位置，在这期间，需要对行进行消隐，每行结束时，用行同步...

2021-01-25 标签：fpga 触摸屏液晶 6.1k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十五章HDMI字符显示实验

在HDMI输出实验中讲解了HDMI显示原理和显示方式，本实验介绍如何使用FPGA实现字符显示，通过这个实验更加深入的了解HDMI的显示方式。

2021-01-25 标签：fpga HDMI 开发板 6.2k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十四章HDMI输出实验

由于开发板上只有DP可以显示，但却是PS端的，PL端没有HDMI的接口，因此我们采用AN9134的HDMI扩展模块实现HDMI显示。将24位RGB编码输...

2021-01-25 标签：fpga HDMI 开发板 6.6k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十三章RS485实验

RS485与RS422类似，也是采用差分信号传输，但RS485是半双工传输，也就是说，同一时刻只能有一个方向的数据传输。而且接口也比RS422少，只有差...

2021-01-25 标签：fpga RS485 差分信号 5.9k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十二章RS422实验

本章利用AN3485模块实现RS422接口数据传输。关于模块，在前面的RS232实验中已经介绍过，本实验不再赘述。RS422与RS232在与FPGA的连...

2021-01-23 标签：fpga RS422 MAX3 9.6k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十一章RS232实验

AN3485模块的RS232接口采用MAX3232芯片实现RS232和+3.3V TTL电平的转换。TTL电平的串口接收和发送信号（RXD, TXD）连...

2021-01-23 标签：fpga RS232 uart 5.8k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十章PWM呼吸灯实验

用一个N比特的计数器，最大值可以表示为2的N次方，最小值0，计数器以“period”为步进值累加，加到最大值后会溢出，进入下一个累加周期。当计数器值大于...

2021-01-23 标签：fpga PWM Zynq 1.6万 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第九章Vivado下按键实验

按键是FPGA设计当中最常用也是最简单的外设，本章通过按键检测实验，检测开发板的按键功能是否正常，并了解硬件描述语言和FPGA的具体关系，学习Vivad...

2021-01-22 标签：fpga 按键 Zynq 2.9k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第八章FPGA片内FIFO读写测试实验

FIFO: First in, First out代表先进的数据先出，后进的数据后出。Xilinx在VIVADO里为我们已经提供了FIFO的IP核, 我...

2021-01-22 标签：fpga Xilinx fifo 6k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第七章FPGA片内ROM测试实验

既然是ROM，那么我们就必须提前给它准备好数据，然后在FPGA实际运行时，我们直接读取这些ROM中预存储好的数据就行。Xilinx FPGA的片内ROM...

2021-01-22 标签：fpga ROM RAM 4.8k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第六章FPGA片内RAM读写测试实验

RAM是FPGA中常用的基础模块，可广泛用于缓存数据的情况，同样它也是ROM，FIFO的基础。本实验将为大家介绍如何使用FPGA内部的RAM以及程序对该...

2021-01-22 标签：fpga ROM RAM 5.8k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第五章Vivado下PLL实验

PLL(phase-locked loop)，即锁相环。是FPGA中的重要资源。由于一个复杂的FPGA系统往往需要多个不同频率，相位的时钟信号。所以，一...

2021-01-22 标签：fpga pll Zynq 5.9k 0

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