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ACAP是赛灵思在2018年推出的新一代计算平台,是一种革命性异构计算架构。ACAP整合了硬件可编程逻辑单元、软件可编程处理器、以及软件可编程加速引擎的计算平台产品。
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Versal ACAP、APU - DSB 指令后可能会发生推测性 TLB 填充
Arm 发行的白皮书 "Cache Speculation Side-channels"用于发现 "Spectre&quo...
Versal ACAP,APU - 由于旧负载检测到异步外部异常中止,导致新负载误报同步外部异常中止
在某些条件下,新负载如果复用旧器件负载的分组标识 (GID),则可能报告同步外部异常中止,原因是错误关联旧器件存储器访问所检测到的外部错误。器件负载快速...
Versal ACAP PS GEM - GEM 控制器可能在大型发送卸载配置中触发错误的 Amba_Error
当在硬件配置中包含“大型发送卸载 (Large Send Offload)”并在缓冲区描述符中启用 LSO 功能时,GEM IP 可能通过中断状态寄存器...
Versal ACAP, RPU - 为调试寄存器 DBGDSAR 设置的值错误
每个 RPU 处理器都有 1 个 DBGDSAR 寄存器,其中包含其 CoreSight ROM 表的偏移地址。但是,读取 RPU 的 DBGDSAR ...
Versal ACAP、APU - ELR 错误报告序列中加密指令之间的中断
在 aarch32 模式下,如果执行的代码包含下面的加密指令序列,并且在执行第一条加密指令后立即断言并中断,ELR 会被记录为返回地址,产生的错误可能会...
Versal ACAP,APU - 当有逐出传输事务处于暂挂状态时,外部数据嗅探可能导致数据损坏
如果 Arm Cortex-A72 处理器配置为向处于 UniqueClean (UC) 状态的缓存行发送逐出传输事务,那么 Cortex-A72 处理...
Vitis 环境开发方法论反应了 Versal ACAP 系统的异构性质,此类系统通常是由 PS、PL 和 AI 引擎功能组成的。您可使用 Vitis ...
对于任何一项设计,要想尽可能实现最低的功率包络,都需要在设计周期早期准确估算功耗。早期估算有助于选择合适的器件、充分发挥架构优势、更改设计拓扑,以及使用...
赛灵思 Versal 自适应计算加速平台 (ACAP) 设计方法论是旨在帮助精简 Versal 器件设计进程的一整套最佳实践。鉴于这些设计的规模与复杂性...
Versal 自适应计算加速平台 (ACAP) 将标量引擎 (Scalar Engine)、自适应引擎 (Adaptable Engine) 和智能引擎...
在瞬息万变的智能化时代, 单一计算架构已难以应对处理海量数据的重任, 业界亟需“异构计算”来解决当今所面临的挑战, 赛灵思 Versal ACAP, 作...
赛灵思Versal评估套件助力开发者迈入解锁ACAP功能的高速路
装备业界首个自适应计算加速平台(ACAP)的赛灵思 Versal AI Core 系列 VCK190评估套件 和 Versal Prime 系列 VMK...
Vitis迎来了版本更新,Vitis 2020.2 带来更加快捷智能的使用体验。首次引入Vitis™AI Engine( AI引擎)编译器,并提供多个加速功能。
新基建的核心就是数据,七大领域所覆盖的汽车、城际高速、特高压、工业物联网等传统行业,面临产业数字化的转型机会;5G、人工智能、数据中心等,则面临数字产业...
赛灵思: FPGA、可编程 SoC,以及 ACAP 自适应计算加速的发明者,“致力于打造灵活应变,万物只能的世界”。从消费电子到自动驾驶、从云到端到边缘...
赛灵思推第三代ACAP平台Versal Premium,计算密度为FPGA两倍
赛灵思发布ACAP的第三代产品——Versal Premium系列,该处理器采用台积电7nm制程工艺,集成软件可编程功能、动态可配置硬件加速、预制连接和...
这一个新十年,时代的“大”和“快”从数字的比较上是以前难以想象的。大数据雪崩爆发时,每一片雪花都是意义的;有些事件看似离我们很远,但被浪花打到时依然有力...
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