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这些肖特基钳位TTL MSI电路设计用于需要非常短的传播延迟时间的高性能存储器解码或数据路由应用。在高性能存储器系统中，这些解码器可用于最小化系统解码的影响。当采用利用快速使能电路的高速存储器时，这些解码器的延迟时间和存储器的使能时间通常小于存储器的典型存取时间。这意味着肖特基钳位系统解码器引入的有效系统延迟可以忽略不计。
'LS138，SN54S138和SN74S138A根据三个二进制选择输入和三个使能输入的条件对八条线中的一条进行解码。两个低电平有效和一个高电平有效使能输入可在扩展时减少对外部门或逆变器的需求。无需外部逆变器即可实现24线解码器，32线解码器仅需一个逆变器。使能输入可以用作多路分解应用的数据输入。
所有这些解码器/解复用器都具有完全缓冲的输入，每个输入仅代表其驱动电路的一个归一化负载。所有输入均采用高性能肖特基二极管钳位，以抑制线路振铃并简化系统设计。
SN54LS138和SN54S138的特点是可在-55°C至125°C的整个军用温度范围内工作。 SN74LS138和SN74S138A的特点是工作温度范围为0°C至70°C。
| Function |
| Technology Family |
| VCC (Min) (V) |
| VCC (Max) (V) |
| Channels (#) |
| Voltage (Nom) (V) |
| F @ Nom Voltage (Max) (Mhz) |
| ICC @ Nom Voltage (Max) (mA) |
| tpd @ Nom Voltage (Max) (ns) |
| Configuration |
| Type |
| IOL (Max) (mA) |
| IOH (Max) (mA) |
| Rating |
| Operating Temperature Range (C) |
| Package Group |
| Package Size: mm2:W x L (PKG) |
| Bits (#) |
| Digital input leakage (Max) (uA) |
| ESD Charged Device Model (kV) |
| ESD HBM (kV) |
| SN74LS138 | SN54LS138 |
|---|---|
| Decoder Demultiplexer | Decoder/Demultiplexer |
| LS | LS |
| 4.75 | 4.5 |
| 5.25 | 5.5 |
| 1 | 1 |
| 5 | 5 |
| 35 | 35 |
| 10 | 10 |
| 41 | 41 |
| 3:8 | 3:8 |
| Standard | Standard |
| 8 | 8/-0.4 |
| -0.4 | |
| Catalog | Military |
| 0 to 70 | -55 to 125 |
| PDIP SO SOIC | CDIP CFP LCCC |
| See datasheet (PDIP) 16SO: 80 mm2: 7.8 x 10.2(SO) 16SOIC: 59 mm2: 6 x 9.9(SOIC) | See datasheet (CDIP) See datasheet (CFP) 20LCCC: 79 mm2: 8.89 x 8.89(LCCC) |
| 8 | 8 |
| 5 | 5 |
| 0.75 | 0.75 |
| 2 | 2 |
| 无样片 |
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