如何对xilinx FPGA进行bit文件加密
AES即高级加密标准，是一种区块加密，当然也是对称加密。区块固定为128bit，秘钥为128，192....
详细解释一下傅里叶级数的数学推导过程
傅里叶级数在数论、组合数学、信号处理、概率论、统计学、密码学、声学、光学等领域都有着广泛的应用，这不....
解读香农定理、奈奎斯特定理、编码与调制
假设带宽为W赫兹信道中传输的信号是二进制信号（即信道中只有两种物理信号），那么该信号所能承载的最大数....
FPGA-现场可编程门阵列
FPGA芯片说明书中，包含了可编程逻辑模块的数量、固定功能逻辑模块（如乘法器）的数目及存储器资源（如....
谈一谈RapidIO串行物理层包的传输过程
通道的概念用于描述串行RapidIO端点的宽度。通道定义为每个方向上的单向差分对。目前串行Rapid....
介绍一种基于数据包交换的互连体系结构RapidIO
RapidIO是由Motorola和Mercury等公司率先倡导的一种高性能、 低引脚数、 基于数据....
走进Linux内存系统探寻内存管理的机制和奥秘
Linux 内存是后台开发人员，需要深入了解的计算机资源。合理的使用内存，有助于提升机器的性能和稳定....
从赛灵思FPGA设计流程看懂FPGA设计
综合优化（Synthesize）是将硬件语言或原理图等设计输入翻译成由与，或，非门、RAM、触发器等....
详解FPGA的四大设计要点
SERDES:高速串行接口。将来PCI-E、XAUI、HT、S-ATA等高速串行接口会越来越多。有了....
RS触发器基本知识：同步RS触发器/主从触发器/JK触发器
在数字电路中，为协调各部分动作一致，常要求某些触发器于同一时刻工作，所以要引入同步信号。
什么是良好的Verilog代码风格？
1. 前言 之前在公司负责制定代码规范，费了九牛二虎之力，终于整理出来一份文档。由于保密规定的缘故，....
带有同步器的NoC结构是解决FPGA高速时序收敛的关键原因吗？
随着物联网、机器人、无人机、可穿戴/植入设备等低功耗便携式设备越来越普及，超低功耗SoC芯片技术也面....
RapidIO核的仿真以及包时序的分析
它由一个仿真顶层的testbench和两个SRIO核顶层组成。其中顶层的testbench文件sri....
无线通信中的IQ调制，BPSK调制，QPSK调制，16QAM调制的理解
前面我们讲了IQ调制和解调的原理，下来我们看一下如何应用IQ调制来实现MPSK调制（QPSK、8PS....
DisplayPort-DP接口知识
DP设有专用总线，即AUX Channel，用于source和sink之间的握手。因为source是....
一个工程师打算在命令行里编译Xilinx SDK工程
在BSP工程目录下，有文件makefile，执行make命令，也可以编译。在BSP工程目录下，有很多....
雷达信号处理：FPGA还是GPU?
FPGA和CPU一直是雷达信号处理不可分割的组成部分。传统上FPGA用于前端处理，CPU用于后端处理....
混合编程中的模块命名与管理
最近在项目中以SpinalHDL为主体做系统集成，其中遇到了不少模块命名与管理的坑，借此机会，再来聊....
基于逻辑门的构成解释如何完成任意逻辑的管级电路设计
明白上述原因后，就可以理解输出的高电平由上管决定，低电平由下管决定。为了保证在某一时刻，输出只能为高....
跨时钟域处理的亚稳态与同步器
我们都知道数字电路中有两个最重要的概念，建立时间和保持时间。通过满足建立时间和保持时间，我们可以确保....
Verilog HDL描述的组合逻辑环在FPGA实现时到底有什么问题？
组合反馈环的时序分析是无穷循环的时序计算，综合、实现等EDA 工具迫不得已一般必须主动割断其时序路径....
FPGA数字信号处理之verilog实现混频器
常见的数字混频器结构如下，由移频模块和求和模块组成。比如信号A、B是输入的两个单音信号，B是上一节讲....
FIR、IIR滤波器的FPGA实现和仿真研究分析
通常根据所加的窗函数的不同，在频域所得的低通滤波器的阻带衰减也不同。常用的窗函数有矩形窗、三角窗、汉....
FIR及IIR滤波器的FPGA实现
所以实际上我们得到的是h(t)抽样后的S平面与Z平面的映射，当Ω以2π/T整数倍改变时，会映射到Z平....
