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分析优化和消除具有高达13.6GHz VCO的锁相环中的整数边界杂散

假设某个调制方案指出整数边界杂散功率高于–80 dBc的通道不可用;那么图10中大约1%的通道不再可用。为了克服这个问题，ADIsimFrequency...

2023-02-01 标签：芯片振荡器 pll 2.9k 0

如何设计和调试锁相环电路

许多工程师对如何选择参考频率感到困惑，但参考频率和输出频率阶跃之间的关系很简单。对于整数N分频PLL，输出频率阶跃等于鉴频鉴相器（PFD）输入端的频率，...

2023-01-30 标签：放大器 PLL VCO 3.7k 0

双环路时钟发生器清除抖动提供多个高频输出

一些现代双环模拟PLL集成在单个芯片上，使设计人员能够减少低频参考抖动，同时提供高频、低相位噪声输出。这节省了宝贵的PCB面积，并允许从单个相位对齐源对...

2023-01-30 标签：芯片 pll 时钟发生器 1.7k 0

构成PLL频率合成器的构建模块研究

频率合成器的核心是鉴相器或鉴频鉴相器。在这里，将参考频率信号与VCO输出反馈的信号进行比较，产生的误差信号用于驱动环路滤波器和VCO。在数字PLL（DP...

2023-01-30 标签：锁相环频率合成器 pll 2.7k 0

PLL的相位噪声和参考杂散参数在开环调制方案中的重要性

在任何振荡器设计中，频率稳定性都至关重要。我们对长期和短期稳定都感兴趣。长期频率稳定性与输出信号在很长一段时间（数小时、数天或数月）内的变化有关。它通常...

2023-01-30 标签：电源振荡器 pll 6.9k 0

单芯片直接数字频率合成与模拟PLL的比较

新的集成完整DDS产品为敏捷频率合成应用提供了一种有吸引力的模拟PLL替代方案。长期以来，直接数字频率合成（DDS）一直被认为是生成高精度、频率捷变...

2023-01-30 标签：处理器 pll DDS 2.9k 0

使用ADF4111频率合成器和VCO190-902T压控振荡器的实用PLL电路

锁相环是一种反馈系统，结合了压控振荡器和相位比较器，其连接方式使振荡器频率（或相位）精确跟踪施加的频率或相位调制信号的频率（或相位）。例如，锁相环可用于...

2023-01-30 标签：振荡器比较器 pll 3.4k 0

锁相环的电源管理设计

锁相环（PLL）是现代通信系统的基本组成部分。PLL通常用于在无线电接收器或发射器中提供本振（LO）功能;它们还用于时钟信号分配和降噪，并越来越多地用作...

2023-01-29 标签：锁相环振荡器电源管理 2.9k 0

12GHz、超低相位噪声小数N分频锁相环的设计

本应用笔记详细介绍了集成外部VCO的完整12GHz、超低相位噪声小数N分频锁相环（PLL）的设计。它由高性能小数N分频PLL（MAX2880）、基于运算...

2023-01-16 标签：滤波器运算放大器 pll 2.3k 1

利用硅双极宽带PLL构建模块集成电路

该文提出了一种宽带锁相环（PLL）构建模块集成电路（IC），该电路可以适应0.5GHz至9GHz的信号频率。该设计集成了具有可选分频比的预分频器、鉴相器...

2023-01-13 标签：集成电路滤波器 PLL 1.5k 0

整数N分频和小数N分频PLL频率合成器的相位噪声

在产生高频、高线性度信号源时，低相位噪声至关重要。相位噪声是信号相位不希望的变化或变化的量度。它是在频域中测量的，相当于时域中的抖动。使用PLL频率合成...

2023-01-09 标签：振荡器 PLL 检波器 6.6k 0

LT3042高性能低压差线性稳压器用于为噪声敏感型供电应用

在为噪声敏感型模拟/射频应用供电时，低压差（LDO）线性稳压器通常优于其切换对应方。低噪声 LDO 为各种模拟/射频设计，包括频率合成器（P...

2023-01-09 标签：稳压器 ldo pll 1.1万 1

分析优化和消除具有高达13.6 GHz VCO的锁相环中的整数边界杂散

锁相环（PLL）和压控振荡器（VCO）以特定频率输出RF信号，理想情况下，该信号将是输出端存在的唯一信号。实际上，输出端存在不需要的杂散信号和相位噪声。...

2023-01-08 标签：振荡器仿真器 pll 3.2k 0

适用于16位2.5Gsps高性能DAC的不折不扣的时钟解决方案

LTC®2000 16 位 2.5Gsps DAC 提供了卓越的交流性能。对于许多DAC应用，相位噪声、噪声频谱密度（NSD）和无杂散动态范围（SFDR...

2023-01-05 标签：dac pll 信号发生器 2.3k 0

分析和管理电源噪声和时钟抖动对高速DAC相位噪声的影响

从一张白纸开始，DAC首先被视为一个块盒。噪声可以在内部产生，因为任何实际组件都会产生一些噪声，或者噪声可能来自外部来源。外部电源的入口可以通过任何DA...

2023-01-04 标签：电源 dac pll 4.3k 0

ADF4356/ADF5356器件上的相位对齐和控制

顾名思义，锁相环（PLL）使用鉴相器将反馈信号与参考信号进行比较，将两个信号的相位锁定在一起。虽然该特性仍有许多应用，但目前PLL最常用于频率合成，通常...

2023-01-04 标签：放大器转换器变频器 3.1k 0

时钟失效之后，STM32还能运行？

该问题由某客户提出，发生在 STM32F103VDT6 器件上。据其工程师讲述：在其产品的设计中，STM32 的 HSE 外接 8MHz 的晶体产生振荡...

2022-12-30 标签：看门狗 STM32 pll 1.3k 0

FPGA知识汇集-FPGA系统时序理论

上式中：Tco_clkb是系统时钟信号CLKB在时钟驱动器的内部延迟；Tflt_ clkb 是CLKB从时钟驱动器输出后到达发送端（CPU）触发器的飞行...

2022-12-21 标签：fpga pll 时序图 1.9k 0

JESD204C入门：新增功能应用

对于 64b/66b 链路层，66 位数据块是两个同步标头位，后跟八个八位字节的示例数据，部分基于 IEEE 802.3 条款 49 中定义的块格式。与...

2022-12-21 标签：转换器 pll 2k 0

收发器相位噪声拆解通过外部LO提供性能

ADI公司ADRV9009收发器使用外部本振（LO）时的测量表明，使用低噪声LO时，相位噪声可以显著改善。收发器架构是从相位噪声贡献的角度提出的。通过一...

2022-12-21 标签：集成电路收发器 pll 2.4k 0

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IoT是Internet of Things的缩写，字面翻译是“物体组成的因特网”，准确的翻译应该为“物联网”。物联网（Internet of Things）又称传感网，简要讲就是互联网从人向物的延伸。
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