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电子发烧友网>可编程逻辑>FPGA/ASIC技术>ETD第14期:SDR源同步接口时序约束方法

ETD第14期:SDR源同步接口时序约束方法

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时序约束连载03~约束步骤总结

本小节对时序约束做最终的总结
2023-07-11 17:18:57351

时序约束连载02~时序例外

本文继续讲解时序约束的第四大步骤——时序例外
2023-07-11 17:17:37417

时序约束出现时序违例(Slack为负数),如何处理?

时序约束出现时序违例(Slack为负数),如何处理?
2023-07-10 15:47:063099

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