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Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB® 和 Simulink® 环境中进行快速设计探索和验证，并加速 Xilinx 器件的量产。

文章：93个浏览：8257次帖子：21个

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vitis技术

《基于“矿板”低成本学习Zynq系列》之七-memory测试

2023-07-19 标签：仿真 Memory 编译 2.8k 0

《基于“矿板”低成本学习Zynq系列》之五-XADC改造与测试

本文转自公众号欢迎关注《基于“矿板”低成本学习Zynq系列》之四-第一个工程HelloWorld一下 (qq.com) 一.前言前面我们了解了板子的...

2023-07-19 标签：soc 程序开发板 5.1k 1

Vitis-Vivado强制JTAG模式烧录QSPI方法

本教程提供 VITIS 2021.1 QSPI-FLASH 下载方法如下

2023-07-07 标签：Zynq QSPI Vivado 7.5k 0

Vitis软件平台安装

Vitis软件平台由适用于交互式工程开发的集成设计环境和适用于脚本化或手动应用开发的命令行工具组成

2023-07-07 标签：WINDOWS 软件平台 Vitis 1.6k 0

VCK5000运行Vitis-AI 3.0 WeGO实时量化演示

VCK5000在vitis ai 3.0对应的shell版本为xilinx-vck5000-gen4x8-qdma-base_2

2023-07-07 标签：AI 命令 Shell 2.3k 0

Vitis AI工具概述

深度学习处理器 (DPU) 是一个专为深度神经网络而优化的可编程引擎。它由一组可参数化的 IP 核组成

2023-07-07 标签：处理器 AI DPU 1.7k 0

Vitis嵌入式Linux:Sysroot和库的用法

本文演示了在Vitis™ 中对 Linux 应用程序开发的过程中如何使用外部库

2023-07-07 标签：嵌入式 Linux SDK 1.7k 0

《基于“矿板”低成本学习Zynq系列》之三-vitis安装

Xilinx提供了一整套开发环境用于其FPGA和SOC的开发，主要包括硬件部分和软件部分的开发工具，之前硬件部分是vivado软件部分是sdk，现在统一...

2023-06-26 标签：fpga Xilinx Zynq 5.5k 0

使用Vitis AI在Zynq MP上实现手势识别

FPGA得益于其高可编程性以及低延迟，低功耗的特点，在机器学习的推理领域已获得了广泛的关注。在过去，FPGA对于软件开发人员来说有较高的开发门槛，把一部...

2023-06-25 标签：fpga 手势识别 AI 2k 0

在Vitis中通过PSU DDR执行MicroBlaze应用

MicroBlaze CPU 是可修改的拖入式预设 32 位/64 位 RISC 微处理器配置系列。

2023-06-21 标签：cpu Xilinx 微处理器 1.6k 0

Xilinx FPGA远程调试方法(一)

日常的FPGA开发常常会遇到“编码与上机调试使用各自的电脑”的场景，解决方法一般如下。

2023-05-25 标签：fpga 嵌入式 Xilinx 4.2k 0

Vitis IDE Git集成快速入门

在本快速入门演示中，将探讨如何在 Vitis 中使用 Git 集成以及如何使用团队操作来共享 Vitis 工程。

2023-05-12 标签：Xilinx IDE Git 1.8k 0

如何在Vitis中使用Git集成以及如何使用团队操作来共享Vitis工程

在上述两种情况下，用户始终都能使用 “Refresh Project Models”（刷新工程模型）选项从 Git 仓库获取最新更改，在 “System...

2023-05-12 标签：Git 资源管理器 Vitis 2.5k 0

闲谈Vitis AI|DPU在UltraScale平台下的软硬件流程(1)

本篇中，我想跳过一些细枝末节, 先简单介绍 AMD Xilinx Vitis AI 在 Zynq 这个硬件加速平台下软硬件开发的基本思路和流程，把各个开...

2022-12-21 标签：Xilinx AI DPU 3.2k 0

理解Vitis HLS默认行为

相比于VivadoHLS，Vitis HLS更加智能化，这体现在Vitis HLS可以自动探测C/C++代码中可并行执行地部分而无需人工干预添加prag...

2022-11-24 标签：函数 C++HLS 2.3k 0

Vitis HLS知识库总结

对于AMD Xilinx而言，Vivado 2019.1之前（包括），HLS工具叫Vivado HLS，之后为了统一将HLS集成到Vitis里了，集成之...

2022-09-02 标签：Xilinx 电路模型 Vitis 4.5k 0

Vitis HLS介绍及工作流程

这种方法还可以更好地与团队方法一起使用，并且可以创建可跨多个项目使用的加速内核库（IP）。另一个优点是应用于可编程逻辑实现的优化驻留在 .xo 文件中，...

2022-08-30 标签：二进制 HLS Vitis 5.3k 3

使用AXI4-Lite将Vitis HLS创建的IP连接到PS

在 AXI 基础第 6 讲 - Vitis HLS 中的 AXI4-Lite 简介中，使用 C 语言在 HLS 中创建包含 AXI4-Lite 接口的 ...

2022-08-02 标签：AXI4 Vivado Vitis 1.2k 0

在Vitis中调试ARM可信固件和U-boot

在本篇博文中，我们将探讨如何在 Vitis 中调试 Zynq UltraScale 器件启动镜像。这些启动镜像包括 ARM 可信固件 (ATF) 和 U...

2022-08-02 标签：Xilinx Zynq Vitis 4.9k 0

如何在Vitis中设定Kernel的频率

在Vitis 统一软件平台中使用Alveo系列开发板设计加速Kernel时，系统会自动为Kernel的时钟设置默认频率。以 xilinx_u200_qd...

2022-08-02 标签：Kernel Vitis 1.1k 0

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