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pll技术

PLL/VCO技术如何提高性能、减小尺寸并简化设计周期

多年来，微波频率生成给工程师带来了重大挑战，需要深入了解模拟、数字和射频（RF）以及微波电子学，特别是锁相环（PLL）和压控振荡器（VCO） ...

2022-12-20 标签：微波 pll RF 4k 0

驱动高压锁相环频率合成器电路的VCO

锁相环（PLL）电路是一种反馈系统，它结合了压控振荡器（VCO）和鉴相器，使振荡器信号以正确的频率和相位跟踪施加的频率或相位调制信号。当需要从固定的低频...

2022-12-20 标签：滤波器振荡器 pll 3.4k 0

为什么完全集成的转换环路器件可实现最佳的相位噪声性能

该设备配备了自动校准引擎，可以识别给定目标频率的最佳VCO频段。在校准模式下，设备可以在实际温度下搜索正确的频段，并且工艺条件，使调频过程无缝衔接。

2022-12-16 标签：振荡器 pll 倍频器 2.1k 0

下一代软件定义无线电收发器在跳频方面取得巨大进步

本文深入讨论了跳频（FH）的高级概念、通过ADRV9002 SDR收发器的灵活锁相环（PLL）架构实现的跳频设计原理及其四个主要跳频特性。这些功能使用户...

2022-12-09 标签：收发器 pll 无线电 2.7k 0

HMC834LP6GE压控振荡器介绍

集成式相位检波器(PD)和Σ-Δ型调制器能以高达100 MHz的频率工作，实现更宽的环路带宽和出色的频谱性能。

2022-11-24 标签：pll 压控振荡器倍频器 1.4k 0

一文了解锁相环原理及工作方式

锁相环(PLL)电路存在于各种高频应用中，从简单的时钟净化电路到用于高性能无线电通信链路的本振(LO)，以及矢量网络分析仪(VNA)中的超快开关频率合成器。

2022-11-15 标签：锁相环 pll 鉴相器 2.7k 0

一种FLL辅助PLL的GNSS接收机矢量跟踪环路

摘要：全球导航卫星系统（GNSS）接收机的设计主要包括捕获、跟踪、解算三个环节，其中，跟踪环节中载波频率和码频率的稳定性直接影响着导航定位性能。为改...

2022-10-27 标签：接收机 pll GNSS 3.2k 0

时钟设计技巧

时钟信号在很大程度上决定了整个设计的性能和可靠性，尽量避免使用FPGA内部逻辑产生的时钟，因为它很容易导致功能或时序出现问题。内部逻辑（组合逻辑）产生的...

2022-10-26 标签：fpga pll 时钟信号 1.8k 0

PLL为什么是这么一个结构呢？

如果用一个自由振荡的振荡器，给MCU提供时钟。会咋样呢?

2022-10-25 标签：mcu 振荡器 pll 1.3k 0

AT32F403A/407时钟配置指南

时钟是芯片正确高效运行的基础，正确的时钟配置是芯片能正确运行的必要条件，其重要性不言而喻。AT32各系列产品的时钟配置部分可能存在细微的差异和需要注意的...

2022-10-24 标签：pll 时钟 AT32 3.6k 0

什么是时钟缓冲器（Buffer）？时钟缓冲器（Buffer）参数解析

什么是时钟缓冲器（Buffer）？时钟缓冲器（Buffer）参数解析什么是时钟缓冲器（Buffer）？我们先把这个概念搞清楚。时钟缓冲器就是常说的C...

2022-10-18 标签：时钟缓冲器 pll 时钟 3.0万 0

基于PLL和DDS的高性能频率合成器设计

要满足苛刻的频率合成器要求，通常需要做到一定程度的设计灵活性。基本的锁相环(PLL)频率合成器能以低成本、高空间效率、低功耗封装提供合理的频谱纯度和频率...

2022-10-14 标签：锁相环频率合成器 pll 4.2k 0

jitter的关键术语和参数

时钟电路是芯片中最基础的电路，时钟电路性能的好坏关乎SoC中所有电路能否达到预期目标，例如：计算核（CPU/GPU/NPU）的主频，DDR的带宽，高速接...

2022-10-12 标签：pll Jitter 时钟电路 9.2k 0

详解锁相环（PLL）电路、信号、模块组成

锁相环（PLL）是电子系统中最通用、最灵活和最有价值的电路配置之一，因此在许多应用中都有使用。它用于时钟重定时和恢复，作为频率合成器和可调谐振荡器，...

2022-08-30 标签：锁相环低通滤波器 pll 2.4万 0

为什么组件集成对天基PLL合成器很重要

通过将射频和合成器组件集成到单片射频 IC 中，工程师可以解决星载应用中的尺寸和复杂性设计挑战

2022-08-17 标签：锁相环合成器 pll 735 0

如何手动选择频段以缩短PLL锁定时间

ADRF6820是一款高度集成的解调器和频率合成器，非常适合用于高级通信系统。它内置一个宽带I/Q解调器、一个小数N/整数N分频锁相环(PLL)以及一...

2022-08-09 标签：分频器 pll VCO 1.9k 0

传统 PLL 与平移环系统级封装技术

低噪声平移环的设计涉及众多电路块的实现，导致设计复杂，通常体积庞大，灵活性有限。此外，整个电路必须针对目标操作进行验证和特征化。

2022-07-28 标签：pll 混频器压控振荡器 1.8k 0

i.MXRT1xxx系列MCU时钟相关功能引脚作用

如果我们从一颗 MCU 芯片的引脚分类来看芯片功能，大概可以分为三大类：电源、时钟、外设功能。

2022-07-07 标签：mcu pll 时钟 923 0

马达电机驱动器四大要点概述

前言据统计，近年来，全世界的马达电机年生产量大约为100亿台，其功耗大约占据全世界总耗电量的50%。这一数据听上去让人觉得出乎意料，但是当我们细数一...

2022-07-07 标签：电机 pll 电机驱动 1.8k 0

具有分布式PLL的相控阵的系统级本地振荡器相位噪声模型

　　已经提出了一种在具有分布式锁相环的系统中评估相位噪声的方法。该方法的基础是每个组件都可以通过其单独的噪声、组件与系统输出之间的噪声传递函数、使用的数...

2022-07-05 标签：adc dac pll 1.7k 0

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