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PCI-Express（peripheral component interconnect express）是一种高速串行计算机扩展总线标准，它原来的名称为“3GIO”，是由英特尔在2001年提出的，旨在替代旧的PCI，PCI-X和AGP总线标准。

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Ack/Nak机制详细介绍

Ack/Nak是一种由硬件实现的，完全自动的机制，目的是保证TLP有效可靠地传输。Ack DLLP用于确认TLP被成功接收，Nak DLLP则用于表明T...

2018-05-29 标签：Ack PCIe Nak 1.6万 0

PCIe总线实现了一种叫做Quality of Service（QoS）的机制

PCIe驱动程序（配置软件）通过修改VC资源控制寄存器（VC Resource Control Register）中的TC/VC Map位来实现TC/V...

2018-05-25 标签：寄存器总线 PCIe 1.1万 0

如何加速海量数据和信息的收集和汇聚？

大数据和云计算时代背景下，数据中心和骨干网支撑着海量数据的计算和交互。而海量的数据则源自于无数的手机和终端个体，如何加速海量数据和信息的收集和汇聚？

2018-05-24 标签：HDMI PCIE 7.9k 0

Flow Control机制可以显著地提高总线的传输效率

PCIe Spec规定，PCIe设备的每一个端口（Ports）都必须支持Flow Control机制，在发送TLP之前，Flow Control必须先检...

2018-05-24 标签：总线 PCIe 7.9k 0

PCIe总线必须要先完成Flow Control初始化

由于VC0是默认使能的，所以当Flow Control初始化开始时，其会被自动的初始化。其他的Virtual Channel是可选的，只有当被配置为使能...

2018-05-24 标签：总线 PCIe 数据链路层 8.6k 0

xilinx sp605 PCIe EDK使用方法（之一：EDK设置部分）视频教程

在EDK环境中针对在xilinx sp605 PCIe开发板，举一个简单的例子，介绍如何使用PCIE核与PC进行数据通讯。

2018-06-07 标签：fpga Xilinx PCIe 6.6k 0

ise设计流程视频教程

xilinx的ise的使用流程，简单介绍

2018-06-06 标签：fpga Xilinx PCIe 4.2k 0

演示如何使用ISE开发FPGA项目（1）视频教程

作为一个初学者，有的时候很难弄清楚ISE如何使用，本视频教程以一种最简单的方式展示如何使用ISE来开发一个XILINX FPGA工程。由于录屏的原因，本...

2018-06-06 标签：fpga Xilinx PCIe 6.9k 0

Xilinx DSP解决方案- SysGen 8.1视频教程

我们将一起从头至尾复习一遍Xilinx DSP的整个设计流程。其中将讨论各种设计技巧，包括黑盒子，HDL协同仿真，硬件协同仿真。看过下面的演示，您在半个...

2018-06-06 标签：dsp fpga Xilinx 4.6k 0

一个简单的Byte Enable使用的例子

TLP的类型和路由方式由Fmt和Type所决定，这在前面关于TLP路由的文章中已经详细的介绍过。上图显示的是各种不同格式的TLP Header的相同的部分。

2018-05-17 标签：电平 PCIe TLP 1.0万 0

实测：高性能PCIe通道固态硬盘带来的实际影响

这几款游戏都是目前比较热门的游戏大作，有着大型的场景需要加载。因此测试以点击进入游戏开始计时，到完全进入可操作界面为止，分别进行时间统计。

2018-05-16 标签：PCIe 固态硬盘 2.0万 0

分析一下PortB的Header中的Base & Limit寄存器

需要注意的是，Endpoint的需要的NP-MMIO的大小明明只有4KB，PortB的Header却给其1MB的空间（最小1MB），也就是说剩余的空间都...

2018-05-11 标签：寄存器 PCIe 7.1k 0

一些关于TLP路由的基础知识

可能有的人要有疑惑了，既然Message可以使用地址路由或者ID路由，为什么还要单独搞出来一个模糊路由呢？原因很简单，使用模糊路由可以广播Message...

2018-05-11 标签：总线 PCIe tlp 8.4k 0

几个简单的例子来熟悉寄存器BAR的机制

Step1：如图中（1）所示，未初始化的BAR的低比特（11~4）都是0，高比特（31~12）都是不确定的值。所谓初始化，就是系统（软件）向整个BAR都...

2018-05-09 标签：寄存器 PCIe 7.5k 1

Type0和Type1型配置请求

如果不相等，但是在自己的下一级总线号（Secondary Bus Number）和最后一级总线号（Subordinate Bus Number）之间，则...

2018-05-06 标签：PCIe type 7.3k 0

转向32GT/s速度的PCIe设计所面临的挑战

历史上，PCIe系统设计人员把通用低成本FR4 PCB材料和引线键合（wirebond）封装用于高达 8GT/s 数据速率（Gen3）的大多数应用...

2018-05-04 标签：印刷电路板 CPU PCIe 8.2k 0

PCIe的Spec中明确规定只有Root有权限发起配置请求

处理器一般不能够直接发起配置读写请求，因为其只能产生Memory Request和IO Request。这就意味着Root必须要将处理器的相关请求转换为...

2018-05-04 标签：PCIe Root 7.5k 0

BDF与配置空间

前面的关于PCI总线的文章介绍过PCI总线的配置空间，PCIe总线为了兼容这些PCI设备，几乎完整的保留了PCI总线的配置空间。并将配置空间扩展到4KB...

2018-05-03 标签：总线 PCIe 1.1万 0

PCIe物理层的基本概念

需要注意的是，PCIe物理层处理可以转发LTP和DLLP之外，还可以直接发送命令集（Ordered Sets）。之所以称其为命令集，是因为它并不是真正意...

2018-05-02 标签：总线 PCIe 物理层 1.1万 0

一个简单地的例子来回顾PCIe总线的结构、事务层、数据链路层和物理层

如下图所示，Completer的应用层会根据接受到的信息进行相应的处理，处理完成后会将数据发送至事务层，事务层根据这一信息创建一个新的TLP（即CplD...

2018-05-02 标签：总线 PCIe 9.8k 0

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