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PCI-Express（peripheral component interconnect express）是一种高速串行计算机扩展总线标准，它原来的名称为“3GIO”，是由英特尔在2001年提出的，旨在替代旧的PCI，PCI-X和AGP总线标准。

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pcie技术

低抖动时钟源和时钟树组建为下一代PCIe提供更快的数据传输速度

先进的串行通信标准外围组件互连(PCI)最初用于个人电脑，以克服限制并行总线标准带宽的挑战如时钟和数据信号偏移。PCI作为串行互连，还有助于避免实现并行...

2020-02-12 标签：接收器时钟 pcie 3.9k 0

Root如何处理来自其他PCIe设备的错误消息

高级可校正错误屏蔽寄存器如下图所示，默认情况下，这些bit的值都是0。也就是说，只要发生相关错误，且该错误报告功能被使能，则相关错误便会被报告（不被屏蔽...

2018-08-28 标签：寄存器 PCIe Root 5.2k 0

PCIe错误报告机制上高级错误报告AER

其中，最低5bits为当前错误指针（First Error Pointer），当相关错误状态更新时，该指针由硬件自动更新。一般情况下，当前错误指针指向的...

2018-08-27 标签：寄存器 PCIe 8.5k 0

PCIe总线的三种错误报告方式

PCIe设备的配置空间中的状态与控制寄存器如上图所示，通过这些寄存器可以使能（或禁止）通过错误消息（Error Message）发送错误报告、查询错误状...

2018-08-23 标签：寄存器总线 PCIe 1.5万 0

介绍事务错误、链路流量控制相关的错误、异常的TLP以及内部错误

所有的PCIe设备都必须支持Completion超时定时器，除非该设备只是用于初始化配置事务的。需要注意的是，PCIe设备必须能够针对多个事务（Tran...

2018-08-22 标签：PCIe 配置 5.7k 0

PCI-Express接口连接器知识分析

PCIe链路的最大宽度为×32，但是在实际应用中，×32的链路宽度极少使用。在一个处理器系统中，一般提供×16的PCIe插槽，并使用PETp0~15、P...

2018-08-21 标签：连接器总线 PCIE 1.5万 0

PCIe扫盲—PCIe错误检测机制的详细资料概述

PCIe总线错误检测囊括了链路（Link）上的错误以及包传递过程中的错误，如下图所示。用户设计的应用程序层中的错误不属于链路传输中的错误，不应当通过PC...

2018-08-18 标签：CRC Link PCIe 1.6万 0

PCIe总线的错误报告机制中四个比较重要的概念

错误报告（Error Reporting）：通知系统某个（或多个）错误发生了。在PCIe总线中，发生错误的设备会通过错误消息（Error Messag...

2018-08-17 标签：寄存器总线 PCIe 7.6k 0

那为什么SSD要用PCIe接口？

和PCIe一样，SATA也有独立的发送和接收通道，但与PCIe工作模式不一样：同一时间，只有一条道可以进行数据传输，也就是说，你在一条道上发送数据，另外...

2018-06-25 标签：接口 SSD PCIe 1.2万 0

基于FPGA的PCIe设备如何才能满足PCIe设备的启动时间的要求？

根据PCIe的协议，当设备启动后，PCIe设备必须满足启动时间的要求，即上电后100ms内，完成PCIe设备的初始化。如果不能满足PCIe设备启动时间的...

2018-06-19 标签：fpga pcie 可编程逻辑 9k 0

PCIe SSD推出了新的硬件形式：SFF-8639，又称U.2

目前有很多服务器厂商都发布了有很多U.2 SSD盘位的服务器，有的是少数U.2 SSD和多数SATA HDD混合，有的甚至是24个纯U.2 SSD盘位。...

2018-06-14 标签：服务器 SSD PCIe 2.0万 0

泰克最新PCI Express，创新功能介绍

PCI Express从问世到今天已经走过十个年头，从第一代2.5GT/S到今天的第三代系统，速率已经高达8GT/s，而第四代芯片也已经进入开发阶段，速...

2018-06-25 标签：tektronix pcie 4.2k 0

物理层电气部分基础

需要注意的是，PCIe总线采用的是嵌入式时钟，即只有数据Lane，并没有时钟Lane（具体在前面的文章中已经详细地介绍过了）。也就是说，以Gen1为例，...

2018-06-09 标签：芯片 PCIe 物理层 5.2k 0

对LTSSM进行了简单的介绍

这是链路（Link）的正常状态（Normal and Full-Active State），所有的TLP、DLLP和Ordered Sets都可以被正常...

2018-06-08 标签：PCIe 链路功耗管理 1.6万 0

PCIe中的信号补偿技术——De-emphasis

此时，还存在另一个问题，由于压摆率的特性，如果系统中出现几个连续的1（或者0），而接下来的信号为0（或者1）时，信号的电压可能达不到要求，如下图所示。这...

2018-06-06 标签：信号 PCIe 物理层 2.1万 0

PCIe SSD推动全新闪存时代到来

一个明显趋势是能耗的总量和增速都在快速变化，很多地方政府本着发展地方经济和产业转型的目标，还是较为积极的发展和支持云计算与数据中心产业，比如内蒙古、重庆...

2018-06-05 标签：SSD PCIe 3.1k 0

PCIe总线中的链路初始化与训练

前面的文章中介绍过，PCIe收发的都是差分信号，有的时候Link两端的设备的对应信号的极性可能是相反的。因此，PCIe Spec允许在链路训练与初始化的...

2018-06-05 标签：嵌入式总线 PCIe 1.2万 0

聊一聊接收端物理层逻辑子层的实现细节

如果链路（Link）处于低功耗状态（比如L0s或者L1）时，接收端此时会失去同步（即Losing Bit Lock）。为了避免物理层认为这是一个错误（异...

2018-06-03 标签：PCIe 物理层 4.4k 0

物理层逻辑知识，关于扰码器需要遵循的规则

前面的文章中提到过Ordered Sets，其主要用于链路训练等。每一个Ordered Set都是按照DW对齐的（即四个字节），且Ordered Set...

2018-06-01 标签：PCIe 物理层 6.7k 0

PCIe物理层实现了一对收发差分对，可以实现全双工的通信方式

如上图所示，PCIe物理层实现了一对收发差分对，因此可以实现全双工的通信方式。需要注意的是，PCIe Spec只是规定了物理层需要实现的功能、性能与参数...

2018-05-31 标签：全双工 PCIe 物理层 1.4万 0

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