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AXI是一种总线协议，该协议是ARM公司提出的AMBA3.0协议中最重要的部分，是一种面向高性能、高带宽、低延迟的片内总线。它的地址/控制和数据相位是分离的，支持不对齐的数据传输，同时在突发传输中，只需要首地址，同时分离的读写数据通道、并支持Outstanding传输访问和乱序访问，并更加容易进行时序收敛。AXI是AMBA中一个新的高性能协议。

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深入剖析AXI的协议与架构（上）

AMBA AXI协议支持用于主从模块之间通信的高性能、高频率系统设计。

2023-05-04 标签：模块 AMBA AXI 2.7k 0

AXI如何用于连接互连组件呢？

AXI 是一种接口规范，它定义了 IP 块的接口，而不是互连本身。

2023-05-04 标签：处理器 SoC系统 AXI 1.6k 0

AXI总线协议：AHB、APB、AXI对比分析

V1.0 ASB、APB是第一代AMBA协议的一部分。主要应用在低带宽的外设上，如UART、 I2C，它的架构不像AHB总线是多主设备的架构，APB总线...

2023-04-14 标签：AMBA AXI 4.6k 0

浅谈PCI Express相关组件的集合

分离的DMA接口/ DMA客户端模块支持高度灵活，高性能的DMA操作。DMA接口和DMA客户端模块通过具有高性能分段存储器接口的双端口RAM连接。

2023-04-03 标签：存储器 Xilinx PCIe 1.1k 0

AMBA总线都有哪些？三种总线的区别？

AMBA(Advanced Microcontroller Bus Architecture)高级处理器总线架构，不同的速率需求构成了为高性能SoC设计...

2023-03-21 标签：处理器 AMBA总线 SoC设计 6k 0

AXI VDMA IP 的高级用例

如果 STRIDE 等于 HSIZE，那么 AXI VDMA IP 会在没有任何跳转的情况下读取帧缓存。但是，由于输入大小大于输出大小，我们需要在地址之...

2023-02-15 标签：存储器分辨率 AXI 2k 0

使用AXI CDMA制作FPGA AI加速器通道

使用 AMD-Xilinx FPGA设计一个全连接DNN核心现在比较容易（Vitis AI），但是利用这个核心在 DNN 计算中使用它是另一回事。本项目...

2023-02-08 标签：fpga amd 加速器 3.4k 0

MIPI dsi TX移植注意事项简单总结

MIPI Dsi的使用相比于CSI多了一些寄存器控制，生成的example直接仿真是可以的，但是修改了参数，一些参数也要做相应的调整。

2023-02-06 标签：寄存器 MIPI CSI 2.6k 0

如何通过NoC从Versal应用处理单元(APU)访问AXI BRAM

Versal 架构将“Scalar Engine”（标量引擎）、“Adaptable Engine”（自适应引擎）和“Intelligent Engin...

2022-11-11 标签：APU NoC AXI 1.3k 0

在Versal中通过NoC从PS-APU对AXI BRAM执行基本读写操作

本篇博文旨在演示如何通过 NoC 从 Versal 应用处理单元 (APU) 访问 AXI BRAM。

2022-11-09 标签：NoC AXI Versal 1.1k 0

AXI FIFO和AXI virtual FIFO两个IP的使用方法

FIFO 是我们设计中常用的工具，因为它们使我们能够在进行信号和图像处理时缓冲数据。我们还使用异步FIFO来处理数据总线的时钟域交叉问题。

2022-11-04 标签：fpga fifo AXI 6.4k 0

AXI总线协议简介

　　AXI (高性能扩展总线接口，Advanced eXtensible Interface)是ARM AMBA 单片机总线系列中的一个协议，是计划用于...

2022-10-10 标签：接口总线 AXI 1.1万 0

使用AXI VIP的几个关键步骤及常见功能

AXI总线在FPGA设计中使用越来越频繁，但初学的同学经常会因为对协议的理解不够深入，写出来的代码经常会出现死锁等问题，对FPGA设计与调试带来很多不必...

2022-10-08 标签：fpga Xilinx AXI 7.3k 0

AXI通道定义及AXI总线信号描述

本文主要介绍了AXI通道以及在每个通道下信号的概述。

2022-08-04 标签：总线 AXI 1.2万 0

AXI总线协议的几种时序介绍

由于ZYNQ架构和常用接口IP核经常出现 AXI协议，赛灵思的协议手册讲解时序比较分散。所以笔者收藏AXI协议的几种时序，方便编程。

2022-08-02 标签：时序总线协议 AXI 9.5k 0

使用AXI performance monitors(APM)测试MPSoC DDR访问带宽

MPSoC的DDR控制器的数据通道上集成了 AXI performance monitors (APM)。具体情况，可以参考Xilinx UG1085 ...

2022-08-02 标签：APM MPSoC AXI 3.2k 0

AXI学习路线，从握手协议开始

对 AXI master的全面讨论变得困难。我还没有（还）想出如何简化材料来写一篇关于如何构建通用 AXI master器的帖子，这已经够难了——通常来...

2022-07-29 标签：cpu Xilinx AXI 1.5k 0

AXI_GPIO简介与使用指南

前面简单学习了关于GPIO的操作，本次将使用PL 端调用 AXI GPIO IP 核，并通过 AXI4-Lite 接口实现 PS 与 PL 中 AXI...

2022-07-19 标签：GPIO Zynq AXI 6.3k 0

使用AXI-Full接口的IP进行DDR的读写测试

首先对本次工程进行简要说明：本次工程使用AXI-Full接口的IP进行DDR的读写测试。在我们的DDR读写IP中，我们把读写完成和读写错误信号关联到PL...

2022-07-18 标签：DDR AXI总线 SDK 6.9k 0

创建AXI Sniffer IP以在Vivado IP Integrator中使用教程

在某些情况下，通过嗅探 AXI 接口来分析其中正在发生的传输事务是很有用的。在本文中，我将为大家演示如何创建基本 AXI4-Lite Sniffer I...

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