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AMD Kria KR260 DPU配置教程

XILINX开发者社区 来源:XILINX开发者社区 2024-01-12 09:36 次阅读

本文作者:AMD 工程师Shaoyi Chen

这篇文章我们将为 AMD KriaKR260 在 AMD Vitis上创建硬件加速平台。 我们将从 KR260 预设文件开始,添加平台所需的外设并对其进行配置。 一切设置完毕后,我们将把硬件设计导出到 XSA。

创建名为 kr260_platform 的 Platform

Create Project > Next

Project name: kr260_platform > Next

6627ff9c-b071-11ee-8b88-92fbcf53809c.png

勾选 "Project is an extensible Vitis platform" > Next

6649283e-b071-11ee-8b88-92fbcf53809c.png

开发板选择 Boards > KR260 > Next > Finis

666dcebe-b071-11ee-8b88-92fbcf53809c.png

如果没有安装 KR260,需要先安装 KR260。

6693d0be-b071-11ee-8b88-92fbcf53809c.png

创建一个 Block Design
Create Block Design > OK

66b9f30c-b071-11ee-8b88-92fbcf53809c.png

Add PS > Run Block Automation > Apply Board Preset > OK

66db19ba-b071-11ee-8b88-92fbcf53809c.png66fc3cf8-b071-11ee-8b88-92fbcf53809c.png

在此阶段,AMD Vivado自动添加了 AMD Zynq UltraScale+ MPSoC,并应用了 KR260 的所有板卡预设选项。 预设选项包括 MPSoC PS 模块配置和引脚分配。


创建时钟和复位
Add a Clocking Wizard

clk_out1 to 100 MHz

clk_out2 to 300 MHz

clk_out3 to 600 MHz

Reset Type to Active Low > OK

6711a598-b071-11ee-8b88-92fbcf53809c.png6738a7d8-b071-11ee-8b88-92fbcf53809c.png

使能 Platform 的 AXI 接口

使能 PS 的 AXI Master 接口:

打开Platform Setup界面。

打开AXI Port子页面。

在 zynq_ultra_ps_e_0 选项下,使能

M_AXI_HPM0_FPD和**M_AXI_HPM1_FPD。**

保持 Memport 为 M_AXI_GP, sptag 为空。

使能来自 AXI Interconnect 的 AXI Master interfaces:

在 ps8_0_axi_periph 选项下, 点击 M01_AXI, 按住Shift 并点击 M07_AXI 以选中从 M01_AXI 到M07_AXI 的多个接口。

右键选中的选项并点击使能。

保持 Memport 为 M_AXI_GP,sptag 为 empty。

使能来自 PS 的 AXI Slave interfaces 来允许 Kernels 连接 DDR 内存:

在 zynq_ultra_ps_e_0 选项下, 选中所有的 AXI slave 接口: 按住Ctrl 并点击

S_AXI_HPC0_FPD,S_AXI_HPC1_FPD,S_AXI_HP0_FPD,S_AXI_HP1_FPD,S_AXI_HP2_FPD,S_AXI_HP3_FPD。

右击所有的选项并点击enable。

修改 S_AXI_HPC0_FPD和S_AXI_HPC1_FPD的Memport 为S_AXI_HP。

将接口的 sptag 名字修改为 HPC0, HPC1,HP0, HP1, HP2,HP3。 v++ 可以在 linking 阶段使用这些接口。

67548cc8-b071-11ee-8b88-92fbcf53809c.png

导出 XSA

点击Validate Design按钮来确认 block design 设计有效。在这个过程中 Vivado 会报告一个 critical warning,这是因为/axi_intc_0/intr没有被连接。因为 v++ 链接器会将中断连接到这个端口上,所以这个警告可以被忽略。

为 block design 创建一个 module wrapper:

在Source界面, Design Sources group 上右键design_1.bd。

选择Create HDL Wrapper...

选择Let Vivado manage wrapper and auto-update。

点击OK来为 block design 生成 wrapper。

生成设计:

在 Flow Navigator 窗口下选择 Generate Block Design。

点击 Generate。

在 Flow Navigator 窗口下选择 Generate Bitstream。

点击 Yes.

导出 Platform:

点击菜单File -> Export -> Export Platform来运行Export Hardware Platformwizard。

点击 Next 。

选择 Platform Type 为:Hardware, 点击 Next。

选择 Platform State:Pre-synthesis, 使能 Include Bitstream,点击 Next。

输入 Platform 属性并点击Next。比如:

Name: kv260_hardware_platform

Vendor: xilinx

Board: kv260

Version: 0.0

Description: This platform provides high PS DDR bandwidth and three clocks

输入 XSA 文件名:

‍kv260_hardware_platform并保持默认导出地址。

点击Finish。

kv260_hardware_platform.xsa将会被生成。

审核编辑:汤梓红

声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表电子发烧友网立场。文章及其配图仅供工程师学习之用,如有内容侵权或者其他违规问题,请联系本站处理。 举报投诉
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原文标题:开发者分享|AMD Kria™ KR260 DPU 配置教程 1

文章出处:【微信号:gh_2d1c7e2d540e,微信公众号:XILINX开发者社区】欢迎添加关注!文章转载请注明出处。

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