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QFN/QFP封装设计参考

xiaoyoufengs 来源:CEIA电子智造 2023-06-30 09:53 次阅读

背景:

QFP/QFN封装不良造成生产大量缺陷

1. gaw9.2z39-4 U8位QFP散热焊盘过孔设计不良造成制程中锡膏流入孔中造成大量制程不良,钻孔大小16mil,背面无半塞处理!

ca7bfd3a-166c-11ee-962d-dac502259ad0.png

U8

2. PI699E2.3U16-3DB U13位QFN焊盘设计与元件不匹配导致元件散热焊盘和PCB 引脚焊盘短路!

caae6ab8-166c-11ee-962d-dac502259ad0.png

3. DSL699E7.5Z20-2 U32位QFP焊盘封 装和PCB不匹配,导致钢网开孔依照PCB 制作以及元件散热焊盘和焊脚standoff 过大造成空焊。

cad4ebd4-166c-11ee-962d-dac502259ad0.png

U32 X-Ray

QFP焊盘设计规范— 引脚

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cbc5844a-166c-11ee-962d-dac502259ad0.png

QFN焊盘设计规范

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cc1049bc-166c-11ee-962d-dac502259ad0.png

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QFN/QFP焊盘设计其他要求:

1. 元件定位Mark点(Local Fiducials) :选择添加,设计原则如下:

1)尽量接近元件; 2)要求在元件对角设置2个,元件中心点到任何一个Mark中心点不得超过5cm; 3)形状为圆形或方形,大小为及设计如下图(选择其一):

cc772a56-166c-11ee-962d-dac502259ad0.png

cc9494ce-166c-11ee-962d-dac502259ad0.png

2. 极性丝印 :必须添加,形状为圆形,要求丝印在元件体外靠近元件处,大小根据实际情况定义,一般为(0.50mm-1.00mm)

3. QFN/QFP元件引脚和接地焊盘共面性要求:上限不超过0.10mm.

审核编辑:汤梓红
声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表电子发烧友网立场。文章及其配图仅供工程师学习之用,如有内容侵权或者其他违规问题,请联系本站处理。 举报投诉
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原文标题:干货分享丨QFN/QFP封装设计参考

文章出处:【微信号:CEIA电子智造,微信公众号:CEIA电子智造】欢迎添加关注!文章转载请注明出处。

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