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Hyperram使用注意事项总结

XL FPGA技术交流 来源:XL科技 作者:XL科技 2023-02-01 17:07 次阅读

出于功耗的考虑,易灵思在存储方面提供了对hyperram的支持。在hyperram中使用中有些需要注意的,我们在这里稍做总结 。

(1)IP设置

7f524cfa-a20f-11ed-bfe3-dac502259ad0.png

poYBAGPaLASAWoa9AAFmjijLAmk418.jpg

802192d0-a20f-11ed-bfe3-dac502259ad0.png

pYYBAGPaLHaAYnf6AAFWS_dic7g613.jpg

(2)IO时钟域设置

Hyperram的IO总共有三个时钟域,分别为hbramClk,hbramClk90,hbramClk_cal.并且要注意时钟是否反向。在hyperram的文档中提供了每个IO的时钟使用情况。请参考下图:

803958de-a20f-11ed-bfe3-dac502259ad0.png

(3)自动校准。

80638e9c-a20f-11ed-bfe3-dac502259ad0.png

注意calibration mode选择PLLAutoCalibration.自动校准就是控制器控制hbc_cal_SHIFT_ENA,hbc_cal_SHIFT_SEL和hbc_cal_SHIIF来实现校正。它们分别对应PLL的SHIFT,SHIFT_SEL和SHIFT_ENA信号

自动校准的可以通过hbc_cal_debug_info来得到。通过Bit[15:8]来判断找到的相位有哪些。bit[7:5]是用于指示选择的是那个相位。另外要注意RDO delay值,可以获取用于手动校准设计。

80ff341e-a20f-11ed-bfe3-dac502259ad0.png

(4)手动校准

1、在IP中选择PLL Manual Calibration手动校准。然后编译

2、通过手动调节dyn_pll_shase_en和dyn_pll_phase_sel,这两个通过hbc_cal_SHIFT_ENA和hbc_cal_SHIIF传给PLL(看起来没有必须通过控制器传输的必要),hbc_cal_SHIFT_SEL是在Hyperram控制器中选择的PLL对应的输出。

8125ca34-a20f-11ed-bfe3-dac502259ad0.png

其中dyn_pll_phase_en是使能信号,dyn_pll_phase_sel是step选择信号选择信号。

建议在资源充足的情况下使用自动校准。如果资源紧张可以先进行自动校准获取相应参数值,再用手动校准设置相应参数。

(5)PLL设置

poYBAGPaLJiALrbrAAFFmJ1UwuM214.jpg
8169971e-a20f-11ed-bfe3-dac502259ad0.png

8188d624-a20f-11ed-bfe3-dac502259ad0.png

(6)效率测试

以下是用hyperram测试的效率情况,仅供参考。

81c4fd16-a20f-11ed-bfe3-dac502259ad0.png

审核编辑:刘清

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原文标题:Hyperram使用指导

文章出处:【微信号:gh_ea2445df5d2a,微信公众号:FPGA及视频处理】欢迎添加关注!文章转载请注明出处。

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