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Codasip Studio 9.2.0版本发布 支持宏处理器以简化CodAL开发

lhl545545 来源:Codasip 科达希普 作者:Codasip 科达希普 2022-09-14 17:21 次阅读

随着Codasip Studio 9.2.0版本的发布,Codasip Studio新版本通过扩展和优化等系列新功能赋能处理器设计自动化。

Codasip Studio 9.2.0支持的新功能包括:

处理器

CodAL数组(array)

uRISC-V 2.0

模块中的流水线定义

模拟器保存状态和恢复状态

支持RHEL8(红帽企业Linux

支持苹果MacOS

首先让我们来看一下CodAL功能中的宏处理器、uRISC-V 2.0和数组

支持宏处理器以简化CodAL开发

Codasip Studio 9.2.0版包括一个宏处理器,这是一个强大的文本处理器,通过使用一组结构体来生成代码,简化了CodAL模型的编写。与C/C++预处理器相比,它支持的主要功能包括带参数的可调用宏、loops和复杂表达式等。

宏处理器简化了开发人员的工作,因为它避免了重复的工作和调用可能产生不必要开销的函数。下面的例子显示了宏处理器的用法之一。

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宏处理器的使用实例

同时值得一提的是宏处理器也可以与其它语言和工具一起使用。

在CodAL中应对多线程应用程序的数组支持

Codasip Studio 9.2.0支持多线程内核寄存器和寄存器文件的数组。这些数组以每个线程为单位保存信息。数组大小与线程的数量相匹配,每个线程只包括其各自在数组中的索引,可供使用。

Codasip Studio 9.2.0版本同时也支持信号数组(多维数组除外)。只要数据类型一对一匹配,就可以支持数组到数组的赋值,即使资源类型不同。支持诸如将一个寄存器数组分配给相同数据类型的信号数组。

数组可以动态地进行索引。在loop中语义被扩展,所以它们可以与数组一起使用。

以下示例显示了架构资源的数组语法:

register bit[32] r_foo [32];

register_file bit[32] rf_foo [FOO_SIZE];

register bit[1] s_foo [ONE + TWO];

71b6bbaa-340d-11ed-ba43-dac502259ad0.jpg

CodAL中的数组示例

uRISC-V 2.0实验支持

众所周知Codasip Studio 9.0版本首次支持用于5级流水线应用的uRISC-V处理器。uRISC-V是一个教程,允许用户在一个实时RISC-V实现上进行检查和学习。在Codasip Studio 9.2.0中,这个教程变成了uRISC-V 2.0,现在也可用于3级流水线应用。

这个功能扩展了Codasip Studio中用于科研目的或熟悉RISC-V架构的可能性。它包括尝试修改处理器,添加自定义指令扩展,以及在一个模型中优化性能,该模型的设计方法与Codasip RISC-V商业IP核相同。而该实现是一个简单的32位或64位3级流水线处理器,支持RISC-V I(基本整数)、M(整数乘除的标准扩展)、Zicsr(控制和状态寄存器指令)和Zifencei(栅栏指令)扩展,以及基于RISC-V标准的片上调试器。

720b0aa2-340d-11ed-ba43-dac502259ad0.png

Codasip Studio 9.2.0中的uRISC-V 2.0(Linux操作系统

审核编辑:彭静
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原文标题:Codasip Studio 9.2.0版正式发布,增加扩展和优化等系列新功能赋能处理器设计自动化。

文章出处:【微信号:Codasip 科达希普,微信公众号:Codasip 科达希普】欢迎添加关注!文章转载请注明出处。

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