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Versal 产品组合基于台积电（TSMC）的 7 nm FinFET 工艺技术，是第一个将软件可编程性与特定领域硬件加速和灵活应变能力相结合的平台，这对于跟上当今快速的创新步伐至关重要。

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【ALINX 技术分享】AMD Versal AI Edge 自适应计算加速平台之 Versal 介绍（2）

【ALINX 技术分享】AMD Versal AI Edge 自适应计算加速平台之 Versal 介绍，以及Versal 芯片开发流程的简介。

2024-03-07 标签：处理器 FPGA Xilinx 311 0

AMD Versal系列CIPS IP核建立示例工程

接着上一篇“AMD Versal系列CIPS IP核介绍”文章来进一步讲解如何来建立CIPS IP核示例工程。

2023-12-05 标签：amd 调试 IP核 332 0

Versal GTM如何用Tcl命令在IBERT生成QPRBS13序列

目前对于 Vivado 2023.1 版本的 IBERT GUI 界面暂时不支持 QPRBS13 的设置，需要通过 tcl 或者端口设置的方法来实现。

2023-08-18 标签：amd 仿真命令 398 0

AMD Versal系列FPGA NoC介绍及实战

NoC是相对于SoC的新一代片上互连技术，从计算机发展的历史可以看到NoC 必将是SoC 之后的下一代主流技术，SoC 通常指在单一芯片上实现的数字计算...

2023-07-13 标签：fpga amd 计算机 642 0

Versal HDIO OBUFT和IOBUF三态时序影响

本文着重探讨 HDIO OBUFT 和 IOBUF 用例。如果含三态控制 (OBUFT/IOBUF) 的 HDIO 输出缓冲器的上电电压为 3.3 V ...

2023-07-12 标签：以太网寄存器缓冲器 422 0

Versal启动文件简述

Versal™ 是由多个高度耦合的可配置块组成的自适应计算加速平台 (ACAP)

2023-07-07 标签：NoC Vivado 启动文件 692 0

如何在IPI流程中修改(以太网)IP工程(及其所包含的GT模块)的代码与属性

本文介绍如何修改IP例子工程里的IP和GT模块的源代码与属性

2023-07-10 标签：模块以太网寄存器 866 0

如何开启Versal的XilSEM功能

本文介绍了如何开启Versal最基本的XilSEM功能。

2023-07-07 标签：寄存器开发板 Versal 250 0

使用QEMU启动Versal VCK190 ACAP

本文涵盖了有关使用 PetaLinux 命令行来对 Versal™ ACAP 的 PetaLinux BSP 运行 QEMU 的信息

2023-07-07 标签：仿真器开源 qemu 373 0

Versal:JTAG TDO

本文则着重探讨 JTAG TDO 用例

2023-07-07 标签：寄存器 JTAG 指令 450 0

Versal Advanced IO Wizard-部分配置存在时序收敛问题

在Versal Advanced IO Wizard中，所包含的PLL的去歪斜电路可能导致数据速率较高时出现建立时间

2023-07-07 标签：接口 pll 时序 280 0

Vivado 202x-Versal时钟校准去歪斜的时序问题

使用“时钟校准去歪斜”时，在 Vivado 中会显示下列消息以指明是否启用该功能特性

2023-07-07 标签：时钟 Vivado Versal 379 0

Versal ACAP DDRMC-DDR4、LPDDR4和LPDDR4X外部参考时钟设计指南

本文旨在呈现使用 DDR4、LPDDR4 或 LPDDR4X 存储器控制器的 Versal ACAP 器件的外部参考时钟电路要求

2023-07-10 标签：仿真 DDR4 时钟设计 874 0

Versal Premium SysMon：如何在辅助SLR中对SysMon寄存器进行寻址

要在辅助 SLR 中启用对 Sysmon 寄存器空间的访问，须在 CIPS 和 NOC GUI 执行多个步骤

2023-07-10 标签：寄存器接口 Versal 173 0

Versal System Monitor(Sysmon)：过热告警行为

在 CIPS GUI 中已对 Versal System Monitor 过热 (OT) 告警进行了说明

2023-07-10 标签：Xilinx GUI Versal 314 0

在Versal VCK190评估套件上使用器件固件升级(DFU)执行USB辅助启动模式测试

本文将演示如何在 Versal AI Core 系列 VCK190 评估套件上从 USB 辅助启动模式启动 Linux

2023-07-10 标签：usb Linux JTAG 576 0

Versal GTY/GTYP：使用PRBS生成器和检查器

本文涵盖了在 Versal GTY 和 GTYP 中使用模式生成器和检查器时对以下操作的限制

2023-07-10 标签：Xilinx 生成器检查器 712 0

如何在Advanced IO Wizard(XPHY)中使用XPIO_VREF

SelectIO架构手册 AM010 描述了如何使用 XPIO_VREF原语来调整 Internal Vref

2023-07-11 标签：接口 RTL Versal 319 0

如何在IP集成器中将单工TX/RX核合并到多个Quad

要为 Versal 的多个 Quad 创建收发器设置，建议从 Transceiver Bridge IP 开始，在其中选择所需的设置，然后交由 Viva...

2023-06-09 标签：收发器 Xilinx Quad 490 0

Versal HBM系列外部参考时钟设计指南文章

Versal HBM 栈可通过内部 HSM0 参考时钟来进行时钟设置，此参考时钟是由 CIPS 或外部时钟源生成的。

2023-06-05 标签：时钟 NoC AXI 458 0

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