0
  • 聊天消息
  • 系统消息
  • 评论与回复
登录后你可以
  • 下载海量资料
  • 学习在线课程
  • 观看技术视频
  • 写文章/发帖/加入社区
创作中心

完善资料让更多小伙伴认识你,还能领取20积分哦,立即完善>

3天内不再提示

DVB-S2标准协议:流自适应与FEC编码简析

FPGA算法工程师 来源:FPGA算法工程师 2023-05-22 09:36 次阅读

5.2流自适应

流自适应(见图1和图4)提供填充以完成定长(Kbch bit)的BBFRAME和加扰。Kbch取决于FEC码率,如表5所示。当可用于传输的用户数据不足以完全填充BBFRAME时,或者当必须在BBFRAME中分配整数个UP时,可以应用填充。

输入流应该是一个BBHEADER后面跟着一个DATA FIELD。输出流应该是一个BBFRAME。

fd73c5a6-f812-11ed-90ce-dac502259ad0.png

图4:流适配器输出处的BBFRAME格式

5.2.1 填充

(Kbch-DFL-80)个零bit应附加在DATA字段之后。产生的BBFRAME应具有Kbch位的恒定长度。对于广播服务应用,DFL = Kbch -80,因此不应用填充。

5.2.2基带加扰

完整的BBFRAME将被随机化。随机化顺序应与BBFRAME同步,从MSB开始,以Kbch bit后结束。

加扰序列由图5的反馈移位寄存器产生。伪随机二进制序列(PRBS)发生器的多项式应为:

将序列(100101010000000)装入PRBS寄存器,如图5所示,应在每个BBFRAME开始时启动。

fd99cc24-f812-11ed-90ce-dac502259ad0.png

图5:PRBS编码器的可能实现

5.3FEC编码

该子系统应执行外码(BCH)、内码(LDPC)和比特交织。由输入流BBFRAME和输出流FECFRAME组成。

每个BBFRAME (比特)由FEC编码子系统处理,生成一个FECFRAME (比特)。系统BCH外码的奇偶校验位(BCHFEC)应附加在BBFRAME字段之后,内部LDPC编码器的奇偶校验位(LDPCFEC)应附加在BCHFEC字段之后,如图6所示。

fdb6ebc4-f812-11ed-90ce-dac502259ad0.png

图6:比特交织前的数据格式(常规FECFRAME的nldpc = 64 800 bit,短FECFRAME的nldpc = 16 200 bit)

表5a给出了常规FECFRAME (= 64 800 bits)的FEC编码参数,表5b给出了短FECFRAME (= 16 200 bits)的FEC编码参数。

表5a:编码参数(常规FECFRAME nldpc = 64800)

fdd6c606-f812-11ed-90ce-dac502259ad0.png

表5b:编码参数(短FECFRAME nldpc = 16 200)

fe1e9dc8-f812-11ed-90ce-dac502259ad0.png

5.3.1 外码(BCH)

每个BBFRAME(Kbch)应应用t个纠错的 BCH (Nbch, Kbch)码以生成错误保护包。nldpc = 64 800的BCH代码参数见表5a, nldpc = 16 200的BCH代码参数见表5b。

t个纠错BCH编码器的生成器多项式由表6a中nldpc = 64 800和表5b中nldpc = 16200的第一个t多项式相乘得到。

表6a: BCH多项式(对于常规FECFRAMEnldpc = 64 800)

fe4d7d6e-f812-11ed-90ce-dac502259ad0.png

表6b: BCH多项式(对于短FECFRAME nldpc = 16 200)

fe8c2c1c-f812-11ed-90ce-dac502259ad0.png

fed77780-f812-11ed-90ce-dac502259ad0.png

5.3.2 内码(LDPC)

fef79524-f812-11ed-90ce-dac502259ad0.png

5.3.2.1 常规FECFRAME的内码

ff2036be-f812-11ed-90ce-dac502259ad0.png

ff46ba8c-f812-11ed-90ce-dac502259ad0.png

ff647072-f812-11ed-90ce-dac502259ad0.png

ff9cbcca-f812-11ed-90ce-dac502259ad0.png

以类似的方式,对于每一组360个新信息比特,从表B.1到B.11中的新行用于查找校验位累加器的地址。

用完所有信息比特后,得到最终校验位如下:

ffccba88-f812-11ed-90ce-dac502259ad0.png

表7a:正常帧的q值

fffe831a-f812-11ed-90ce-dac502259ad0.png

001d1fbe-f813-11ed-90ce-dac502259ad0.png

5.3.2.2 短FECFRAME的内码

00304986-f813-11ed-90ce-dac502259ad0.png

5.3.3 比特交织(仅适用于8PSK, 16APSK和32APSK)

对于8PSK、16APSK和32APSK调制格式,LDPC编码器的输出应使用块交织器进行位交织。数据按列顺序写入交织器,按行顺序读出(首先读出BBHEADER的MSB,但在8PSK速率3/5的情况下,BBHEADER的MSB在第三读出),如图7和图8所示。

每个调制格式的块交织器的配置如表8所示。

表8:位交织器结构

00716bfa-f813-11ed-90ce-dac502259ad0.png

009e9314-f813-11ed-90ce-dac502259ad0.png

图7:8PSK和正常FECFRAME长度的比特交织方案(除3/5外的所有速率)

00d617ee-f813-11ed-90ce-dac502259ad0.png

图8:8PSK和正常FECFRAME长度的比特交织方案(速率仅为3/5)





审核编辑:刘清

声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表电子发烧友网立场。文章及其配图仅供工程师学习之用,如有内容侵权或者其他违规问题,请联系本站处理。 举报投诉
  • 发生器
    +关注

    关注

    3

    文章

    1291

    浏览量

    60876
  • 移位寄存器
    +关注

    关注

    2

    文章

    182

    浏览量

    22021
  • FEC
    FEC
    +关注

    关注

    0

    文章

    41

    浏览量

    13591
  • PRBS
    +关注

    关注

    0

    文章

    10

    浏览量

    2538

原文标题:DVB-S2标准协议:流自适应与FEC编码

文章出处:【微信号:FPGA算法工程师,微信公众号:FPGA算法工程师】欢迎添加关注!文章转载请注明出处。

收藏 人收藏

    评论

    相关推荐

    ATSC DVB ISDB标准的区别

    DVB采纳,而ATSC对此则不作强制性规定。     (2)系统层和视频编码DVB和ATSC标准都采纳MP
    发表于 05-30 17:37

    国内外主流DVB-S ,DVB-S2及ISDBT 方案,功能

    国内外主流DVB-S ,DVB-S2及ISDBT厂家,,型号,方案,及功能。第一次发贴,希望对广大烧友有用。以后再给传更多更详细的资料给大家共享! 
    发表于 10-28 10:41

    PCI型卫星电视信号源--DekTec DTA-107S2

    PCI型卫星电视信号源DTA-107S2[/td]一、技术特点兼容DVB-S标准EN300 421,DVB-S2标准EN302 307以及I
    发表于 08-08 17:34

    N5182A信号发生器能生成dvb-s2信号吗?

    嗨,我想在L-BAND(950Mhz到1950Mhz)中生成DVB-SDVB-S2信号(QPSK,8PSK,16APSK和16QAM)。 N5182A信号发生器能做到吗?我的目标是通过我的卫星设备
    发表于 08-02 12:10

    采用MSD7S45的海外DVB-S2高清机顶盒方案

      一、方案概述  MSD7S45系列芯片是Mstar推出的支持H265解码的高安DVB-S2的高清机顶盒方案。芯片内置S2解调器,支持各主流条件接收系统,支持PVR/Timeshit功能,支持各种
    发表于 07-02 17:32

    基于MSD7S01的DVB-S2机顶盒方案

      一、方案概述:  MSD7S01芯片是Mstar推出的极富竞争力的DVB-S2机顶盒方案、芯片内置64MB DDR2S2解调器、支持Biss功能、支持PVR/Timeshit功能
    发表于 07-06 10:09

    如何去实现一种自适应算术编码

    自适应算术编码的基本原理是什么?自适应算术编码的FPGA实现如何对自适应算术编码进行仿真?
    发表于 04-30 06:50

    DVB-S/DVB-S2信号发生器 (DVB-S/S2 Si

    SSG500 is the DVB-S2 signal generator built in DVB-S2 modulator and Upconverter in one unit.
    发表于 01-15 11:32 52次下载

    基于IP over DVBDVB-H仿真系统

    根据对DVB-H 协议中的关键技术—时间切片、多协议封装及前向纠错编码(MPE-FEC)以及相关信道编码
    发表于 01-11 13:54 13次下载

    基于PXA270 和STi710x 的双CPU DVB-S2

    基于PXA270 和STi710x 的双CPU DVB-S2标准卫星数字机顶盒方案:本文设计了一款基于PXA270 和STi710x 的双CPU DVB-S2 标准卫星数字机顶盒方案,
    发表于 01-16 15:35 41次下载

    基于PXA270和STi710x的双CPU DVB-S2标准

    基于PXA270 和STi710x 的双CPU DVB-S2 标准卫星数字机顶盒方案本文设计了一款基于PXA270 和STi710x 的双CPU DVB-S2 标准卫星数字机顶盒方案,
    发表于 02-05 22:23 46次下载

    自适应算术编码的FPGA实现

    摘要: 在简单介绍算术编码自适应算术编码的基础上,介绍了利用FPGA器件并通过VHDL语言描述实现自适应算术编码的过程。整个
    发表于 06-20 13:40 1041次阅读
    <b class='flag-5'>自适应</b>算术<b class='flag-5'>编码</b>的FPGA实现

    基于网络编码的速率自适应协作介质访问控制协议

    传统无线网络编码协议在单播传输模式中较少考虑速率自适应对网络性能的改善作用,而利用RTS/CTS握手信号进行信道估计的速率自适应机制则存在开销大、网络吞吐性能差等缺陷。为此,提出一种基
    发表于 01-24 14:21 0次下载

    DVB-S2标准协议:模式自适应

    该子系统应在DATA FIELD中执行输入接口、输入流同步(可选)、空包删除(仅针对TS输入流和ACM)、用于错误检测的CRC-8编码(仅针对分组的输入流)、输入流合并(仅针对多个输入流)和输入流切片。
    的头像 发表于 05-08 11:24 1139次阅读
    <b class='flag-5'>DVB-S2</b><b class='flag-5'>标准</b><b class='flag-5'>协议</b>:模式<b class='flag-5'>自适应</b>

    基于MATLAB的DVB-S2端到端示例如何搭建仿真链路

    随着卫星互联网的兴起,我们再次将目光聚集到DVB-S2上。与之相关的还有DVB-S2X和DVB-RCS2等,以及最近几年提出的5G-NTN。
    的头像 发表于 05-17 09:07 1225次阅读
    基于MATLAB的<b class='flag-5'>DVB-S2</b>端到端示例如何搭建仿真链路