针对PCB设计中“引脚间距小于10”的报错问题，以下是原因分析和解决方案（以常见设计软件如Altium Designer/KiCad为例）：
⚠️ 报错原因
- 设计规则冲突：
- 软件的设计规则检查（DRC）中设置了 最小间距限制（通常默认≥10mil/0.254mm），实际引脚间距（焊盘间、引脚与走线/过孔间）小于此值触发报错。
- 封装库问题：
- 元件封装（Footprint）的焊盘中心距或形状尺寸本身小于规则允许值。
- 布局重叠：
- 元件放置时引脚与其他器件/走线距离过近。
? 解决方案
✅ 方法1：修改设计规则（推荐优先检查）
- 打开设计规则设置（Altium:
Design > Rules；KiCad:工具 > 设计规则）。 - 找到 电气间距规则（Electrical Clearance）：
- 检查
Minimum Clearance值（如默认10mil）。 - 若允许减小，将此值改为 ≤实际引脚间距的值（如8mil），但需确保符合生产商工艺能力❗。
- 检查
- 检查 元件间距规则（Component Clearance）：
- 调整元件本体或引脚间的最小距离限制。
✅ 方法2：修正元件封装
- 打开元件封装库，检查焊盘中心距（Pin Pitch）：
- 标准间距如1.27mm（100mil）、0.65mm等。若封装错误（如误设为0.5mm），需重新绘制焊盘位置。
- 确保焊盘形状/尺寸未超出引脚实际范围（如避免方形焊盘边缘间距过近）。
✅ 方法3：调整布局布线
- 手动移动元件：拉开与其他引脚/走线的距离。
- 优化走线路径：避免在密集引脚区域穿线，改用更细线宽或调整过孔位置。
- 使用局部规则：对特定高密度区域设置豁免规则（Altium的
Room Rules）。
✅ 方法4：忽略报错（慎用！）
- 若确认设计安全（如厂商确认可生产），可在DRC中禁用该规则，但可能导致良率风险❗。
⚡ 关键注意事项
- 单位确认：检查规则单位是 mil（0.0254mm）还是 mm，10mil≈0.254mm。
- 生产工艺限制：最小间距取决于PCB厂能力（如普通工艺≥6mil/0.15mm）。低于10mil需提前确认可行性。
- 电气安全：高压或高速信号需额外增加间距以防短路/干扰。
? 操作示例（Altium Designer）
1. 顶部菜单 Design > Rules...
2. 在 Electrical 规则组展开 Clearance > 修改 Minimum Clearance 值
3. 在 Component Clearance 中调整焊盘/本体间距限制
4. 重新运行DRC（Tools > Design Rule Check）建议流程：先检查封装是否正确 → 再调整设计规则 → 最后优化布局。若为厂商标准封装（如QFP、BGA），优先规则适配；若为自制封装，务必校准尺寸。设计完成后需再次DRC验证！
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huzp_123
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郑振宇altium
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