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74ALVCH16646 由 16 个同相总线收发器电路组成，具有 3 态输出、 D型触发器和控制电路，用于直接从 内部寄存器。“A”或“B”总线上的数据将在内部寄存器中计时，因为 适当的时钟（nCPAB或nCPBA）达到高逻辑电平。输出使能 （nOE） 和 提供方向 （nDIR） 输入以控制收发器功能。在收发器模式下， 高阻抗端口的数据可以存储在“A”或“B”寄存器中，或者存储在两者中。 选择源输入（nSAB 和 nSBA）可以多路复用存储和实时（透明模式） 数据。方向 （nDIR） 输入决定了当 nOE 处于活动状态 （LOW） 时，哪条总线将接收数据。 在隔离模式（nOE = HIGH）下，“A”数据可能存储在“B”寄存器中，/或“B”数据可能存储 存储在“A”寄存器中。 当输出功能被禁用时，输入功能仍处于启用状态，并可用于存储 并传输数据。两辆公交车中的一辆，即“A”或“B”，一次只能行驶。 为确保上电或断电期间的高阻抗状态，nOE应与VCC相连 通过上拉电阻;电阻的最小值由电流吸收/ 驱动器的电流源能力。
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