资料介绍
AD9523提供低功耗、多路输出时钟分配功能,具有低抖动
性能,还配有片内集成锁相环(PLL)和电压控制振荡器
(VCO)。片内VCO的调谐频率范围为3.6 GHz至4.0 GHz。
AD9523旨在满足长期演进(LTE)和多载波GSM基站设计的
时钟要求。它依靠外部VCXO清除参考抖动,以满足严格
的低相位噪声要求,从而获得可接受的数据转换器信噪比
(SNR)性能。
输入接收器、振荡器和零延迟接收器支持单端和差分两种
操作。当连接系统参考时钟恢复输入及外部VCXO,器件
产生1 MHz至1 GHz范围内的14路低噪声输出,以及一路来
自输入PLL(PLL1)的专用缓冲输出。一路时钟输出相对于
另一路时钟输出的频率和相位可通过分频器相位选择功能
改变,该功能用作无抖动的时序粗调,其调整增量相当于
VCO输出信号的半个周期。
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