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本论文主要讨论和仿真了基于CPLD的PSK系统单元设计，在阐述调制解调系统的基本原理与设计方法的同时，又详细地介绍了系统的总体电路框图及各个模块的具体软硬件实现。作者以VHDL作为设计的硬件描述语言，在Altera公司的Maxplus2开发平台上进行了程序设计及波形仿真。“自顶向下”是本设计的主要特色，所有程序都通过了以EPM7128SLC84-7作为主芯片的CPLD实验开发板的硬件调试。
现代通信系统要求通信距离远、通信容量大、传输质量好。作为其关键技术之一的调制
解调技术一直是人们研究的一个重要方向[5]。从模拟调制到数字调制，从二进制发展到多进制调制，虽然调制方式多种多样，但都是朝着使通信系统更高速、更可靠的方向发展。一个系统的通信质量，很大程度上依赖于所采用的调制方式。因此，对调制方式的研究，将直接决定着通信系统质量的好坏[1]。
复杂可编程逻辑器件（CPLD）结合了专用集成电路和DSP 的优势，既具有很高的处理
速度，又具有一定的灵活性。因此，基于CPLD 的数字调制系统的研究具有重要的实际意义。本文论述了如何用CPLD 实现PSK 数字调制系统的方法，其实现步骤包括：1.研究PSK调制系统的原理及设计方法；2.根据各个系统的总体功能与硬件特点，设计总体框图；3.根据VHDL 语言特点，对系统进行VHDL 建模；4.根据VHDL 模型，进行具体VHDL 语言程序设计；5.对设计的程序进行波形仿真与硬件调试。
现代通信系统要求通信距离远、通信容量大、传输质量好。作为其关键技术之一的调制
解调技术一直是人们研究的一个重要方向[5]。从模拟调制到数字调制，从二进制发展到多进制调制，虽然调制方式多种多样，但都是朝着使通信系统更高速、更可靠的方向发展。一个系统的通信质量，很大程度上依赖于所采用的调制方式。因此，对调制方式的研究，将直接决定着通信系统质量的好坏[1]。
复杂可编程逻辑器件（CPLD）结合了专用集成电路和DSP 的优势，既具有很高的处理
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