资料介绍
This single bus buffer gate is designed for 1.65-V to 5.5-V VCC operation.
The SN74LVC1G126-Q1 is a single line driver with a 3-state output. The output is disabled when the output-enable (OE) input is low.
To ensure the high-impedance state during power up or power down, OE should be tied to GND through a pulldown resistor; the minimum value of the resistor is determined by the current-sourcing capability of the driver.
This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.
- SN74LVC1G32-Q1,pdf(SINGLE 2-IN 17次下载
- SN74AUC2G126,pdf(DUAL BUS BUFF 5次下载
- SN74LVC1G125-Q1,pdf(Single Bus 25次下载
- SN74LVC1G02,pdf(SINGLE 2-INPUT 19次下载
- SN74LVC1G10,pdf(single 2-input 14次下载
- SN74LVC1G0832,pdf(SINGLE 3-INP 7次下载
- SN74LVC1G373,pdf(Single D-Type 21次下载
- SN74LVC245A,pdf(Octal Bus Tran 32次下载
- SN74LVC2G126,pdf(Dual Bus Buff 32次下载
- SN74LVC1G126,pdf9SINGLE BUS BU 19次下载
- SN74LVC126A-Q1,pdf9Quadruple B 18次下载
- SN74AUC1G126,pdf(Single Bus Bu 18次下载
- SN74AHCT1G126-Q1,pdf(Single Bu 5次下载
- SN74AHCT1G126,pdf(SINGLE BUS B 9次下载
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