资料介绍
本章节对改善您系统的信号完整性,以及在系统中成功实现LPDDR2SDRAM接口提供了指南。
具有UniPHY知识产权(IP)的LPDDR2SDRAM控制器使您能够实现LPDDR2 SDRAM与Arria”V和CycloneV器件之间的接口连接。
本章重点对影响信号完整性的以下几个主要因素作了介绍:
■I/0标准
■LPDDR2配置
■信号匹配
■印刷电路板(PCB)布局指南
LPDDR2SDRAM 接口信号使用HSUL-12JEDECI/0信号标准,具有低功耗和低排放的特性。HSUL-12JEDECI/0标准主要用于点到点的无端接总线拓扑结构。通过使用此标准,在LPDDR2SDRAM实现中就不再需要外部串行或者并行匹配电阻,并且大大降低了端接功耗,使可编程驱动强度用于匹配阻抗。
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