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DS90CF384 +3.3V LVDS 接收器 24 位平板显示 (FPD) 链接 - 65 MHz

数据:

描述

DS90C383发送器将28位CMOS /TTL数据转换为4个LVDS(低压差分信号)数据流。锁相发送时钟通过第五LVDS链路与数据流并行发送。发送时钟的每个周期28比特的输入数据被采样和发送。 DS90CF384接收器将LVDS数据流转换回28位CMOS /TTL数据。在65MHz的发送时钟频率下,24比特的RGB数据和3比特的LCD定时和控制数据(FPLINE,FPFRAME,DRDY)以每LVDS数据信道455Mbps的速率发送。使用65 MHz时钟,数据吞吐量为227 Mbytes /sec。变送器提供可编程边缘数据选通,便于与各种图形控制器连接。可通过专用引脚将发送器编程为上升沿选通或下降沿选通。上升沿发送器将与下降沿接收器(DS90CF384)互通,无需任何转换逻辑。 DS90CF384还提供64引脚,0.8mm细间距球栅阵列(FBGA)封装,PCB尺寸减少44%(可用Q3,1999)。

该芯片组是理想的手段解决与宽,高速TTL接口相关的EMI和电缆尺寸问题。

特性

  • 20至65 MHz移位时钟支持
  • 可编程发送器(DS90C383)选通选择
    (上升沿或下降沿)频闪)
  • 单3.3V电源
  • 芯片组(Tx + Rx)功耗< 250 mW(典型值)
  • 掉电模式(总计<0.5 mW)
  • 每个时钟单像素XGA(1024x768)就绪
  • 支持VGA,SVGA ,
  • 带宽高达227兆字节/秒
  • 高达1.8 Gbps的吞吐量
  • 窄总线可减少​​电缆尺寸和成本
  • 用于低EMI的290 mV摆幅LVDS器件
  • PLL无需外部元件
  • 薄型56引脚TSSOP封装。
  • DS90CF384也有64球,0.8mm细间距球栅阵列(FBGA)封装
  • 下降沿数据选通接收器
  • 与TIA /EIA-644 LVDS标准兼容
  • ESD额定值> 7 kV
  • 工作温度:40°C至+ 85°C

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参数 与其它产品相比 显示 SerDes

 
Function
Color Depth (bpp)
Pixel Clock Min (MHz)
Pixel Clock (Max) (MHz)
Input Compatibility
Output Compatibility
Total Throughput (Mbps)
Rating
Operating Temperature Range (C)
Package Group
Package Size: mm2:W x L (PKG)
Pin/Package
DS90CF384
Receiver    
24    
20    
65    
FPD-Link LVDS    
LCMOS
LVTTL    
1800    
Catalog    
-40 to 85    
TSSOP    
56TSSOP: 113 mm2: 8.1 x 14(TSSOP)    
56TSSOP    

方框图 (1)

技术文档

数据手册(1)
元器件购买 DS90CF384 相关库存

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