0
  • 聊天消息
  • 系统消息
  • 评论与回复
登录后你可以
  • 下载海量资料
  • 学习在线课程
  • 观看技术视频
  • 写文章/发帖/加入社区
创作中心

完善资料让更多小伙伴认识你,还能领取20积分哦,立即完善>

3天内不再提示

Xilinx赛灵思官微

文章:514 被阅读:125.6w 粉丝数:23 关注数:0 点赞数:8

广告

技巧分享:如何在Vivado中正确使用接口

设计技巧:在 Vivado Synthesis 中使用 SystemVerilog 接口连接逻辑
的头像 Xilinx赛灵思官微 发表于 07-02 12:03 11190次阅读
技巧分享:如何在Vivado中正确使用接口

软件更新:Vivado 2019.1 现已开放下载

软件更新:Vivado 2019.1 现已开放下载
的头像 Xilinx赛灵思官微 发表于 07-02 12:03 10523次阅读

技术分享:信号完整性仿真 - 入门

技术分享:信号完整性仿真 - 入门
的头像 Xilinx赛灵思官微 发表于 07-02 12:03 3551次阅读
技术分享:信号完整性仿真 - 入门

赛灵思的 SDAccel 开发环境为 FPGA 提供软件应用设计流程

在 FPGA 设计方面,设计人员能够为运行特定工作负载开发自己的处理架构。FPGA 的一大重要优势就....
的头像 Xilinx赛灵思官微 发表于 06-28 06:07 2843次阅读
赛灵思的 SDAccel 开发环境为 FPGA 提供软件应用设计流程