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随着我国改革开放，人们生活水平的不断提高，汽车越来越成为人们生活中不可缺少的一部分。从世界上第辆T型福特牌轿车被盗开始，偷车已成为现今城市里最常见的犯罪行为之一。汽车数量增多，车辆被盗的数量也逐年上升，这给社会带来极大的不安定因素，担心车辆被盗，成为困扰每一位汽车用户的难题。 　　本文将系统介绍有关汽车防盗器的原理、选配、安装及使用等方面的基本知识，希望能给放大汽车用户以帮助。欢迎广大读者和业内士来稿或咨询，协助我们将此栏目办好。 　　问：什么是汽车防盗器？ 　　答：简单说，汽车防盗器就是一种安装在车上，用来增加盗车难度，处长盗车时间的装置。 　　问：汽车防盗器有哪几种类型？ 　　答：随着科学技术的进步，为对付不断升级的盗车手段，人们一代一代研制各种方式、不同结构的防盗器，目前防盗器按其结构可分三大类；机械式、电子式和网络式。钩锁、转达向盘锁和变速挡锁等基本属于机械式防盗器，它主要是告锁定离合、制动、油门或转向盘、变速挡来达到防盗的目的，但只防盗不报警。插片式、按键式和遥控式等都属于电子式防盗器，（摘自：华夏汽车影音防盗社区http://bbs.carbav.com)它主要是靠锁定点火或起动来达到防盗的目的，同时具有防盗和声音报警功能。GPS卫星定位汽车防盗系统(或其他网络系统)，将报警信息和报警车辆所在位置无声地传送到报警中心。 　　问：遥控式汽车防盗器有哪些特点？　　答：遥控式汽车防盗器是随着电子技术的进步而发展起来的，是市场上推广普及最为广泛的一种。它的特点是遥控控制防盗器的全部功能，可靠方便，可带有振动侦测、门控保护及微波或红外探头等功能。随着市对防盗器要求的不断提高，遥控式汽车防盗器还增加了许多方便使用的附加功能，如遥控中控门锁、遥控送放冷暖风、遥控电动门窗及遥控开启行李舱等功能。

本帖最后由 eehome 于 2013-1-5 10:07 编辑 　　1、 什么是同步逻辑和异步逻辑? 整个设计中只有一个全局时钟称为同步逻辑。 同步电路是由时序电路(寄存器和各种触发器) 和组合逻辑电路构成的电路， 其所有操作都是在严格的时钟控制下完成的。 这些时序电路共 享同一个时钟CLK，而所有的状态变化都是在时钟的上升沿(或下降沿)完成的。 不同子系统使用多个时钟信号的逻辑设计称为异步逻辑。　　2、 什么是竞争与冒险现象?怎样判断?如何消除? 信号在数字电路器件内部通过连线和逻辑单元时， 都有一定的延时。 延时的大小与连线的长 短和逻辑单元的数目有关，同时还受器件的制造工艺、工作电压、温度等条件的影响。信号 的高低电平转换也需要一定的过渡时间。 由于存在这两方面因素， 多路信号的电平值发生变 化时，在信号变化的瞬间，组合逻辑的输出有先后顺序，并不是同时变化，往往会出现一些 不正确的尖峰信号，这些尖峰信号称为"毛刺"。如果一个组合逻辑电路中有"毛刺"出现，就 说明该电路存在"冒险"。 解决方法：一是添加布尔式的消去项，二是用 D 触发器，格雷码计数器，同步电路等优秀的 设计方案可以消除。　　3、什么是亚稳态?如何解决亚稳态? 亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。 当一个触发器进入亚稳 态时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平上。 在这个稳定期间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无用的输 出电平可以沿信号通道上的各个触发器级联式传播下去。 解决方法： 1) 降低系统时钟 2) 用反应更快的 FF 3) 引入同步机制，防止亚稳态传播 4) 改善时钟质量，用边沿变化快速的时钟信号，关键是器件使用比较好的工艺和时钟周期 的裕量要大。　　4、常用逻辑电平有哪些?TTL 与 COMS 电平可以直接互连吗? TTL，COMS，不能直连 LVDS：LVDS(Low Voltage Differential Signal)即低电压差分信号，LVDS 接口又称 RS644 总线接口，是 20 世纪 90 年代才出现的一种数据传输和接口术。 ECL：(EmitterCoupled Logic)即射极耦合逻辑，是带有射随输出结构的典型输入输出接口 电路。 CML：CML 电平是所有高速数据接口中最简单的一种。其输入和输出是匹配好的，减少了外 围器件，适合于更高频段工作。　　5、数字电路设计中，静态时序模拟和动态时序模拟各有什么优缺点? 静态时序分析是采用穷尽分析方法来提取出整个电路存在的所有时序路径， 计算信号在这些 路径上的传播延时， 检查信号的建立和保持时间是否满足时序要求， 通过对最大路径延时和 最小路径延时的分析，找出违背时序约束的错误。它不需要输入向量就能穷尽所有的路径， 且运行速度很快、占用内存较少，不仅可以对芯片设计进行全面的时序功能检查，而且还可 利用时序分析的结果来优化设计， 因此静态时序分析已经越来越多地被用到数字集成电路设 计的验证中。 动态时序模拟就是通常的仿真， 因为不可能产生完备的测试向量， 覆盖门级网表中的每一条 路径。因此在动态时序分析中，无法暴露一些路径上可能存在的时序问题;　　6、多时域设计中，如何处理信号跨时域? 不同的时钟域之间信号通信时需要进行同步处理， 这样可以防止新时钟域中第一级触发器的 亚稳态信号对下级逻辑造成影响，其中对于单个控制信号可以用两级同步器，如电平、边沿 检测和脉冲，对多位信号可以用 FIFO，双口 RAM，握手信号等。 跨时域的信号要经过同步器同步，防止亚稳态传播。例如：时钟域 1 中的一个信号，要送到 时钟域 2，那么在这个信号送到时钟域 2 之前，要先经过时钟域 2 的同步器同步后，才能进 入时钟域 2。这个同步器就是两级 D 触发器，其时钟为时钟域 2 的时钟。这样做是怕时钟域 1 中的这个信号，可能不满足时钟域 2 中触发器的建立保持时间，而产生亚稳态，因为它们 之间没有必然关系，是异步的。这样做只能防止亚稳态传播，但不能保证采进来的数据的正 确性。所以通常只同步很少位数的信号。比如控制信号，或地址。当同步的是地址时，一般 该地址应采用格雷码，因为格雷码每次只变一位，相当于每次只有一个同步器在起作用，这 样可以降低出错概率， 象异步 FIFO 的设计中， 比较读写地址的大小时， 就是用这种方法。 如 果两个时钟域之间传送大量的数据，可以用异步 FIFO 来解决问题。　　7、IC 设计中同步复位与异步复位有什么区别? 同步复位在时钟沿采复位信号， 完成复位动作。 异步复位不管时钟， 只要复位信号满足条件， 就完成复位动作。 异步复位对复位信号要求比较高， 不能有毛刺， 如果其与时钟关系不确定， 也可能出现亚稳态。　　8、latch 与 register 有什么区别? latch 是电平触发，register 是边沿触发，register 在同一时钟边沿触发下动作，符合同 步电路的设计思想，而 latch 则属于异步电路设计，往往会导致时序分析困难，不适当的应 用 latch 则会大量浪费芯片资源。　　9、BLOCKING 和 NONBLOCKING 赋值有什么区别? 非阻塞赋值：块内的赋值语句同时赋值，一般用在时序电路描述中 阻塞赋值：完成该赋值语句后才能做下一句的操作，一般用在组合逻辑描述中　　10、Moore 与 Mealy 状态机各有什么特征? Moore 状态机的输出仅与当前状态值有关,且只在时钟边沿到来时才会有状态变化;Mealy 状态机的输出不仅与当前状态值有关,而且与当前输入值有关,这一特点使其控制和输出更 加灵活,但同时也增加了设计复杂程度。　　11、 什么是“线与”逻辑，要实现它，在硬件特性上有什么具体要求? 将几个 OC 门结构与非门输出并联，当每个 OC 门输出为高电平时，总输出才为高，这种连接 方式称为线与。　　12、 如何用 D 触发器实现 2 倍分频的逻辑电路? 把 D 触发器的输出端加非门接到 D 端即可实现 2 倍分频的逻辑电路。　　13、一个四级的 Mux，其中第二级信号为关键信号如何改善 timing? 关键：将第二级信号放到最后输出一级输出，同时注意修改片选信号，保证其优先级未被修 改。　　14、为什么一个标准的倒相器中 P 管的宽长比要比 N 管的宽长比大? 和载流子有关，P 管是空穴导电，N 管电子导电，电子的迁移率大于空穴，同样的电场下，N 管的电流大于 P 管，因此要增大 P 管的宽长比，使之对称，这样才能使得两者上升时间下降 时间相等、高低电平的噪声容限一样、充电放电的时间相等。　　15、 什么是 Setup 和 Holdup 时间? 建立时间(setup time)是指在触发器的时钟信号上升沿到来以前，数据稳定不变的时间， 如果建立时间不够，数据将不能在这个时钟上升沿被打入触发器;保持时间(hold time) 是指在触发器的时钟信号上升沿到来以后，数据稳定不变的时间，如果保持时间不够，数据 同样不能被打入触发器。　　16、如果已知 reg 的 setup,hold 时间，组合逻辑的 delay 需要在什么范围内? Delay T+T2max，T3hold>T1min+T2min

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本帖最后由 gk320830 于 2015-3-7 08:21 编辑 复位电路集锦

1. Q：我的ALLEGRO 是14.0版本的，FILE——EXPORT——后面就没有看到SUB DRAWING的命令了。如果用EDIT——COPY的话又不能把A板的线贴到B板上，我该怎么办？A: 是不是你启动Allegro 时Cadence Product Choices 没选好,要选PCB Dedign Expert 或Allegro Expert~~~2. Q: 在ALLEGRO中，找个器件好难啊，他只是点亮器件而光标不移动到器件那里。请问各为大侠，有没办法可以象POWERPCB 那样，查找零件时光标跟着移动？A:确认将元件点亮后，将鼠标移动至右下角的小显示框中，单击左键，光标即可自动转到所点亮的元件处.3. Q: 将logic_edit_enabled打开后，只能删除单个的net, logic_edit_enabled打开".是從何處打開???A: 在14.2中的操作：Setup -> User Preferences Editor -> Misc -> logic_edit_enabled然后可以在LOGIC/NET LOGIC 下删除NET。4. Q: 想移动元件的某一个PIN ， 请问该如何做。用move 命令， 总提示Symbol or drawing must have UNFIXED_PINS property。A: edit -> properties 选中要move Pin的元件的symbols，增加UNFIXED_PINS 属性即可。5.Q: how can i get rid of the "dynamic length" dialogue box?A: Setup -> User Preferences Editor ->Etch>allegro_etch_length_on6 .Q： 请问如何將以删除的PIN NUMBER及SILKSCREEN还原??A：删除此零件,再重新导入~~~或可以直接UPDATE 零件也可以7. Q：从orcad导入后，place->quickplace，但是出来的元件上面很多丝横，就和铺铜一样，怎么回事？A：把PACKAGE GEOMETRY 的PLACE_BOUND_TOP 勾掉即可.8. Q：请问在allegro中,怎様画一条沒有绿漆的綫??A：同样位置再画一根sold mask的线9. Q： 如何将走线的尖角过渡改成圆弧？A：可以直接画圆弧上去，记得勾上replace etch，原来的线就没了或使用slide 命令﹐然后在右邊的tab option選項中的comers改成arc,再去移動線﹐就可以改成圓弧﹗10.Q： allegro中覆铜的基本步骤是怎样的？A：edit/shape进入shape编辑模式——edit/change net(pick)点上GND net——shape/parameters设置相关参数（看help）——void/auto进行shape处理——shape/fill退出shape编辑模式。11. Q：怎么设置参数才能得到THERMAL REILIF 的连接呢？A：在画完铺铜范围以后，菜单会进入铺铜状态这时shape－－>parameters...对于负片，在做热漂移焊盘前，必须先定义各类焊盘的FLASH SYMBOL，*.FSM文件，然后加到各类焊盘的铺铜层，再铺铜。做出光绘文件就能看见连接了。12.Q：请教如何修改手工铜的角度，还有就是我要在铜箔里挖一个VIA 或一个PIN 的空间，该如何做？？？？？？？？？A：edit-->shape,选取铜箔,点右键done,这时菜单改变了,可以用edit-->vertex 修改顶点的方式修改铜箔边框角度.而挖空间要用到void中的shpe(多边形)或circle(圆形)或Element(零件外形)要不干脆auto一下,自动会帮你挖好13 Q：Regular pad 、Anti-pad 和Thermal pad的区别A：真实焊盘大小、带隔离大小焊盘、花焊盘14.Q： 怎么做方形（或其他非圆形）负片热汗盘？A：做一个方形（或其他非圆形）的shape symbol，然后再在做pad时将shape symbol赋给flash～～15.Q： ALLEGRO中DRC标记的显示，是否可以显示为填充的，也就是像VIA那样实心的。 A：当然可以了setup-->user preferences...勾选Display中的display_drcfill. 16. Q：allegro中怎么加泪滴(teardrop）？ A： 要先打开所有的走线层，执行命令route->gloss->parameters.., 出现对话框，点选 pad and T connection fillet，再点其左边的方格，点选circular pads,pins,vias,T connections./OK/GLOSS即可。加泪滴最好在出GERBER之前加。若要MODIFY板子，则要先删掉泪滴，执行命令EDIT/DELETE，右边的FIND栏中选CLINE，下面的FIND BY NAME 中选property,点more，选FILLET=，/点APPLY/OK即可。无论加泪滴还是删掉泪滴，一定要先打开所有的走线层，否则，没打开的走线层就不会有执行 17. Q：在ALLEGRO里打开的BRD里可导出元件，但是导出的元件如何加到库里？ A：File-->Export-->Libraries...再将*.txt拷到你的device库中，*.pad拷到pad库中，其他的拷到你的psm库中。 18.Q： ALLEGRO中有自动存盘系统吗？？ A：自动存盘需要用户自己设置，具体方法如下：（你没设置前是否有默认目录，找找看） setup>user preferences editer autosave 设定自动存盘 autosave_dbcheck: 设置存盘时是否需要数据检查，如果此项设为存盘时需要数据检查则会使存盘时间加长。 autosave_time: 自动存盘时间设置。默认值为30分钟，自动存盘时间设定范围10~100分钟。 19.Q: 请问在制作元件的时候怎么定义元件的高度？ A:当你铺好place_bound_top层shape以后，再执行Setup-->Areas-->Package Height,点击shape，此时Option 面板上就可以输入高度了～～～ 20 Q:为什么在ALLEGRO的零件PADS显示都是PADS外框线，怎样才能显示整个PADS，请指教！ A:Setup-->Drawing Options...Display: Filled pads and cline endcaps 勾选 21.Q:请问各位在Padstack Designer中的Padstack Layers的FILMMASK的作用及用**?? A:好像是用于助焊的，大小跟焊盘一样大的 22. Q:请问如何设置在走线时,不自动避开 A:右边的OPTIONS里面的BUBBLE边上那个框里面先OFF 23.Q:在两组插槽中间走了一组排线，由于在ＣＣＴ中使用无网格步线，所以线与线的间距有大有小，有没有办法将一组线间距调整到等距宽度，这样比较美观。在Ａｌｌｇｅｏ或ＣＣＴ中有无此调线的命令？ A:In cct, you can use post-route, spread wire and center wire. In allegro, you can use roue-glosss-parameter-ceneter lines between pads. 24.Q:请问如何有选择性的更改，如，我只要改一个焊盘，或者我只要改一个器件 A:padstack--replace里可以改一个盘，或一个元件，或一类器件， 25. Q:如何在内层看到therml孔 A:正片可以直接看到呀，负片在光绘文件上就可以看到的。在setUP\drawing options 中的display 中的thermal pads 打勾就是了 26.Q： 如何在rename的时候把部分器件保护起来？！[ A：给你所有要重新rename位号的器件添加一个auto_rename属性！ 27.Q：怎么在ALLEGRO下使铺的铜不被涂上阻旱剂？ A： 开阻焊窗。在阻焊层铺一块同样大小铜。 28. Q：这是我设计的一块双面板,上下两部分是对称的,现已经将上半部分的线布完,我想将这部分的线复制到下半部分,要求沿水平方向翻转下来,请教如何在Allegro中实现,请指教~~~~ A：在COPY 命令下，如果要mirror 多条线时，先拉个框选种，然后要鼠标左键点一下（这时被选种的内容可以移动），然后再右击，出现的"Mirror Geometry"选项就不显灰了呀发贴时间： Dec 12 2005 4:53PM ||Chris Li Offline发表：929. Q：有一个LOGO，是.bmp 图象文件，请问怎样将它导入ALLEGRO设计中，并且以SILKSCREEN的形式显示 A：借助第三方軟件﹐把*.bmp 轉成*.dxf,然后在allegro 中導入dxf 文件﹗﹗﹗先将bmp 转成dxf，再生成format symbo！ 30. Q：如何让VIA在BGA的PIN间居中: A：你只能直接输入坐标定位，算好间距后，然后用矩阵复制就可以了。矩阵复制就是，选中copy按钮，在option下面的Qty下分别填入数值，即可复制 X表示横向复制 Y表示纵向复制 Qty表示你要复制几次（就是说复制几个via） Spacing表示复制的这几个via间距都是多少 Order表示复制的方向。比如X方向复制，你在Order选择Right，就是从你复制的这个原始via开始向右复制依次的Left 表示向左复制。Down和Up分别表示向下和向上复制。 31. Q ：请教ALLEGRO中的Manufacture->dfa check的功能为何?? A：深层次的应用，需要Skill语言的支持 32. Q：如何在Allegro中只显示连线，不显示同一层的铺铜有的时候检查某一层的时候，既有连线又有铺铜很难检查 A：可以将除了铺铜之外的所有线都hilight那么就只有铺铜是Dehilight 然后使用Display--Color Priority，关闭铺铜的那个颜色这时候，这一层就只显示连线了不过需要注意的是，这一层的via、pad、等等的颜色不能和铺铜的颜色一样，否则将会一起不显示了, 也可以改变shape显示的格点,在user preference editor中display选项卡,将display_shapefill一栏中的值填5～10之间的某个数(象素),这样shape在显示时就不是那么显眼了. 33. Q：请教Allegro的两个功能 Setup------Property Definitions 有什么功能和如何使用 Setup------Define Lists……怎么用 A：请参考下面： Setup------Property Definitions 是添加一些用户的设定，虽然Allegro 里的Edit Property里的设定已经很多了，可能还有很多用户希望的没有，所以用户可以自己发挥； Setup------Define Lists 可以输出相关的信息，按照上面的选项，点击->按钮选add，然后选show就可以了， 34. Q： 请教如何替换封装? A：请参考下面：在Device中定义的语法是： PACKAGEPROP ALT_SYMBOLS '(Subclass:Symbol,...;Subclass:Symbol,...)' 其中Subclass可设定为Top层和Bottom层，Top层的表示可以用“T”来表示，Bottom层的表示可以用“B”来表示。若Subclass没有进行设定表示，系统会认为是Top层。例：原先的零件包装为R0805，我们要设定它可以和Top曾的R0603和Bottom层的R1206进行包装的转换。 Device File中的定义： PACKAGE R0805 CLASS IC PINCOUNT 2 PACKAGEPROP ALT_SYMBOLS '(T：R0603；B：R1206)' END 这个Device文档就表示R0805这颗零件可以和top层上包装为R0603和Bottom层的零件包装为R1206的零件进行更换。注：一定要用一组单引号把所要转换的零件框在里面。35. Q：执行什么动作才能让已有的via转换为测试点，或者你们是怎么生成测试点的。 A：rout-->testprep-->auto...中选中replace via 36. Q：请教一个奇怪的铺铜现象我用ADD_SHAP_SOLID FILL,设LIN WIDTH 为4,加上后用了EDIT SHAP,设网络名为GND,并使 VOID AUTO.但是不能自动避开其它网络. A：请参考下面：不能小与0.003 0.003是指当执行Auto void时小于这个值的shape就自动删除，单位为：平方英寸。 37.Q：请问View--Color view save是什么作用A：第一个Complete，保存后的文件用写字板打开可以看到当前打开的所有颜色的记录第二个选项是记录了之前对显示哪些、不显示那些的操作 38.Q：我在SETUP USER PREFERENCES里面进行了设置,但退出后就没有了,不能保存?下次进入还是缺省值? A：参考下面：问题主要可能是：因为Allegro不支持空格符号，而Windows XP系统装好Allegro后默认的Pcbenv会放在用户目录下，即： d:\Documents and Settings\×××\pcbenv 而其中正好有空格。解决方案为：更改Pcbenv的位置。步骤： 1． 右击我的电脑，进入属性设置?高级?环境变量 2． 点击系统变量的新建，变量名：home 变量值：任何一个绝对路径，注意不要有空格的路径，例：D:确定就可以了 39. Q：请教怎么样做一个弧形阵列的元件! A：你在加Pin的时候，option里的copy mode选polar就可以了，其它和普通加矩阵pin设置差不多！ 40. Q：ALLEGRO特殊规则区是怎样做出来的（例如线进入这个区域线宽会有变化） A：setup->constraints-> add area 在spacing / physical rules set 的set value 中設定一種所需的spacing/physical edit ->properties 選剛才畫的area(that is a shape) 選net_spacing_type net_physical_type 填入一個名字,最好能表現他的屬性, setup->constraints-> 在spacing / physical rules set 中分別點assignment table 套用上去就可以了. 另外,還有一種添加area 的方法. add -> shape ->unfilled class board geometry sub_class constraint_area

1. Q：我的ALLEGRO 是14.0版本的，FILE——EXPORT——后面就没有看到SUB DRAWING的命令了。如果用EDIT——COPY的话又不能把A板的线贴到B板上，我该怎么办？A: 是不是你启动Allegro 时Cadence Product Choices 没选好,要选PCB Dedign Expert 或Allegro Expert~~~2. Q: 在ALLEGRO中，找个器件好难啊，他只是点亮器件而光标不移动到器件那里。请问各为大侠，有没办法可以象POWERPCB 那样，查找零件时光标跟着移动？A:确认将元件点亮后，将鼠标移动至右下角的小显示框中，单击左键，光标即可自动转到所点亮的元件处.3. Q: 将logic_edit_enabled打开后，只能删除单个的net, logic_edit_enabled打开".是從何處打開???A: 在14.2中的操作：Setup -> User Preferences Editor -> Misc -> logic_edit_enabled然后可以在LOGIC/NET LOGIC 下删除NET。4. Q: 想移动元件的某一个PIN ， 请问该如何做。用move 命令， 总提示Symbol or drawing must have UNFIXED_PINS property。A: edit -> properties 选中要move Pin的元件的symbols，增加UNFIXED_PINS 属性即可。5.Q: how can i get rid of the "dynamic length" dialogue box?A: Setup -> User Preferences Editor ->Etch>allegro_etch_length_on6 .Q： 请问如何將以删除的PIN NUMBER及SILKSCREEN还原??A：删除此零件,再重新导入~~~或可以直接UPDATE 零件也可以7. Q：从orcad导入后，place->quickplace，但是出来的元件上面很多丝横，就和铺铜一样，怎么回事？A：把PACKAGE GEOMETRY 的PLACE_BOUND_TOP 勾掉即可.8. Q：请问在allegro中,怎様画一条沒有绿漆的綫??A：同样位置再画一根sold mask的线9. Q： 如何将走线的尖角过渡改成圆弧？A：可以直接画圆弧上去，记得勾上replace etch，原来的线就没了或使用slide 命令﹐然后在右邊的tab option選項中的comers改成arc,再去移動線﹐就可以改成圓弧﹗10.Q： allegro中覆铜的基本步骤是怎样的？A：edit/shape进入shape编辑模式——edit/change net(pick)点上GND net——shape/parameters设置相关参数（看help）——void/auto进行shape处理——shape/fill退出shape编辑模式。11. Q：怎么设置参数才能得到THERMAL REILIF 的连接呢？A：在画完铺铜范围以后，菜单会进入铺铜状态这时shape－－>parameters...对于负片，在做热漂移焊盘前，必须先定义各类焊盘的FLASH SYMBOL，*.FSM文件，然后加到各类焊盘的铺铜层，再铺铜。做出光绘文件就能看见连接了。12.Q：请教如何修改手工铜的角度，还有就是我要在铜箔里挖一个VIA 或一个PIN 的空间，该如何做？？？？？？？？？A：edit-->shape,选取铜箔,点右键done,这时菜单改变了,可以用edit-->vertex 修改顶点的方式修改铜箔边框角度.而挖空间要用到void中的shpe(多边形)或circle(圆形)或Element(零件外形)要不干脆auto一下,自动会帮你挖好13 Q：Regular pad 、Anti-pad 和Thermal pad的区别A：真实焊盘大小、带隔离大小焊盘、花焊盘14.Q： 怎么做方形（或其他非圆形）负片热汗盘？A：做一个方形（或其他非圆形）的shape symbol，然后再在做pad时将shape symbol赋给flash～～15.Q： ALLEGRO中DRC标记的显示，是否可以显示为填充的，也就是像VIA那样实心的。 A：当然可以了setup-->user preferences...勾选Display中的display_drcfill. 16. Q：allegro中怎么加泪滴(teardrop）？ A： 要先打开所有的走线层，执行命令route->gloss->parameters.., 出现对话框，点选 pad and T connection fillet，再点其左边的方格，点选circular pads,pins,vias,T connections./OK/GLOSS即可。加泪滴最好在出GERBER之前加。若要MODIFY板子，则要先删掉泪滴，执行命令EDIT/DELETE，右边的FIND栏中选CLINE，下面的FIND BY NAME 中选property,点more，选FILLET=，/点APPLY/OK即可。无论加泪滴还是删掉泪滴，一定要先打开所有的走线层，否则，没打开的走线层就不会有执行 17. Q：在ALLEGRO里打开的BRD里可导出元件，但是导出的元件如何加到库里？ A：File-->Export-->Libraries...再将*.txt拷到你的device库中，*.pad拷到pad库中，其他的拷到你的psm库中。 18.Q： ALLEGRO中有自动存盘系统吗？？ A：自动存盘需要用户自己设置，具体方法如下：（你没设置前是否有默认目录，找找看） setup>user preferences editer autosave 设定自动存盘 autosave_dbcheck: 设置存盘时是否需要数据检查，如果此项设为存盘时需要数据检查则会使存盘时间加长。 autosave_time: 自动存盘时间设置。默认值为30分钟，自动存盘时间设定范围10~100分钟。 19.Q: 请问在制作元件的时候怎么定义元件的高度？ A:当你铺好place_bound_top层shape以后，再执行Setup-->Areas-->Package Height,点击shape，此时Option 面板上就可以输入高度了～～～ 20 Q:为什么在ALLEGRO的零件PADS显示都是PADS外框线，怎样才能显示整个PADS，请指教！ A:Setup-->Drawing Options...Display: Filled pads and cline endcaps 勾选 21.Q:请问各位在Padstack Designer中的Padstack Layers的FILMMASK的作用及用**?? A:好像是用于助焊的，大小跟焊盘一样大的 22. Q:请问如何设置在走线时,不自动避开 A:右边的OPTIONS里面的BUBBLE边上那个框里面先OFF 23.Q:在两组插槽中间走了一组排线，由于在ＣＣＴ中使用无网格步线，所以线与线的间距有大有小，有没有办法将一组线间距调整到等距宽度，这样比较美观。在Ａｌｌｇｅｏ或ＣＣＴ中有无此调线的命令？ A:In cct, you can use post-route, spread wire and center wire. In allegro, you can use roue-glosss-parameter-ceneter lines between pads. 24.Q:请问如何有选择性的更改，如，我只要改一个焊盘，或者我只要改一个器件 A:padstack--replace里可以改一个盘，或一个元件，或一类器件， 25. Q:如何在内层看到therml孔 A:正片可以直接看到呀，负片在光绘文件上就可以看到的。在setUP\drawing options 中的display 中的thermal pads 打勾就是了 26.Q： 如何在rename的时候把部分器件保护起来？！[ A：给你所有要重新rename位号的器件添加一个auto_rename属性！ 27.Q：怎么在ALLEGRO下使铺的铜不被涂上阻旱剂？ A： 开阻焊窗。在阻焊层铺一块同样大小铜。 28. Q：这是我设计的一块双面板,上下两部分是对称的,现已经将上半部分的线布完,我想将这部分的线复制到下半部分,要求沿水平方向翻转下来,请教如何在Allegro中实现,请指教~~~~ A：在COPY 命令下，如果要mirror 多条线时，先拉个框选种，然后要鼠标左键点一下（这时被选种的内容可以移动），然后再右击，出现的"Mirror Geometry"选项就不显灰了呀发贴时间： Dec 12 2005 4:53PM ||Chris Li Offline发表：929. Q：有一个LOGO，是.bmp 图象文件，请问怎样将它导入ALLEGRO设计中，并且以SILKSCREEN的形式显示 A：借助第三方軟件﹐把*.bmp 轉成*.dxf,然后在allegro 中導入dxf 文件﹗﹗﹗先将bmp 转成dxf，再生成format symbo！ 30. Q：如何让VIA在BGA的PIN间居中: A：你只能直接输入坐标定位，算好间距后，然后用矩阵复制就可以了。矩阵复制就是，选中copy按钮，在option下面的Qty下分别填入数值，即可复制 X表示横向复制 Y表示纵向复制 Qty表示你要复制几次（就是说复制几个via） Spacing表示复制的这几个via间距都是多少 Order表示复制的方向。比如X方向复制，你在Order选择Right，就是从你复制的这个原始via开始向右复制依次的Left 表示向左复制。Down和Up分别表示向下和向上复制。 31. Q ：请教ALLEGRO中的Manufacture->dfa check的功能为何?? A：深层次的应用，需要Skill语言的支持 32. Q：如何在Allegro中只显示连线，不显示同一层的铺铜有的时候检查某一层的时候，既有连线又有铺铜很难检查 A：可以将除了铺铜之外的所有线都hilight那么就只有铺铜是Dehilight 然后使用Display--Color Priority，关闭铺铜的那个颜色这时候，这一层就只显示连线了不过需要注意的是，这一层的via、pad、等等的颜色不能和铺铜的颜色一样，否则将会一起不显示了, 也可以改变shape显示的格点,在user preference editor中display选项卡,将display_shapefill一栏中的值填5～10之间的某个数(象素),这样shape在显示时就不是那么显眼了. 33. Q：请教Allegro的两个功能 Setup------Property Definitions 有什么功能和如何使用 Setup------Define Lists……怎么用 A：请参考下面： Setup------Property Definitions 是添加一些用户的设定，虽然Allegro 里的Edit Property里的设定已经很多了，可能还有很多用户希望的没有，所以用户可以自己发挥； Setup------Define Lists 可以输出相关的信息，按照上面的选项，点击->按钮选add，然后选show就可以了， 34. Q： 请教如何替换封装? A：请参考下面：在Device中定义的语法是： PACKAGEPROP ALT_SYMBOLS '(Subclass:Symbol,...;Subclass:Symbol,...)' 其中Subclass可设定为Top层和Bottom层，Top层的表示可以用“T”来表示，Bottom层的表示可以用“B”来表示。若Subclass没有进行设定表示，系统会认为是Top层。例：原先的零件包装为R0805，我们要设定它可以和Top曾的R0603和Bottom层的R1206进行包装的转换。 Device File中的定义： PACKAGE R0805 CLASS IC PINCOUNT 2 PACKAGEPROP ALT_SYMBOLS '(T：R0603；B：R1206)' END 这个Device文档就表示R0805这颗零件可以和top层上包装为R0603和Bottom层的零件包装为R1206的零件进行更换。注：一定要用一组单引号把所要转换的零件框在里面。35. Q：执行什么动作才能让已有的via转换为测试点，或者你们是怎么生成测试点的。 A：rout-->testprep-->auto...中选中replace via 36. Q：请教一个奇怪的铺铜现象我用ADD_SHAP_SOLID FILL,设LIN WIDTH 为4,加上后用了EDIT SHAP,设网络名为GND,并使 VOID AUTO.但是不能自动避开其它网络. A：请参考下面：不能小与0.003 0.003是指当执行Auto void时小于这个值的shape就自动删除，单位为：平方英寸。 37.Q：请问View--Color view save是什么作用A：第一个Complete，保存后的文件用写字板打开可以看到当前打开的所有颜色的记录第二个选项是记录了之前对显示哪些、不显示那些的操作 38.Q：我在SETUP USER PREFERENCES里面进行了设置,但退出后就没有了,不能保存?下次进入还是缺省值? A：参考下面：问题主要可能是：因为Allegro不支持空格符号，而Windows XP系统装好Allegro后默认的Pcbenv会放在用户目录下，即： d:\Documents and Settings\×××\pcbenv 而其中正好有空格。解决方案为：更改Pcbenv的位置。步骤： 1． 右击我的电脑，进入属性设置?高级?环境变量 2． 点击系统变量的新建，变量名：home 变量值：任何一个绝对路径，注意不要有空格的路径，例：D:确定就可以了 39. Q：请教怎么样做一个弧形阵列的元件! A：你在加Pin的时候，option里的copy mode选polar就可以了，其它和普通加矩阵pin设置差不多！ 40. Q：ALLEGRO特殊规则区是怎样做出来的（例如线进入这个区域线宽会有变化） A：setup->constraints-> add area 在spacing / physical rules set 的set value 中設定一種所需的spacing/physical edit ->properties 選剛才畫的area(that is a shape) 選net_spacing_type net_physical_type 填入一個名字,最好能表現他的屬性, setup->constraints-> 在spacing / physical rules set 中分別點assignment table 套用上去就可以了. 另外,還有一種添加area 的方法. add -> shape ->unfilled class board geometry sub_class constraint_area

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