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EDA/IC设计

波特图仪的SPICE陷阱

MultiSim SPICE仿真与电路设计软件提供了多种测量仪器仿真功能,其中之一就是波特图仪(Bode Plotter),它可为指定的任何电路产生波特图,如图1所示。值得注意的是,其分析结果并非取决于V1的驱动频率。

2019-08-18 标签:multiSimspice 30

晶振停振的原因分析

有许多工程师在遇到,晶振在电路板,一会儿起振,一会儿不起振,或用电吹风吹一下又可以正常工作等问题。这个时候就开始怀疑是否是晶振出问题了,其实我们不能下太早结论,必须抓到问题核心,才能做出正确判断。

2019-08-18 标签:电路板晶振 97

PCB LAYOUT中电容的作用

实际上,芯片附近的电容还有蓄能的作用,这是第二位的。你可以把总电源看作密云水库,我们大楼内的家家户户都需要供水,这时候,水不是直接来自于水库,那样距离太远了,等水过来,我们已经渴的不行了。实际水是来自于大楼顶上的水塔,水塔其实是一个Buffer的作用。

2019-07-27 标签:pcb电容 148

altium designer网络标号的作用范围

Altium Designer提供了6类网络标识:Net Label(网络标号),Port(端口),Sheet Entry(图纸入口),Power Port(电源端口),Hidden Pin(隐匿引脚)、Off-sheet Connector(图纸外连接符)。

2019-07-13 标签:altiumnet 187

altium designer的不同原理图怎么分别导入不同p...

在Altium Designer中,我们可以用Altium Designer设计同步装置把设计资料从一个区域转到另一个区域,它包括比较工具、ECO以及UPDATER。它可以用于原理图和PCB之间的转换,Altium Designer中导入网络表不在是必须的。

2019-07-13 标签:pcbaltium 180

三个步骤设计PCB板

常见的元器件原理图库都会自带,但是一些特殊的元器件需要自己画,比如特殊芯片、晶体管、数码管等;找出所需的元器件,然后排列得当之后,按照要实现的电路功能连线;画好原理图后,可生成BOM表。

2019-07-07 标签:pcb元器件 173

两种类型PCB布线策略

不同类型的单板,其布线策略自然也不一样,本文内容主要为大家介绍两种类型的PCB布线策略。

2019-07-07 标签:pcb布线 104

OrCAD将原理图中导出并保存至器件库的详细步骤

近期在研究FPGA System Planner的过程中,发现在调用原理图符号时需要指定一个原理图器件库,而本人设计中使用的FPGA符号与之前创建的不太一样,为了精准无误地进行设计,需要将FPGA从原理图中导出并保存至器件库。本文将这个方法分享给读者。

2019-06-30 标签:fpgaorcad 410

Allegro的通用等长规则设置方法

本例中需要实现PCI-e金手指到EMMC芯片等长,包括D0-D7,CLK,CMD这10条网络。查看各条网络,确认是否存在串联匹配电阻。本例中,仅在时钟线上存在,如下图的高亮器件。

2019-06-22 标签:pcballegro 197

PCB Layout抑制串扰的3W线距原则

串扰(Crosstalk)是指信号线之间由于互容(信号线之间的空气介质相当于容性负载),互感(高频信号的电磁场相互耦合)而产生的干扰,由于这种耦合的存在,当一些信号电平发生变化的时候,在附近的信号线上就会感应出电压(噪声),在电路设计中,抑制串扰最简单的方法就是在PCB Layout中遵循3W原则。

2019-06-22 标签:pcb串扰 142

Allegro设计PCB板的Out Of Date Shap...

使用Allegro设计PCB板时,查看Status,经常会遇到out of date shapes的警告信息,具体如下:

2019-06-16 标签:pcballegro 132

Allegro中导入Outline的方法步骤

在PCB设计过程中,EDA工程师常常需要匹配两代PCB的结构,这种情况下,将上一代PCB的Outline(板框)导入新的PCB设计文件中,就可以大大缩短时间,而且尺寸完全准确。我看到常常有网友检索类似的信息,所以打算图文并茂的方式为读者讲解Allegro中导入Outline的方法。

2019-06-16 标签:pcbedaallegro 196

PCB Layout不当引起CPU工作不稳定的解决方法

在高速数字电路中,CPU的功耗往往随着主频的提升而增大,如果PCB Layout不当,则可能会引起CPU工作不稳定,本人就曾经遇到过。Marvell 88F6282 CPU运行在2GHz主频时,进行Memory Test测试,发现CPU常常不工作,而且每次不工作的时间点没什么规律,但是当CPU降频到1.6GHz运行时,这种现象不会发生。

2019-06-01 标签:pcbcpu 271

Allegro合并铜皮的方法

Allegro中如何合并铜皮,这又是一篇有关Allegro操作的简短文章,同样是近期很多读者搜索的。Allegro中简单快捷的绘制Shape的操作,是我非常喜欢Allegro的一个原因,使用者可以轻易地绘制出各种需要的Shape。

2019-06-08 标签:allegro 182

Allegro修改dra封装引脚编号的快捷方式

在Allegro中,有这样一种情况:一个dra封装已经创建完成,但是不小心排错了引脚顺序,需要修改为正确的。我相信这是EDA工程师经常遇到的问题。这个时候,重新放置一遍焊盘工作量确实比较大,而且有再次出错的可能。其实Allegro已经提供了一种便捷的修改引脚编号的方式,只是很多人不知道,本文将对这种快捷的方式做介绍。

2019-05-26 标签:引脚allegro 331

Allegro导入DXF文件的详细步骤

EDA工程师在PCB设计过程中,往往需要与结构工程师打交道,结构图纸即DXF文件就是结构工程师与EDA工程师沟通的媒介。本文针对Allegro导入DXF文件的详细过程做详细说明,本人看到网上大部分相关文章写得都比较糟糕,所以撰写本文以便更好地帮助读者解决问题。

2019-05-26 标签:pcbedaallegro 210

在Allegro中设计开窗的完整操作步骤

最近常常看到读者在本站搜索Allegro开窗相关的内容, 笔者特撰写本文简单介绍一下。Allegro开窗其实就是使铜皮裸露,通常用于屏蔽罩设计,散热设计,接地设计等,无论是哪种设计,其操作方法都是一致的,本文以BeamRF中的开窗设计为例。

2019-05-18 标签:pcbAllegro 381

PCB仿真软件的电磁场求解器分类

目前商业化的PCB仿真软件主要有: Cadence公司的Sigrity、Ansys公司的SIwave/HFSS、CST公司的CST、Mentor公司的HyperLynx、Polor公司的Si9000等。不同的仿真软件所使用的电磁场求解器各不一样,但是可以大致分为几类:

2019-05-18 标签:pcb 149

AD软件的3种栅格设置详解

AD16系统共有3种栅格:可视栅格、电气栅格、捕捉栅格,作用是画图时,让零件、导线排列整齐好看。

2019-05-12 标签:pcb栅格 1085

基于EP4CE10F17C8N芯片详解Altera Cycl...

器件系列 + 器件类型(是否含有高速串行收发器) + LE逻辑单元数量 + 封装类型 + 高速串行收发器的数量(没有则不写) + 引脚数目 + 器件正常使用的温度范围 + 器件的速度等级 + 后缀

2019-05-12 标签:收发器altera 1492

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