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Zynq-7000 SoC生产勘误项目及应对措施

2018年07月05日 08:38 次阅读

Zynq-7000 生产勘误项目是(Xilinx 答复 47916)中所列项目的子集,通常包括由 Xilinx 和 Linux 社区实现的软件解决方法应对措施。

下表是每个生产勘误项目的状态。

注:第三方勘误项目(如 Arm)在(Xilinx 答复 55518)中列出。

用户功能列图例:

~ = 不适用

^ = 指交替列

v = 没有解决方法,被视为一个极小的问题

X = 解决方法已落实(或即将落实)或者问题可避免

# = 咨询用户,评估其情形

* = 无法提供解决方法

= 调查中

用户指南列:本列包含关于实现解决方法的说明。

解决方法说明列:本列包含关于实现解决方法的具体评论,或解决方法可能不适用的原因。每个勘误项目及可能的解决方法的详细情况都在单独的 Xilinx 答复记录中进行了具体说明。

注意:随着新工具、文档以及 Zynq 解决方案的其它组件的发布,该信息将会发生变化。

生产勘误项目:

Zynq-7000 SoC生产勘误项目及应对措施

Zynq-7000 SoC生产勘误项目及应对措施

Zynq-7000 SoC生产勘误项目及应对措施

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赛灵思Virtex-7 GTX收发器演示

发表于 2018-05-24 13:49 682次阅读
赛灵思Virtex-7 GTX收发器演示

利用 AccelDSP 和 System Gen...

此次为期30分钟的视频演示介绍了 Xilinx 提供的 DSP 设计工具。我们从带有浮点 MATLA...

发表于 2018-05-24 13:47 743次阅读
利用 AccelDSP 和 System Gen...

比较 Xilinx® Virtex®-7FPGA...

设计人员呼吁提升10G+ 芯片到芯片和背板性能, 依赖接收机均衡来补偿信号失真。观看视频, 并排比较...

发表于 2018-05-23 15:47 442次阅读
比较 Xilinx® Virtex®-7FPGA...

Vivado UltraFast设计方法中文版讲...

这个培训将会深度介绍适于Xililnx 可编程门阵列的HDL代码风格, 产生和验证时序约束的正确方法...

发表于 2018-05-23 15:47 537次阅读
Vivado UltraFast设计方法中文版讲...

XILINX推出All Programmable...

Xilinx 宣布启动一项将软件、模型、平台和基于 IP 的设计环境融为一体的抽象化计划,致力于让系...

发表于 2018-05-23 15:47 453次阅读
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全志科技携车规芯T7亮相IVC 2018

2018年5月15至17日,第二届智能汽车决策者大会(IVC 2018)在上海阿纳迪酒店盛大举行,全...

发表于 2018-05-22 15:07 2008次阅读
全志科技携车规芯T7亮相IVC 2018

【PlanAhead 13.1教程】Design...

教您如使用PlanAhead 13.1进行设计应用,通过一个设计程序,来体验PlanAhead的功能...

发表于 2018-05-22 13:47 236次阅读
【PlanAhead 13.1教程】Design...

Xilinx公司Virtex-7 X690T G...

Xilinx公司介绍Virtex-7 X690T GTH Demo。

发表于 2018-05-22 13:47 268次阅读
Xilinx公司Virtex-7 X690T G...