好的，这是 74LS112 双下降沿JK触发器的中文真值表：
| PRE' (异步置位) | CLR' (异步清零) | CLK (时钟) | J | K | Q (输出) | Q' (输出) | 说明 |
|---|---|---|---|---|---|---|---|
| 0 (L) | 1 (H) | X | X | X | 1 (H) | 0 (L) | 异步置位：Q 立刻置 1 (Q' 置 0)，无视 CLK, J, K 状态。 |
| 1 (H) | 0 (L) | X | X | X | 0 (L) | 1 (H) | 异步清零：Q 立刻置 0 (Q' 置 1)，无视 CLK, J, K 状态。 |
| 0 (L) | 0 (L) | X | X | X | 无效 | 无效 | 禁止状态：输出不定或损坏，避免使用！ |
| 1 (H) | 1 (H) | ↓ | 0 | 0 | Q₀ | Q₀' | 保持：时钟下降沿时，输出 保持 原状态不变。 |
| 1 (H) | 1 (H) | ↓ | 1 | 0 | 1 (H) | 0 (L) | 置位：时钟下降沿时，输出 置 1。 |
| 1 (H) | 1 (H) | ↓ | 0 | 1 | 0 (L) | 1 (H) | 复位：时钟下降沿时，输出 置 0。 |
| 1 (H) | 1 (H) | ↓ | 1 | 1 | ~Q₀ (翻转) | ~Q₀' (翻转) | 翻转 (Toggle)：时钟下降沿时，输出 翻转（取反原状态）。 |
| 1 (H) | 1 (H) | H 或 L 或 ↑ | X | X | Q₀ | Q₀' | 无时钟触发：时钟非下降沿时，无视 J, K 状态，输出保持稳定。 |
符号说明:
- H (High): 高电平 (
1) - L (Low): 低电平 (
0) - X (Don't Care): 任意值 (
0或1，忽略) - ↓: 下降沿（时钟信号从高电平变化到低电平的瞬间）
- ↑: 上升沿（时钟信号从低电平变化到高电平的瞬间）
- Q₀, Q₀': 在时钟下降沿触发前的输出状态（原始状态）。
- ~Q₀, ~Q₀': 时钟下降沿触发后，输出变为触发前状态的反相。
- 无效: 输出状态是不确定的或可能损坏芯片，禁止使用此状态。
- 异步置位 (PRE'): 低电平有效（引脚上有横线表示，如
PRE̅或/PRE），优先级最高。 - 异步清零 (CLR'): 低电平有效（引脚上有横线表示，如
CLR̅或/CLR），优先级最高。 - 时钟触发 (CLK): 仅当
PRE' = CLR' = H时，下降沿 (↓) 有效。此时触发器根据 J、K 的输入状态决定输出行为。
关键点总结:
- 异步优先：
PRE'和CLR'是异步控制端，低电平有效，具有最高优先级。只要它们不是同时有效（禁止状态），它们会立刻改变输出，无视时钟和 J、K 的状态。 - 禁止状态： 不要同时将
PRE'和CLR'置低电平 (0)！ 这会导致输出处于无效（不定）状态，可能损坏芯片。 - 时钟触发： 只有
PRE' = CLR' = H（高电平）时，时钟 (CLK) 才起作用。并且仅当CLK出现下降沿 (↓) 时，输出才会根据此时 J 和 K 的输入值（真值表最后 4 行）发生变化。- J=K=0：保持原状态
- J=1, K=0：置 1
- J=0, K=1：置 0
- J=K=1：翻转（原状态取反）
- 时钟非下降沿： 当时钟是稳定的高电平 (
H)、稳定的低电平 (L) 或上升沿 (↑) 时，即使PRE' = CLR' = H，输出也不会因 J、K 而变化，保持稳定。
希望这份详细的中文真值表能帮助您理解和使用 74LS112 的功能！
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