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随着市场智能手机平台和平板电脑对芯片性能和上市时间要求的不断提升，后端工程师面临的设计压力会越来越大。传统的数字实现流程在满足当今 SoC 设计的功耗、频率与面积要求方面正在达到极限。那如何在很短的时间内迅速实现芯片功耗、频率与面积的提升变的尤为重要。
本文基于 SMIC 40nm 低功耗工艺的 ARM Cortex A9 物理设计的实际情况，详细阐述了如何使用 cadence 最新的时钟同步优化技术，又称为 CCopt 技术来实现统一的时钟树综合和物理优化。根据实现的结果来看，CCopt 引擎很好的实现了目标。实现 8%的设计频率提升，并实现了时钟树功率与面积降低。Cadence 最新的 CCopt 引擎对实现复杂芯片物理设计、缩短设计周期、提升芯片性能带来了很大的优势。
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