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电子发烧友网>电子资料下载>可编程逻辑>FPGA/ASIC>基于FPGA的差分信号阻抗匹配

基于FPGA的差分信号阻抗匹配

2011-01-04 | rar | 652 | 次下载 | 5积分

资料介绍

为了节约PCB板空间,充分灵活利用FPGA内部资源,对FPGA内置差分信号匹配终端进行研究。根据差分信号阻抗匹配的基础理论,在自制的PCB电路板上利用差分信号线传递时钟和图像数据。在FPGA内设置不同类型的片内匹配终端,通过示波器观察时钟、图像数据,利用Visual DSP++软件自带的Image Viewer功能观察图像。结果表明,使用片内匹配终端不会恶化差分信号,并能大大节省PCB板空间,且终端匹配更灵活。
Abstract:
 In order to save PCB board space,fully flexible use of FPGA internal resources,it did some research about the terminal in the FPGA which was used to match the differential signal.According to the basic theory about impedance match-ing of differential signal,the clock and image data by differential signal line in the self-made PCB circuit board was trans-mitted.The different OCT(on-chip termination)was set in FPGA,and the clock and image data signals through the oscillo-scope was observed the image by Image Viewer tool in Visual DSP++was also observed.The results show that the use of on-chip differential signal matched termination does not deteriorate dofferential signal,greatly reduces PCB board space,and makes the matching about terminal more flexible.
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