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并行接口电路：
微处理器与I/O设备进行数据传输时均需经过接口电路实现系统与设备互连的匹配。
并行接口电路中每个信息位有自己的传输线，一个数据字节各位可并行传送，速度快，控制简单。由于电气特性的限制，传输距离不能太长。
8255A是通用的可编程并行接口芯片，功能强，使用灵活。适合一些并行输入/输出设备的使用。
8255A并行接口逻辑框图
三个独立的8位I/O端口,口A、口B、口C。
口A有输入、输出锁存器及输出缓冲器。
口B与口C有输入、输出缓冲器及输出锁存器。
在实现高级的传输协议时，口C的8条线分为两组，每组4条线，分别作为口A与口B在传输时的控制信号线。
口C的8条线可独立进行置1/置0的操作。
口A、口B、口C及控制字口共占4个设备号。
8255A并行接口的控制字
工作模式选择控制字：
口A有三种工作模式，口B有二种工作模式。
口C独立使用时只有一个工作模式，与口A、口B配合使用时，作为控制信号线。
三种工作模式命名为：模式0、模式1及模式2。
模式 0 为基本I/O端口，模式1为带选通的I/O端口，模式 2 为带选通的双向I/O端口。
口A可工作在三种模式下，口B可工作在模式 0与模式 1下，口C可工作在模式0下或作为控制线配合口A、口B工作。
微处理器与I/O设备进行数据传输时均需经过接口电路实现系统与设备互连的匹配。
并行接口电路中每个信息位有自己的传输线，一个数据字节各位可并行传送，速度快，控制简单。由于电气特性的限制，传输距离不能太长。
8255A是通用的可编程并行接口芯片，功能强，使用灵活。适合一些并行输入/输出设备的使用。
8255A并行接口逻辑框图
三个独立的8位I/O端口,口A、口B、口C。
口A有输入、输出锁存器及输出缓冲器。
口B与口C有输入、输出缓冲器及输出锁存器。
在实现高级的传输协议时，口C的8条线分为两组，每组4条线，分别作为口A与口B在传输时的控制信号线。
口C的8条线可独立进行置1/置0的操作。
口A、口B、口C及控制字口共占4个设备号。
8255A并行接口的控制字
工作模式选择控制字：
口A有三种工作模式，口B有二种工作模式。
口C独立使用时只有一个工作模式，与口A、口B配合使用时，作为控制信号线。
三种工作模式命名为：模式0、模式1及模式2。
模式 0 为基本I/O端口，模式1为带选通的I/O端口，模式 2 为带选通的双向I/O端口。
口A可工作在三种模式下，口B可工作在模式 0与模式 1下，口C可工作在模式0下或作为控制线配合口A、口B工作。
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