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首先说明一下，Altium Designer的Protel中进行 FPGA设计可以采用：语言设计输入，原理图符号设计输入或者混合输入。象大多数FPGA设计软件一样，我们推荐用户采取层次化的设计方式：底层设计，上层例化（调用）。在底层用语言或原理图符号设计好一个个文件，并将这些文件生成图表符，上层在原理图的环境中将这些代表各个文件的图表符连接起来，并且可以使用我们提供的各种免费的模块（如虚拟仪器，处理器，外设等），来完成设计与测试。下面的例子中，我们对一个VHDL文件进行仿真，当然，我们也可以对原理图文件建立Testbench 进行仿真。
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