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本文将接续介绍电源与功率电路基板，以及数字电路基板导线设计。
宽带与高频电路基板导线设计
a.输入阻抗1MHz，平滑性(flatness)50MHz 的OP增幅器电路基板
图26 是由FET 输入的高速OP 增幅器OPA656 构成的高输入阻抗OP 增幅电路，它的gain
取决于R1、R2，本电路图的电路定数为2 倍。
此外为改善平滑性特别追加设置可以加大噪讯gain，抑制gain-频率特性高频领域时峰值的
R3。图26 高输入阻抗的宽带OP增幅电路
图27 是高输入阻抗OP 增幅器的电路基板图案。降低高速OP 增幅器反相输入端子与接地
之间的浮游容量非常重要，所以本电路的浮游容量设计目标低于0.5pF。
如果上述部位附着大浮游容量的话，会成为高频领域的频率特性产生峰值的原因，严重时频
率甚至会因为feedback 阻抗与浮游容量，造成feedback 信号的位相延迟，最后导致频率特
性产生波动现象。
此外高输入阻抗OP 增幅器输入部位的浮游容量也逐渐成为问题，图27 的电路基板图案的
非反相输入端子部位无full ground设计，如果有外部噪讯干扰之虞时，接地可设计成网格状
(mesh)。
图28 是根据图26 制成的OP 增幅器Gain－频率特性测试结果，由图可知即使接近50MHz
频率特性非常平滑，-3dB cutoff频率大约是133MHz。
宽带与高频电路基板导线设计
a.输入阻抗1MHz，平滑性(flatness)50MHz 的OP增幅器电路基板
图26 是由FET 输入的高速OP 增幅器OPA656 构成的高输入阻抗OP 增幅电路，它的gain
取决于R1、R2，本电路图的电路定数为2 倍。
此外为改善平滑性特别追加设置可以加大噪讯gain，抑制gain-频率特性高频领域时峰值的
R3。图26 高输入阻抗的宽带OP增幅电路
图27 是高输入阻抗OP 增幅器的电路基板图案。降低高速OP 增幅器反相输入端子与接地
之间的浮游容量非常重要，所以本电路的浮游容量设计目标低于0.5pF。
如果上述部位附着大浮游容量的话，会成为高频领域的频率特性产生峰值的原因，严重时频
率甚至会因为feedback 阻抗与浮游容量，造成feedback 信号的位相延迟，最后导致频率特
性产生波动现象。
此外高输入阻抗OP 增幅器输入部位的浮游容量也逐渐成为问题，图27 的电路基板图案的
非反相输入端子部位无full ground设计，如果有外部噪讯干扰之虞时，接地可设计成网格状
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