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• 发布了文章 2025-05-10 11:09

  网课回放 I 升级版“一站式” PCB 设计第三期：原理图完整性及可靠性分析

  

  网课回放 I 升级版“一站式” PCB 设计第三期：原理图完整性及可靠性分析

  Cadence PCB 设计

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• 发布了文章 2025-05-10 11:08

  技术资讯 | 选择性 BGA 焊膏的可靠性

  

  随着时间的推移，采用BGA封装的器件密度不断提高，焊球数量也越来越多。由于器件之间的间距较小，焊球数量庞大且间距缩小，如今即使是一些简单的器件，也需要采用盘中孔的HDI工艺。为了确保良率，在组装时需要特别注意这些器件，并通过有针对性的X射线检查，确保成功焊接。进入大批量生产阶段后，通常会面临降低成本的压力。为此，人们往往从高焊球数器件上的焊膏印刷入手。更换材

  BGA 器件 焊膏

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• 发布了文章 2025-04-25 20:16

  受控阻抗布线技术确保信号完整性

  

  核心要点受控阻抗布线通过匹配走线阻抗来防止信号失真，从而保持信号完整性。高速PCB设计中，元件与走线的阻抗匹配至关重要。PCB材料的选择（如低损耗层压板）对减少信号衰减起关键作用。受控阻抗布线如何保障信号完整性为实现电路信号完整性，需遵循以下设计规范：避免直角走线、隔离时钟信号与电源信号、保持元件间最短距离。受控阻抗布线通过调整走线尺寸和环境参数，使其特性阻

  PCB设计 信号完整性 阻抗 阻抗匹配

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• 发布了文章 2025-04-11 17:21

  技术资讯 | 信号完整性测试基础知识

  

  本文重点信号完整性测试需要从测试电路板和原型获取实验数据并加以分析。在理想的工作流程中，还会仿真信号完整性指标，并将其与实际测量值进行比较。信号完整性测试只能检查特定的结构，通常需要在测试前设计和仿真测试电路板。为确保可靠性并符合行业标准，高速PCB和高频PCB必须经过一系列测试。其中许多测试都是由层压板供应商或PCB制造商执行，这有助于确保符合安全和环境法

  信号完整性 分析仪 测试

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• 发布了文章 2025-04-03 21:32

  辅助协作的简单原理图文档

  

  电子设备的原理图作为PCB设计的基础用于显示电路图。除了定义器件和电路之间的电气连接之外，原理图还有更深层次的作用：展示理解设计所需的文档。这是一种前端文档，要充分理解设计的核心功能、过去的修订版本以及器件之间的高级连接，此文档必不可少。如果希望在单个文档中准确地传达这些信息，而不是将要求分散到多个文档中，那么可以在原理图中包含一些简单的文档。对于多学科协作

  PCB设计 电子设备 电路图

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• 发布了文章 2025-03-31 14:45

  高阶研修班 第一期：SI PI工具安装准备与高效学习技巧

  

  李老师经过深思熟虑和精心整理，历时五日，为大家构建了一个全面而系统的学习框架，涵盖了信号完整性（SI）、电源完整性（PI）、高速接口、反射、串扰、电源分配网络（PDN）、电源噪声、高速接口、SERDES、DDR5/

  仿真 信号完整性 电源完整性

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• 发布了文章 2025-03-21 13:53

  PCB 边缘连接器：高速性能

  

  本文要点PCB边缘连接器是实现高速数据传输和模块化组装的首选系统集成解决方案。在电路板边缘和连接器之间的适当匹配中，需要采用斜切工艺来保护连接器引脚。边缘连接器的选型取决于连接板的组装要求和制造约束条件。PCB边缘连接器采用多条并行数据线实现高数据吞吐量。在系统集成中，各器件的形状和尺寸不一：设计人员可以根据电路板的制造需求调整连接器，而在所有连接器中，PC

  pcb PCB 电路板 连接器

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• 发布了文章 2025-03-21 13:53

  【3/25 正式开课】I SI/PI与EMC通道互连建模仿真设计优化高阶研修班

  

  本课程是专为电子工程领域专业人士开设的高阶培训课程，旨在通过深度解析与实践操作，提升学员在信号完整性、电源完整性、电磁兼容性（EMC）及高速通道互连设计方面的综合能力。本课程由行业资深产品工程师李增担任讲师，以业界领先的仿真软件SigrityXPlatform为操作平台，结合AI驱动的设计优化技术，全面覆盖SI、PI、EMC及高速通道互连设计的核心知识点。通

  emc 仿真设计 建模仿真

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• 发布了文章 2025-03-14 18:15

  多板 PCB 组装中最常见的逻辑错误

  

  许多电子系统和产品并不只使用1个PCB，而是可能包含多个电路板、单个电路板和多个外部模块，或者通过电缆与外部设备连接。在多板系统中，两个电路板之间可能会出现逻辑错误，但如果没有全面审查设计，可能到电路板原型制作结束后，也无法发现这些错误。幸运的是，您可以采取一些简单的解决方案和设计选择，避免电路板之间出现这些逻辑连接错误。01什么是电路板之间的逻辑连接错误？

  pcb PCB PCB组装 电路板

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• 发布了文章 2025-03-14 18:14

  技术资讯 | CMOS 噪声容限值

  

  在描述高速运行的数字系统时，噪声容限是最重要的参数之一。通常情况下，噪声容限定义了I/O引脚上或接口中可接受的噪声水平。在数字电子技术领域，噪声容限是指I/O引脚上出现但不会导致接收逻辑状态出错的噪声水平。这个值在时域中经常调用，用于测量比特误码率。如果您正在设计高速PCB并需要执行串扰检查，首先应明确评估成功的具体标准。从数字器件的CMOS噪声容限值入手是

  CMOS pcb PCB 电子产品

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