实验目的
实验任务
设计一个4位奇偶校验器电路。要求当输入的4位二进制码中有奇数个“1”时,输出为“1”,否则输出为“0”。
实验原理
奇偶校验,即判断输入变量中1的个数。当输入变量中1的个数是奇数时,输出为1。当输入变量中1的个数是偶数时,输出为0。真值表及逻辑表达式如下所示:
Y=A’B’C’D+A’B’CD’+A’BC’D’+A’BCD+AB’C’D’+AB’CD+ABC’D+ABCD’
经过化简得到:Y=A⊕B⊕C⊕D
逻辑电路
Verilog HDL建模描述
实验步骤
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