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时钟

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时钟是生活中常用的一种计时器，人们通过它来记录时间。至今为止，在中国历史上有留下记载的四代计时器分别为：日晷、沙漏、机械钟、石英钟。

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时钟技术

倒计时时钟的设计的设计要求和Protues仿真电路图资料概述

1）设计任务：完成倒计时时钟的设计。 2）指标要求（1）能够分钟级的倒计时，分钟和秒显示。（2）倒计时的起始值可以设置。（3）具有暂停和清...

2019-07-14 标签：时钟数码管 Protues 8.2k 0

详解STM32时钟体系结构分析

RCC(复位与时钟控制器)通过AHB时钟(HCLK)8分频后作为Cortex系统定时器(SysTick)的外部时钟。通过对SysTick控制与状态寄存器...

2019-08-19 标签：电路寄存器时钟 1.2万 0

RGMII接口布线经验

网络设备一定离不开MAC和PHY，有MAC和PHY的地方就有相应的接口，无论看得见或者看不见，它就在那里，不悲不喜。在以太网中，这个接口就是介质无关接口...

2019-06-22 标签：以太网接口时钟 3.1万 1

FPGA建立时间和保持时间详解

时钟是FPGA设计中最重要的信号，FPGA系统内大部分器件的动作都是在时钟的上升沿或者下降沿进行。

2019-06-19 标签：FPGA 时钟 6.7k 0

实现任意整数分频的原理与方法讲解

分频器是一种基本电路，通常用来对某个给定频率进行分频，得到所需的频率。整数分频器的实现非常简单，可采用标准的计数器，也可以采用可编逻辑器件设计实现。但在...

2019-11-20 标签：分频器计数器时钟 7.9k 0

altera时序分析基础项目讲解

时序分析的主要对象是：在REG2中，时钟信号CLK经过路径③的有效沿，与从REG1寄存器输出的数据经过路径①到达REG2的D端时的关系。

2019-11-22 标签：寄存器时钟时序 2.4k 0

FPGA之异步练习1：设计思路

基于FPGA的数字系统设计中大都推荐采用同步时序的设计，也就是单时钟系统。但是实际的工程中，纯粹单时钟系统设计的情况很少，特别是设计模块与外围芯片的通信...

2019-11-18 标签：fpga 芯片时钟 1.6k 0

数字设计FPGA应用：时钟同步状态机的设计

状态机由状态寄存器和组合逻辑电路构成，能够根据控制信号按照预先设定的状态进行状态转移，是协调相关信号动作、完成特定操作的控制中心。

2019-12-04 标签：fpga 时钟状态机 3.6k 0

FPGA视频教程：BJ-EPM240学习板-MAX II内部震动时钟使用实验

Altera的MAX® II 系列在所有CPLD系列中，其单位I/O引脚的功耗和成本都是最低的。MAX II CPLD支持高级功能集成，以降低系统设计成本。

2019-12-12 标签：fpga cpld 时钟 3.2k 0

深入浅出玩转FPGA视频：MAX II内部震动时钟使用实验

Altera的MAX® II 系列在所有CPLD系列中，其单位I/O引脚的功耗和成本都是最低的。不但具有传统CPLD设计的低成本特性，MAX II CP...

2019-12-16 标签：fpga pll 时钟 2.8k 0

FPGA之项目实战篇：LED外设进阶

我们例举三人表决器、数字时钟、多终端点歌系统、数字示波器这四个实际的工程项目，手把手带领大家从分析工程、分解工程、到最终实现工程。通过逐个解决工程中的实...

2019-12-06 标签：fpga led 时钟 1.7k 0

时序约束步骤：系统同步与源同步

针对普通时钟系统存在着限制时钟频率的弊端，人们设计了一种新的时序系统，称之为源同步时序系统。它最大的优点就是大大提升了总线的速度，在理论上信号的传送可以...

2019-12-20 标签：时钟总线时序 5.2k 0

时序约束步骤：生成时钟约束

差分时钟是将数据从源传送到目的地有两种常用的电气方法。一种方法使用“单端”发信号概念，它在发射机和接收机之间使用两个导体。

2019-12-20 标签：数据时钟时序 2.6k 0

时序约束的四大步骤的具体介绍

FPGA中的时序问题是一个比较重要的问题，时序违例，尤其喜欢在资源利用率较高、时钟频率较高或者是位宽较宽的情况下出现。建立时间和保持时间是FPGA时序约...

2019-12-23 标签：fpga 时钟时序 4.7k 0

FPGA之FIFO练习3：设计思路

根据FIFO工作的时钟域，可以将FIFO分为同步FIFO和异步FIFO。同步FIFO是指读时钟和写时钟为同一个时钟。在时钟沿来临时同时发生读写操作。异步...

2019-11-29 标签：fpga fifo 时钟 2.2k 0

FPGA之异步练习2：设计思路

异步双方不需要共同的时钟，也就是接收方不知道发送方什么时候发送，所以在发送的信息中就要有提示接收方开始接收的信息，如开始位，同时在结束时有停止位。

2019-12-02 标签：fpga 时钟异步 1.7k 0

STM32的SysTick时钟源是来自Cortex系统定时器吗？

初始化调用这段代码之后，SysTick将会实现1ms中断一次。这段代码实现1ms中断一次相信大家都能理解，但是这里SysTick初始化和上面说的时钟『/...

2019-04-03 标签：STM32 时钟定时器 5.7k 0

需要学习并了解Linux时钟的原理及其应用

除了wall time，linux系统中也需要了解系统自启动以来过去了多少的时间，这时候，我们可以把钟表的epoch调整成系统的启动时间点，这时候获取系...

2019-05-15 标签：Linux 时钟 2.3k 0

UART（串口）收发模块设计

主要设计代码如下，通过localparam DIV_PEREM指定分频计数值。分频计数器为cnt,当enable为高时，cnt开始循环的从0递增到DIV...

2019-02-04 标签：寄存器计数器时钟 7.5k 0

基于软件的时钟的设计方案与应用

时钟周期是信号连续上升沿之间的时间。频率是上升沿出现的速率（即1/周期）。时间或频率表征时钟。在软件中，要跟踪时钟，您只需存储其中一个值。在本文中，这些...

2019-01-28 标签：嵌入式存储时钟 5.3k 0

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AMS1117系列稳压器有可调版与多种固定电压版，设计用于提供1A输出电流且工作压差可低至1V。在最大输出电流时，AMS1117器件的最小压差保证不超过1.3V，并随负载电流的减小而逐渐降低。
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德州仪器（TI）MSP430系列超低功耗微控制器包含多种器件，它们特有面向多种应用的不同外设集。这种架构与5种低功耗模式相组合，专为在便携式测量应用中延长电池使用寿命而优化。该器件具有一个强大的16位 RISCCPU，16位寄存器和有助于获得最大编码效率的常数发生器。
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　　基准电压是指传感器置于0℃的温场（冰水混合物），在通以工作电流（100μA）的条件下，传感器上的电压值。实际上就是0点电压。其表示符号为V（0），该值出厂时标定，由于传感器的温度系数S相同，则只要知道基准电压值V（0），即可求知任何温度点上的传感器电压值，而不必对传感器进行分度。
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